多通道頻率檢測(cè)儀如何設(shè)計(jì)?(下篇)
在下述的內(nèi)容中,小編將會(huì)對(duì)基于FPGA的多通道頻率檢測(cè)儀實(shí)現(xiàn)方案部分予以詳細(xì),如果頻率檢測(cè)儀的設(shè)計(jì)是您想要了解的焦點(diǎn)之一,不妨和小編共同閱讀這篇文章哦。
注意哦,本文是僅是實(shí)現(xiàn)方案部分,設(shè)計(jì)部分請(qǐng)參閱《多通道頻率檢測(cè)儀如何設(shè)計(jì)?(上篇)》。
本設(shè)計(jì)選用的FPGA芯片是Xilinx公司的Virtex-4SX55,根據(jù)上篇文章中所示的結(jié)構(gòu),得到一種基于DFT多相濾波器組的信道化解決方案,其具體實(shí)現(xiàn)結(jié)構(gòu)如圖4所示。
1、延時(shí)器的實(shí)現(xiàn)
延時(shí)器(Delay)是產(chǎn)生混響或回聲的效果器,在延時(shí)器內(nèi),從直播室機(jī)房的調(diào)音臺(tái)出來(lái)的音頻模擬信號(hào)進(jìn)入延時(shí)器后,模擬信號(hào)首先進(jìn)行A/D轉(zhuǎn)換,將模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),經(jīng)過(guò)編解碼后進(jìn)入DsP模塊,在模塊內(nèi)部自動(dòng)調(diào)整延時(shí)量,主板的單片機(jī)模塊對(duì)該信號(hào)進(jìn)行刪除延時(shí)、退出延時(shí)、重建延時(shí)等功能的實(shí)現(xiàn),之后信號(hào)再經(jīng)過(guò)D/A轉(zhuǎn)換器轉(zhuǎn)換,由數(shù)字信號(hào)轉(zhuǎn)為原模擬信號(hào)。
本延時(shí)器采用FPGA提供的專用存取模塊FIFO來(lái)實(shí)現(xiàn)32周期延時(shí),其架構(gòu)體系如圖5所示。在本設(shè)計(jì)中,級(jí)延遲器的輸出數(shù)據(jù)將作為下一個(gè)延遲器的輸入數(shù)據(jù),就相當(dāng)于級(jí)FIFO的數(shù)據(jù)按先進(jìn)先出的順序依次向第二級(jí)FIFO壓入,相鄰兩級(jí)的將滿標(biāo)志與讀使能信號(hào)進(jìn)行握手協(xié)議,從而實(shí)現(xiàn)數(shù)據(jù)的延遲輸出。
2、系數(shù)存儲(chǔ)模塊
低通濾波器是容許低于截止頻率的信號(hào)通過(guò), 但高于截止頻率的信號(hào)不能通過(guò)的電子濾波裝置。對(duì)于256階原型低通濾波器,可分成八組,每組32個(gè),分別存儲(chǔ)到八個(gè)存儲(chǔ)器當(dāng)中。存儲(chǔ)器可使用邏輯(LUT)實(shí)現(xiàn),也可使用專用存儲(chǔ)模塊Block RAM來(lái)實(shí)現(xiàn)。FIFO中的目標(biāo)數(shù)據(jù)和存儲(chǔ)器中系數(shù)做乘法運(yùn)算時(shí),兩者的對(duì)應(yīng)關(guān)系如圖6所示(以7號(hào)存儲(chǔ)器為例)。
當(dāng)8個(gè)數(shù)據(jù)存儲(chǔ)器的一個(gè)單元數(shù)據(jù)被讀出時(shí),8個(gè)系數(shù)存儲(chǔ)器的0號(hào)地址單元的系數(shù)也將同時(shí)被讀出,然后分別作乘累加,作為y(0)輸出。同理,當(dāng)8個(gè)數(shù)據(jù)存儲(chǔ)器的第二個(gè)數(shù)據(jù)被讀出時(shí),8個(gè)系數(shù)存儲(chǔ)器的1號(hào)地址單元的系數(shù)也同時(shí)被讀出,然后分別作乘累加,的結(jié)果作為y(1)輸出,以此類推,得出全部y(2)~y(31)的輸出。將y(0)~y(31)作為FFT的輸入數(shù)據(jù)進(jìn)行32點(diǎn)FFT運(yùn)算。
3、FFT的實(shí)現(xiàn)
FFT是一種DFT的高效算法,稱為快速傅里葉變換。傅里葉變換是時(shí)域一頻域變換分析中最基本的方法之一。在數(shù)字處理領(lǐng)域應(yīng)用的離散傅里葉變換是許多數(shù)字信號(hào)處理方法的基礎(chǔ)。
設(shè)計(jì)中的FFT變換可通過(guò)調(diào)用Xilinx的IP核來(lái)實(shí)現(xiàn)。FFT核的輸入輸出的引腳關(guān)系如圖7所示。
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