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[導(dǎo)讀]愛特梅爾公司(Atmel Corp)表示,該公司將量產(chǎn)一種新的可定制金屬可編程32位基于ARM的微控制器,這種微處理器被稱為可定制愛特梅爾處理器(Customizable Atmel Processors, CAP)。愛特梅爾的ASIC的市場營銷總監(jiān)Jay Joh

愛特梅爾公司(Atmel Corp)表示,該公司將量產(chǎn)一種新的可定制金屬可編程32位基于ARM的微控制器,這種微處理器被稱為可定制愛特梅爾處理器(Customizable Atmel Processors, CAP)。

愛特梅爾的ASIC的市場營銷總監(jiān)Jay Johnson表示,與通常由FPGA實現(xiàn)的DSP算法相比,新的AT91CAP可定制愛特梅爾處理器所提供的DSP算法性能要高8倍,因而,使功耗和單位IC成本得到極大地降低,下降了30%到50%之多。新的CAP器件將是愛特梅爾現(xiàn)有32位基于ARM7、ARM9及ARM11的AVR32UC3和AVR32 AP7微控制器系列的擴展。

Johnson指出:“對于算法上復(fù)雜的設(shè)計,設(shè)計工程師一直被局限于三個選項:DSP處理器、FPGA或定制ASIC?!盕PGA在該市場中已經(jīng)取得了重大進展,這是因為它們實現(xiàn)了比DSP處理器更快的DSP功能,并且不需要大批量及與ASIC相關(guān)的NRE費用。

然而,眾所周知的是FPGA存在高功耗且性能遠不及定制IC的問題。與所有愛特梅爾的32位微控制器類似,AT91CAP MCU包括一個愛特梅爾處理器內(nèi)核,各種外圍設(shè)備(每個外圍設(shè)備都有自己的DMA)和多條高速總線。

新型可定制處理器模塊的獨特之處在于金屬可編程模塊(MP模塊),該模塊具有與多達200萬個FPGA等效的門,能用于實現(xiàn)下列任何一項功能:1) DSP算法或通常在FPGA中實現(xiàn)的其它IP;2)一個或更多的補充的處理器內(nèi)核;3)目前在愛特梅爾的基于ARM7和ARM9的MCU系列的標準產(chǎn)品中還沒有的附加外圍設(shè)備。

“如果我們能開發(fā)一種允許開發(fā)商迅速地建立各種針對他們的特定需要而最優(yōu)化的標準產(chǎn)品,我們將有更多的機會,” Johnson指出。

采用定制開發(fā)的庫,金屬可編程單元構(gòu)造(Metal Programmable Cell Fabric, MPCF)結(jié)合了能配置到400種以上的不同功能單元之中的緊湊8三極管內(nèi)核單元,Johnson說,MPCF的有效單元布線和附加金屬層能提供比替代技術(shù)高得多的三極管和布局利用(率)。

Johnson表示,“在相同工藝技術(shù)下,由于已布線的門密度幾乎等于標準單元ASIC的門密度,MPCF技術(shù)使CAP MCU的成本與可比的MCU-PLUS-FPGA解決方案的成本要低30%到50%,與標準單元ASIC相比則更具成本競爭優(yōu)勢。”

Johnson指出,通過把系統(tǒng)獨有的IP和片上膠合邏輯與MCU進行集成,利用具有零等待狀態(tài)的、能以完全總線速度運行的邏輯,與FPGA實現(xiàn)相關(guān)的開/關(guān)芯片延遲被消除了。Johnson表示,“MP模塊具有400MHz或更大的時鐘速率,從而有可能把在MP模塊中實現(xiàn)的FPGA邏輯的性能提高8倍?!?P>要讓開發(fā)商在他們對金屬可編程邏輯模塊應(yīng)用的過程中把靈活性最大化,AT91CAP使能的MCU具有一個多層的總線矩陣,其中,具有專用于MP模塊的多個總線主控單元,以消除總線沖突,并使片上帶寬最大化。

例如,這一家族的新型器件之一—基于ARM7的AT91CAP7就有一個具有4個專門用于MP模塊的總線主控單元的6層總線,MP模塊的有19.2 Gbps的最大片上帶寬。其它器件如基于ARM9的AT91CAP9包含一個具有3個專門用于MP模塊的總線主控單元的12層總線,該模塊具有38.4Gbps的最大片上帶寬。

金屬可編程方法也非常適用于多核器件,特別是如果開發(fā)商有一個與標準ARM配置及部分定制的內(nèi)核變化都有關(guān)的設(shè)計時。Johnson表示,CAP9器件上的MP模塊被設(shè)計用來實現(xiàn)具有高速緩沖存儲器的第二個ARM926EJ-S內(nèi)核。

以ARM7TDMI處理器核心為基礎(chǔ),包含可定制邏輯的AT91CAP7S MCU相當(dāng)于約28K或50K FPGA LUT,或者是250K或450K可布線的ASIC門?;贏RM9的AT91CAP9S把一個200MHz ARM926EJ-S與每一個都具有16Kb容量的程序和數(shù)據(jù)高速緩沖存儲器集成,并且可定制邏輯相當(dāng)于約28K或56K FPGA LUT的(250K或500K可布線ASIC陣列)。

Johnson表示,任何現(xiàn)有的ARM7/9-PLUS-FPGA的設(shè)計都能被移植到AT91CAP器件中,包括掩膜費、工程收費和原型建立在內(nèi),NRE成本僅為15萬美元。




來源:零八我的愛0次

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