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. 向更高速和更高信號(hào)頻率的每次新進(jìn)步,都使總線對(duì)信號(hào)失真和異常更加敏感,這些異常可能破壞吞吐量并造成系統(tǒng)堵塞。“并行化的串行”標(biāo)準(zhǔn)對(duì)信號(hào)完整性問(wèn)題影響甚大。眾所周知,極高速電路很難檢測(cè)。 . 一種方法是用光背板來(lái)改善信號(hào)自身路徑;另一種改進(jìn)信號(hào)完整性的方法是用均衡方法來(lái)修飾信號(hào),盡量減少串?dāng)_。 . 很多設(shè)計(jì)人員對(duì)信號(hào)路徑采用更好的設(shè)計(jì)實(shí)踐經(jīng)驗(yàn),控制串?dāng)_和EMI。 . 大多數(shù)致力于信號(hào)完整性問(wèn)題的工程師都同意,對(duì)于高速系統(tǒng)設(shè)計(jì)而言,仿真正在成為必需。 電子設(shè)計(jì)趨勢(shì)推升了設(shè)計(jì)的復(fù)雜度與速度,如多個(gè)高速總線的使用,因此帶來(lái)了新的信號(hào)完整性挑戰(zhàn)。有鑒于此,EDN邀請(qǐng)了一些做信號(hào)完整性工作的工程師召開(kāi)了一次虛擬座談會(huì),探討當(dāng)前的危害情況,評(píng)估現(xiàn)有測(cè)試設(shè)備能在多大程度上符合要求,并確定如何從短期和長(zhǎng)期兩方面改善信號(hào)完整性問(wèn)題。當(dāng)然,很多東西都會(huì)影響到信號(hào)完整性(參考文獻(xiàn)1)。在本次討論中,我們主要關(guān)注串?dāng)_與EMI(見(jiàn)附文:關(guān)注DESIGNCON上的信號(hào)完整性)。 問(wèn)題何在? 很多有經(jīng)驗(yàn)的人都注意到了多個(gè)高速總線對(duì)信號(hào)完整性的影響,以及如何避免相關(guān)的問(wèn)題。Tektronix公司高級(jí)技術(shù)與營(yíng)銷經(jīng)理Chris Loberg與AssetInterTech公司設(shè)計(jì)驗(yàn)證與測(cè)試副總裁Tim Caffee都認(rèn)為,高速總線上工作裕度的縮減是這些挑戰(zhàn)的來(lái)源。 Loberg認(rèn)為:“設(shè)計(jì)趨勢(shì)是更快的串行速度,超過(guò)10Gbit/s,沒(méi)有新的高性價(jià)比架構(gòu)能夠改善信號(hào)路徑的適應(yīng)性問(wèn)題,如對(duì)EMI和串?dāng)_。因此,必須做像均衡這樣的信號(hào)調(diào)節(jié),以盡量減少EMI與串?dāng)_的影響,讓接收器能夠精準(zhǔn)地確定串行總線的邏輯變換?!?Loberg注意到,1或0變換之間的間隔時(shí)間正在不斷縮小,因此,在傳統(tǒng)上用于變換評(píng)估的眼圖中,EMI與串?dāng)_正在使眼“閉合”。工程師們不再能夠有效地評(píng)估信號(hào)完整性問(wèn)題,因?yàn)閷?duì)交越點(diǎn)與時(shí)序完整性的評(píng)估已變得更加困難。 Caffee指出,高速總線每發(fā)展一代,工作裕度都隨信號(hào)頻率的增加而縮減,產(chǎn)生了諸如抖動(dòng)、符號(hào)間干擾(ISI )以及串?dāng)_等影響,對(duì)高速SerDes與存儲(chǔ)器通道的信號(hào)完整性是一種浩劫。速度和信號(hào)頻率每提高一步,總線都會(huì)對(duì)失真與異常更為敏感,可能導(dǎo)致流量的中斷或系統(tǒng)堵塞。 圖1中的眼圖展示了這一點(diǎn),圖中顯示了不斷增加的信號(hào)頻率對(duì)三代假想高速總線的作用及結(jié)果,即縮小了總線上的工作裕度。隨著頻率的增加,即使最輕微的失真也可能損及信號(hào)的吞吐量。 Teledyne LeCroy公司信號(hào)完整性產(chǎn)品經(jīng)理Alan Blankman相信,更高的碼率(>25 Gbit/s)以及“并行化串聯(lián)”標(biāo)準(zhǔn)(如PCIExpress、40/100Gbase-R和InfiniBand)都是引起現(xiàn)在信號(hào)完整性問(wèn)題的原因。他說(shuō):“更高碼率要求較高頻率成分有更快的邊沿,這樣,在連接器、過(guò)孔、封裝等阻抗失配處就會(huì)產(chǎn)生更大的反射,會(huì)有更高的損耗以及更多的串?dāng)_與EMI產(chǎn)生,因?yàn)樵黾恿伺c鄰近走線的耦合?!?安捷倫技術(shù)公司信號(hào)完整性計(jì)劃經(jīng)理Shamree Howard補(bǔ)充說(shuō),較高的速度還給精確的數(shù)據(jù)捕捉帶來(lái)了麻煩,因?yàn)樗枰珳?zhǔn)的觸發(fā)。她認(rèn)為,抖動(dòng)的測(cè)量是確定高速數(shù)據(jù)鏈接特性的關(guān)鍵,并指出:“抖動(dòng)的測(cè)量是很復(fù)雜( 即使給用戶提供了某種一鍵界面),它要考慮時(shí)鐘恢復(fù)及鎖相環(huán)知識(shí)、抖動(dòng)分解技術(shù)及其假設(shè)、串?dāng)_及其影響,以及不同的波形統(tǒng)計(jì)分析方法等”(參考文獻(xiàn)2)。Howard補(bǔ)充說(shuō),安捷倫的U4154A4-Gbit/s AXIe邏輯分析儀可以對(duì)小至100ps×100mV的眼開(kāi)度做出可靠的測(cè)量(圖2)。 SignalConsulting公司的Howard Johnson也同意這點(diǎn),大家都知道極高速電路很難檢測(cè)。Johnson說(shuō):“即使有這么一種可以完成任務(wù)的探頭,我們通常也沒(méi)辦法把它放到待測(cè)電路中的某個(gè)點(diǎn)上?!彼ㄗh采用協(xié)同仿真方法,或同時(shí)開(kāi)發(fā)物理電路及其軟件仿真的方法。 Ransom ’s Notes 公司的Ransom Stephens注意到,盡管領(lǐng)先制造商擁有新的示波技術(shù),但現(xiàn)在仍然沒(méi)有能明確地識(shí)別串?dāng)_的自動(dòng)方法。最新測(cè)試產(chǎn)品提供了以誤碼率(BER)評(píng)估串?dāng)_作用的方法,但它們?nèi)际遣捎门懦ā?Stephens承認(rèn):“避免串?dāng)_的原理雖簡(jiǎn)單,但實(shí)際上有時(shí)是不可能的?!碑?dāng)一個(gè)干擾信號(hào)做邏輯變換時(shí),震蕩的輻射就造成了串?dāng)_,因此增加上升/下降時(shí)間能減少串?dāng)_。由于串?dāng)_就是一種干擾,因此增加走線間距也有很好效果。 Stephens建議:“不過(guò)我覺(jué)得,細(xì)心的差分設(shè)計(jì)是最佳措施。如果你真能讓差分偏移降下來(lái),讓兩根走線幾乎完全相互依靠,那么差分信令就有好的機(jī)會(huì)來(lái)抑制串?dāng)_?!?如何改善SI? Tektronix公司的Loberg認(rèn)為,我們有幾個(gè)方法。首先就是改變和增強(qiáng)信號(hào)本身的路徑。一個(gè)辦法是采用光學(xué)背板。這個(gè)辦法正在逐步實(shí)現(xiàn),但并非主流(想想Thunderbolt)。另一個(gè)改善信號(hào)完整性的方法是用均衡方法去修改信號(hào),來(lái)盡量減少串?dāng)_。例如,可以對(duì)芯片做硬編碼,或編譯FPGA的代碼,實(shí)現(xiàn)信號(hào)均衡。另外,很多設(shè)計(jì)者通過(guò)對(duì)信號(hào)路徑的更好設(shè)計(jì),來(lái)控制串?dāng)_和EMI 。 Asset InterTech公司的Caffee建議工程師在系統(tǒng)生命周期的每個(gè)主要階段(從設(shè)計(jì)到現(xiàn)場(chǎng)運(yùn)行),都要對(duì)總線的信號(hào)完整性做驗(yàn)證,不過(guò)他也承認(rèn)這是一個(gè)具有挑戰(zhàn)性的工作,因此不是一個(gè)普遍的方案。如果在原型板制造期間發(fā)現(xiàn)問(wèn)題,則可能造成設(shè)計(jì)的變化;如果是在生產(chǎn)期間發(fā)現(xiàn)問(wèn)題,則可能改變生產(chǎn)工藝。如果是在現(xiàn)場(chǎng)發(fā)現(xiàn)問(wèn)題,則要對(duì)性能不良的系統(tǒng)、設(shè)計(jì)做查錯(cuò),下一代產(chǎn)品應(yīng)做設(shè)計(jì)變更,生產(chǎn)工藝變更,以減少退貨和保修問(wèn)題。 Anritsu公司業(yè)務(wù)發(fā)展經(jīng)理HiroshiGoto建議將預(yù)加重作為一種有效的傳輸技術(shù),以保持眼圖的開(kāi)度。當(dāng)傳輸速度增加到20Gbit/s甚至更高時(shí),Goto建議采用一種3階或4階加重信號(hào),以增加被加重的位數(shù)。 但是,要對(duì)每一階檢查與設(shè)定加重率的組合,這也是一個(gè)復(fù)雜的工作,在沒(méi)有定量指導(dǎo)情況下,難以找到理想的加重信號(hào)。 Goto稱,Anritsu開(kāi)發(fā)了MP1825B四階加重與傳輸分析軟件,與MP1800A信號(hào)質(zhì)量分析儀B E R 測(cè)試套件(BERTS)一起使用,能根據(jù)待測(cè)設(shè)備(DUT)的“反相特性而找到理想的加重設(shè)置”(圖3) 。“這提升了眼的高度,維持了眼的開(kāi)度,從而能在最短的時(shí)間內(nèi)做出更好的定量信號(hào)完整性分析?!狈抡媾c驗(yàn)證 大多數(shù)人都同意仿真正在成為高速系統(tǒng)設(shè)計(jì)的必需。安捷倫公司的Howard稱該公司的先進(jìn)設(shè)計(jì)系統(tǒng)(ADS)是用于高速數(shù)字應(yīng)用的領(lǐng)先EDA軟件。 Teledyne LeCroy 公司的Blankman補(bǔ)充說(shuō),要檢測(cè)和減少串?dāng)_問(wèn)題,設(shè)計(jì)人員必須能通過(guò)仿真方法,預(yù)測(cè)到近端和遠(yuǎn)端串?dāng)_,并用測(cè)量來(lái)驗(yàn)證仿真中采用的模型(圖4)。在驗(yàn)證串?dāng)_模型時(shí),設(shè)計(jì)人員要測(cè)量多個(gè)差分通道的S參數(shù)(對(duì)干擾源-受擾者模型是8個(gè)端口,對(duì)干擾源-受擾者-干擾源模型是12個(gè)端口,或者甚至有更多的端口數(shù))。 串?dāng)_的測(cè)量需要用實(shí)時(shí)示波器做垂直噪聲測(cè)量,這種設(shè)備可以從串行數(shù)據(jù)信號(hào)中提取出串?dāng)_。這些測(cè)量應(yīng)評(píng)估作為BER函數(shù)的眼圖閉合度,如抖動(dòng)測(cè)量那樣。當(dāng)然抖動(dòng)測(cè)量也很重要。如同時(shí)測(cè)量抖動(dòng)和噪聲,則獲得的串?dāng)_圖像要比單獨(dú)測(cè)量抖動(dòng)更加復(fù)雜。 工具箱 測(cè)試設(shè)備供應(yīng)商正在努力發(fā)展自己的工具,以確定抖動(dòng)的特性,改善信號(hào)完整性分析,因此對(duì)信號(hào)完整性工程師而言,最好的工具箱可能尚未出現(xiàn)。Signal Consulting的Joh nson預(yù)計(jì),“下一個(gè)趨勢(shì)會(huì)是發(fā)展一種專用設(shè)備與測(cè)試軟件的混合體,目的是確定一個(gè)電源系統(tǒng)的特性,并為電源系統(tǒng)注入特定的測(cè)試電流波形?!盧ansom’sNotes的Stephens建議我們密切關(guān)注更多的串?dāng)_均衡技術(shù)。 那么,我們現(xiàn)在有什么? 示波器。這里是大帶寬示波器真正展示自己價(jià)值的地方。Teledyne LeCroy的Blankman說(shuō),非歸零(NRZ)串行數(shù)據(jù)樣式的上升時(shí)間不到30ps。他指出,測(cè)試PCIe Gen3系統(tǒng)的接收器需要一臺(tái)13GHz帶寬的示波器,而發(fā)射器測(cè)試則需要20GHz的示波器。 Blankman 稱:“新興的多路設(shè)計(jì)甚至需要更多的通道數(shù)和帶寬,如InfiniBank和40/100GBase-R。這些標(biāo)準(zhǔn)的碼率達(dá)25Gbit/s和28Gbit/s。一般要求示波器頻率為基頻的四或五倍,即50 GHz~ 65 GHz 。由于InfiniBan k與40/100GBase-R是多路的,因此一次要有8、12甚至更多的通道,才能完全確定SI問(wèn)題的特性?!盉lankman稱TeledyneLeCroy的LabMaster 10 Zi帶寬可達(dá)65GHz,并有一個(gè)ChannelSync架構(gòu),可使最多80個(gè)通道同時(shí)在一臺(tái)儀器上工作。 網(wǎng)絡(luò)分析儀。對(duì)于確定多路系統(tǒng)的串?dāng)_特性,以及揭示DUT的頻率特性,網(wǎng)絡(luò)分析儀很重要。Anritsu公司的Goto指出,為了獲得最佳S參數(shù)數(shù)據(jù),矢量網(wǎng)絡(luò)分析儀應(yīng)擴(kuò)展其頻率的覆蓋范圍。他推薦Anritsu的VectorStarVNA,其頻率區(qū)間為70kHz~125GHz。 他警告說(shuō):“雖然頻率上限最受人關(guān)注,但一定要記住,在信號(hào)完整性應(yīng)用中,對(duì)最低可能頻率的精準(zhǔn)測(cè)量才是關(guān)鍵。通常情況下,測(cè)量盡可能靠近直流可以改善模型精度,因?yàn)樗峁┝擞兄诮⒁粋€(gè)高精度眼圖的精密數(shù)據(jù)?!?Blankman指出,大端口數(shù)的網(wǎng)絡(luò)分析儀可能很昂貴。他說(shuō)TeledyneLeCroy的SPARQ系列網(wǎng)絡(luò)分析儀(圖4)用于信號(hào)完整性測(cè)量,提供了一種傳統(tǒng)VNA的較低成本選擇。(SPARQ意為“快速S參數(shù)”。


軟件。由于需要更多仿真,供應(yīng)商們正在開(kāi)發(fā)與自己硬件相配合的軟件工具。Loberg指出了在Tektronix儀器上的串行數(shù)據(jù)鏈路分析(SDLA)(圖5),它可以幫助工程師們?cè)贓DA環(huán)境(如Cadence Design Systems或Mentor Graphics)下做均衡仿真。Loberg解釋說(shuō):“軟件模型可以裝入到一臺(tái)示波器中,將模型屬性轉(zhuǎn)換為S參數(shù);然后,我們可以將其作用放到示波器中的一個(gè)濾波器里。示波器就可以對(duì)均衡器的行為建立模型,成為被測(cè)量的信號(hào),看我們是否可以打開(kāi)眼圖。這種方案能夠?qū)⒕獾男Ч喜⒌绞静ㄆ髦衼?lái)分析性能?!?TeledyneLeCroy 還在其SDAIII - Complete LinQ產(chǎn)品中提供了基于示波器的串行數(shù)據(jù)分析軟件。Blankman指出,關(guān)鍵是用基于示波器的軟件做眼圖、抖動(dòng)與垂直噪聲分析。他說(shuō),用戶也需要用于分解或模擬各個(gè)設(shè)備與互連,以及適用于發(fā)射器和接收器均衡的工具包。Blankman補(bǔ)充說(shuō):“分析工具包還應(yīng)提供廣泛的圖表類型,能夠在頻率和時(shí)間上顯示出抖動(dòng)與噪聲的變化與分布,從而了解噪聲與抖動(dòng)的根源?!盉ERT。Howard說(shuō):“很多標(biāo)準(zhǔn)都規(guī)定要做接收器測(cè)試,而大多數(shù)人并不知道從何著手?!彼a(bǔ)充說(shuō),系統(tǒng)校準(zhǔn)可能是測(cè)試中最難的部分,這種校準(zhǔn)可確保測(cè)量的準(zhǔn)確性。 Howard透露,與工程師一起工作時(shí),她發(fā)現(xiàn)對(duì)PCIe 3.0重要信號(hào)的正確校準(zhǔn)極具挑戰(zhàn)性。她說(shuō),安捷倫的N4903B J-BERT高性能串行BERT適合于Rx符合性測(cè)試。該儀器可以確定一個(gè)接收器的抖動(dòng)容限特性,目標(biāo)是驗(yàn)證今天最常見(jiàn)串行總線標(biāo)準(zhǔn)的合規(guī)性,包括PCIe、SATA/SAS、DisplayPort以及USB。


Goto的建議是,當(dāng)選擇BERT時(shí),工程師應(yīng)選擇那些具有最低固有抖動(dòng)的型號(hào)。例如,Anritsu的MP1800A固有時(shí)鐘抖動(dòng)<350fs RMS。BERT還應(yīng)能夠針對(duì)各種生成的抖動(dòng)類型,做出可重復(fù)和穩(wěn)定的抖動(dòng)容限測(cè)試,如正弦、隨機(jī),以及有界不相關(guān)抖動(dòng),以及可以測(cè)量高達(dá)32.1Gbit/s的擴(kuò)頻時(shí)鐘。 嵌入式測(cè)試。檢探查測(cè)試焊片的年代幾近尾聲,尤其是對(duì)高速總線,因?yàn)檫@樣會(huì)損及信號(hào)。那么我們還有什么辦法?現(xiàn)在人們對(duì)嵌入式測(cè)試儀器的興趣越來(lái)越濃,可測(cè)試性設(shè)計(jì)運(yùn)動(dòng)能夠通過(guò)非侵入性的嵌入式儀器,提供接收方能看到的信號(hào)數(shù)據(jù)。Caffee說(shuō):“換句話說(shuō),是用軟接入來(lái)提供信號(hào)完整性工程師所需要的硬數(shù)據(jù)?!?嵌入式儀器已在芯片級(jí)特性分析、驗(yàn)證與測(cè)試中使用了數(shù)年時(shí)間。不過(guò),現(xiàn)在嵌入式儀器正被用于監(jiān)控和報(bào)告接收器獲得的數(shù)據(jù)。Caffee指出,嵌入式儀器的訪問(wèn)均采用標(biāo)準(zhǔn)技術(shù),如IEEE1149.1邊界掃描(JTAG)測(cè)試訪問(wèn)端口。 Caffee說(shuō):“JTAG提供了對(duì)外部軟件平臺(tái)的訪問(wèn),這種平臺(tái)可以管理系統(tǒng)中的嵌入式儀器,對(duì)獲得的測(cè)試測(cè)量數(shù)據(jù)做編譯和分析(圖6)?!?隨著系統(tǒng)速度與復(fù)雜性的持續(xù)升高,未來(lái)的方向是尋求先進(jìn)測(cè)量工具與定制仿真模型的技術(shù)的結(jié)合。不過(guò)歸根結(jié)底,改善信號(hào)完整性的最小阻力路徑還是一種業(yè)界的期待,即期望出現(xiàn)巧妙的舊式工程創(chuàng)新。 附文:關(guān)注DESIGNCON上的信號(hào)完整性 DesignCon 2013于1月28日-31日在Santa Clara(加州)Convention Center舉辦,會(huì)議日程包含了信號(hào)完整性論文和演示。如以下內(nèi)容: . 教程,“數(shù)g至40gbps以上高速I/O的設(shè)計(jì)與驗(yàn)證,以及抖動(dòng)、信號(hào)完整性與功率的優(yōu)化”,http://bit.ly/Xe2PcG; . 討論,“ 眼圖閉合的例子:日益嚴(yán)重的100G 困境”,http://bit.ly/12m6F7W; . 會(huì)議,“在時(shí)域、頻域和統(tǒng)計(jì)域中,對(duì)電源導(dǎo)致的有邊界、無(wú)關(guān)的抖動(dòng)做大流量、高靈敏度測(cè)量”,http://bit.ly/TPPUwn; . 會(huì)議,“了解隨PRBS測(cè)試模式長(zhǎng)度的增加而明顯增多的隨機(jī)抖動(dòng)”

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