G.729A語音編碼TMS320VC5416 DSP實時實現(xiàn)

時間：2007-03-27 14:56:00

關鍵字： DSP 語音編碼 TMS320VC5416 寄存器

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[導讀]本文將介紹使用TI公司C5000系列實現(xiàn)ITU-T G.729A 8kb/s CS-ACELP語音壓縮編碼算法，并對TI公司的TMS320C54x系列DSPITU-T G.729A語音編碼算法做簡單介紹，以及軟件編程、調(diào)試和實現(xiàn)結果。

概述

近二十年來，全球半導體產(chǎn)業(yè)的飛速發(fā)展帶動相關的軟件、硬件設計達到新的水平，使得很多比較復雜的數(shù)字信號處理算法可以實時實現(xiàn)并且得到廣泛應用。突出的代表就是數(shù)字信號處理器（DSP）與語音信號壓縮編碼算法相結合，并且在日常通信系統(tǒng)中得到廣泛應用，例如數(shù)字移動電話、IP電話等。隨著網(wǎng)絡通信的發(fā)展、微處理器和信號處理專用芯片的發(fā)展，也為語音處理技術的應用提供了更加廣闊的平臺。所有這些因素都促進了對更加有效、可靠、高質量的語音編碼系統(tǒng)的需要，從而促進了語音編碼技術的持續(xù)發(fā)展。在最近一些年內(nèi)，語音壓縮編碼技術有了很大的發(fā)展。最早的標準化語音編碼標準是70年代CCITT公布的G.711 64kb/s脈沖編碼調(diào)制PCM。此后ITU又先后公布了G.721 32kb/s自適應差分編碼（ADPCM）、G.728 16kb/s短延時碼本激勵線性預測編碼（LD-CELP）。此外還有一些政府和組織制定的語音標準，例如用于西歐數(shù)字移動通信的13kb/s具有長時預測規(guī)則碼激勵（RPE-LPT）的線性預測方案，北美數(shù)字移動通信標準8kb/s矢量和激勵線性預測（VSELP）方案等。1999年歐洲通信標準協(xié)會（ETSI）推出了基于碼激勵線性預測編碼（CELP）的第三代移動通信語音編碼標準自適應多速率語音編碼器（AMR），其中最低速率為4.75kb/s，達到通信質量。1995年ITU公布G.723.1，編碼算法有兩種，5.3kb/s的ACELP和6.3kb/s的MP－MLQ算法，主要用于IP電話。1996年ITU公布了G.728 8kb/s的CS－ACELP算法，可以用于IP電話、衛(wèi)星通信、語音存儲等多個領域。目前，ITU正在致力于制定4kb/s的語音編碼國際標準，該算法將達到長途質量。針對一些特殊應用，如保密通信、軍用通信、應急通信等，許多國際組織、國家也研制了各種不同速率的語音壓縮編碼速率，例如美國政府為保密通信用開發(fā)的2.4和1.2kb/s MELP算法。我國近幾年也研制了0.6、1.2、2.4kb/s及其它速率語音壓縮編碼算法，達到并且超過了國外同速率編碼的質量。

DSP在近20年內(nèi)一直在高速發(fā)展，運算能力不斷提高，片上資源和接口更加豐富，而單位運算所需功耗不斷降低。下面給出幾個主要廠家的DSP產(chǎn)品。

TI的DSP主要有四大系列：

C5000系列（定點，低功耗）：適合

個人與便攜上網(wǎng)及無線通信應用。80－400MIPS。

C2000系列（定點，控制器）：針對
控制進行優(yōu)化的DSP。

C6000系列（高性能）：適合寬帶
網(wǎng)絡和數(shù)字影像應用。

OMAP系列（雙核芯片）：適合低
功耗移動設備和多媒體PDA。

ADI的DSP主要有四大系列：

21xx系列：16定點DSP，內(nèi)部REM
大，外圍接口多，適合作為控制類芯片使用。

SHARC系列：32位浮點DSP，21160 21161提供與大內(nèi)存容量結合的簡單浮點算法，具有高水平的浮點性能。

TigerSHARC系列：比SHARC具
有更高的浮點運算功能TS101，TS201

Blackfin系列：高性能16位DSP
信號處理與通用微控制器易使用的性能結合。

Motolora的DSP：

DSP56800,16BIT定點DSP，通用型DSP。

DSP563XX,24bit定點DSP, 通用型DSP。

本文將介紹使用TI公司C5000系列實現(xiàn)ITU-T G.729A 8kb/s CS-ACELP語音壓縮編碼算法，并對TI公司的TMS320C54x系列DSPITU-T G.729A語音編碼算法做簡單介紹，以及軟件編程、調(diào)試和實現(xiàn)結果。

圖1 C54xDSP結構框圖（略）

TMS320 C54x系列DSP芯片簡介及硬件設計

TMS320 C54x系列DSP芯片是使用靜態(tài)CMOS技術制造的。其方框圖見圖1，從圖中可以看出C54x系列DSP芯片具有以下功能單元：

總線

C54x共有八條總線分別是：

PB：程序讀取總線
CB：數(shù)據(jù)讀取總線1
DB：數(shù)據(jù)讀取總線2
EB：數(shù)據(jù)寫入總線
PAB：程序讀取地址總線
CAB：數(shù)據(jù)讀取地址總線1
DAB：數(shù)據(jù)讀取地址總線2
EAB：數(shù)據(jù)寫入地址總線

中央處理器（CPU）

CPU由以下幾個部件組成：

    先進的多總線結構：包括三個獨立的數(shù)據(jù)總線和一個程序總線

    40位的算術邏輯單元：包括一個40位移位器和兩個獨立的40位累加器

    17bit 17bit的并行乘法器同一個專用的加法器相配合：用來執(zhí)行不經(jīng)流水線的單周期乘加（MAC）運算

    指數(shù)譯碼器：可以在一個周期里計算出一個40位累加器的指數(shù)值

    兩個地址生成器：包括8個輔助寄存器和兩個輔助寄存器算術單元

    程序控制器：對指令進行解碼、管理流水線和程序流程

片上存儲器

C54x共有192K字的尋址能力（64K字的程序區(qū)，64K字的數(shù)據(jù)區(qū)，和64K字的I/O區(qū)）。

表1給出了部分C54x芯片的片上資源、運算能力、工作電壓等。運算能力用MIPS來度量，即每秒能執(zhí)行一百萬條指令的數(shù)量。

片上其它資源

C54x系列中不同產(chǎn)品具有不同的片上外設配置。這些外設有：

軟件可編程的等待狀態(tài)發(fā)生器

可編程的庫轉換

片上鎖相環(huán)時鐘發(fā)生器（包括一個內(nèi)部振蕩器或一個外部時鐘源）

一個16比特定時器

通用輸入輸出管腳

同步串行口

異步串行口

C54x系列DSP芯片具有以下主要特點：

采用改進哈佛結構，對程序內(nèi)存和數(shù)據(jù)內(nèi)存使用分離的總線。這樣可以同時取指令和操作數(shù)，提高了運行效率和通用性

先進的CPU設計和為應用設計的硬件邏輯提高了芯片的性能

為快速的后續(xù)發(fā)展設計的模塊化結構

先進的IC處理技術提供了高性
能和低功耗

采用5V或3V靜態(tài)CMOS技術
可以進一步降低功耗

Power-down模式可以進一步降
低功耗

能源消耗控制：使用IDLE1，IDLE2，和IDLE3指令進入Power-down模式
使用CLKOUT-off控制來禁止CLKOUT信號

高度專門的指令結構提供了快速運算和優(yōu)化的高階語言操作

單指令循環(huán)和塊指令循環(huán)功能

塊內(nèi)存移動指令提供了更好的程序和數(shù)據(jù)管理

32位操作數(shù)指令

擁有兩個或三個操作數(shù)讀取能力的指令

可以并行存儲和并行讀取的算術指令

條件存儲指令

從中斷快速返回的指令擁有多種片上外設和內(nèi)存配置方案

40位算術運算器（ALU）

17bit 17bit單周期并行乘法器

六級流水線操作提高程序執(zhí)行效率

支持比特倒置尋址方式和循環(huán)尋址方式。

對于語音壓縮編碼，通常所需要的DSP運算能力不會超過50個MIPS，程序和數(shù)據(jù)所占用的容量大約幾十K字，AD/DA的精度保持就可以滿足使用要求，語音輸入輸出、信碼輸入輸出各需要一個雙向串口。但考慮在通信領域中應用，往往一片DSP不僅要實現(xiàn)語音壓縮編解碼，還需要實現(xiàn)自適應回聲抵消、加解密、信道編解碼，甚至基帶調(diào)制解調(diào)算法等。因此我們選用了TMS320VL5416設計硬件平臺。AD/DA芯片采用TI公司的TLV320AIC10，它是德州儀器公司（TI）推出的一款通用型低功耗16位A/D、D/A音頻接口芯片，適用于語音以及寬帶音頻處理。采用3.3V或5V供電，片內(nèi)集成了FIR濾波器，可以達到最高88KHz的采樣頻率，集成了輸入放大器和輸出放大器，支持多路芯片串連，提供低功耗、ADC與DAC單獨三種工作模式。TLV320AIC10的數(shù)字接口采用同步串口方式，可以非常方便的與DSP同步串口（McBSP）相連。FLASH采用SST39VF800A芯片，該芯片有512K 16容量，可以將多種應用程序固化在該芯片中。開機后DSP的加載程序自動將FLASH中的程序拷貝到DSP片上RAM中，以便能夠全速運行程序，充分發(fā)揮DSP的處理能力。

ITU-T G.729 8kb/s CS—ACELP簡介

    國際電信聯(lián)盟（ITU-T）于1995年11月正式通過了G.729。 ITU-T建議G.729也被稱作“共軛結構代數(shù)碼本激勵線性預測編碼方案”(CS-ACELP)，它是當前較新的一種語音壓縮標準。96年ITU-T又制定了G.729的簡化方案G.729A，主要降低了計算的復雜度以便于實時實現(xiàn)，因此目前使用的都是G.729A。

    G.729是由美國、法國、日本和加拿大的幾家著名國際電信實體聯(lián)合開發(fā)的。它需要符合一些嚴格的要求，比如在良好的信道條件下要達到長話質量，在有隨機比特誤碼、發(fā)生幀丟失和多次轉接等情況下要有很好的穩(wěn)健性等。這種語音壓縮算法可以應用在很廣泛的領域中，包括ＩＰ電話、無線通信、數(shù)字衛(wèi)星系統(tǒng)和數(shù)字專用線路。

    G.729算法采用“共軛結構代數(shù)碼本激勵線性預測編碼方案”（CS-ACELP）算法。這種算法綜合了波形編碼和參數(shù)編碼的優(yōu)點，以自適應預測編碼技術為基礎，采用了矢量量化、合成分析和感覺加權等技術。

圖1 G.729A編碼器原理圖

編碼器（圖1）對10ms長的語音幀進行處理，每幀分為兩個子幀。輸入語音首先要在預處理模塊中經(jīng)過高通濾波和幅度壓縮變換，以去除低頻干擾及防止在后面運算中出現(xiàn)溢出。每幀進行一次線性預測（LP）分析，并將LPC參數(shù)轉換到線譜，對（LSP）形式進行預測式二階段矢量量化（VQ）。然后使用分析合成法，按照合成信號和原始信號間感覺加權失真最小的準則來提取激勵參數(shù)。激勵參數(shù)（包括固定碼本和自適應碼本參數(shù)）要每子幀（5ms）計算一次。每幀要利用感覺加權語音進行一次開環(huán)整數(shù)基值基音延時估計，然后進行閉環(huán)的分數(shù)值基音分析，確定自適應碼本的延時和增益，下面再進行固定碼本的搜索。固定碼本是使用交織單脈沖排列設計的代數(shù)碼本。在搜索時使用迭代式深度優(yōu)先樹型搜索算法。這種算法的運算量比較小，并且具有固定的運算復雜度，比較有利于使用硬件實現(xiàn)。自適應碼本和固定碼本的增益使用預測式二階段共軛結構碼本進行矢量量化。

圖2 G.729A解碼器原理圖

圖2給出了解碼算法的框圖。首先要從接收到的碼流中提取LSP系數(shù)和兩個分數(shù)基音延時、兩個固定碼本矢量以及兩套自適應碼本和固定碼本增益等參數(shù)。然后，對LSP參數(shù)進行插值，并轉換到線性預測濾波器系數(shù)的形式。接下來，將自適應碼本和固定碼本矢量分別乘以各自的增益再相加，得到激勵信號。激勵信號通過LPC綜合濾波器后，就得到了合成語音信號。最后還要對合成語音信號進行后處理，以提高合成語音的質量。

程序的編制及調(diào)試

程序編制

DSP開發(fā)工具一般都提供C編譯器，可以直接將寫好的C語言程序轉換成DSP匯編語言程序，但效率非常低。G.729A算法C語言程序用編譯器轉成匯編語言程序運行所需要的運算量超過2000個MIPS（每秒百萬條指令），根本無法實時運行，因此必須手工編寫匯編程序。

由于編解碼的程序規(guī)模很大，又是在DSP的匯編語言級別上實現(xiàn)，因此保持原定點C語言程序所具有的模塊化、結構化的特點對于匯編程序的編寫、檢查、調(diào)試和閱讀都是非常有利的。所以在編程時盡量保持DSP程序與C語言程序在流程上的一致，具體是使DSP程序與C程序之間保持函數(shù)一一對應關系，保持循環(huán)、分支等結構的一一對應。只有為了避免使DSP程序產(chǎn)生過大的不必要開銷時，才對結構進行一定的修改，但仍然要保持程序的模塊化和結構化。由于C程序的結構清晰，所以要想作到這一點并不困難，只要為C程序中的if、else、for、while等結構設計出相應的結構化的DSP匯編程序結構，在編程時按照這種固定對應關系對C語言程序進行轉換就可以了。

程序的調(diào)試

程序的調(diào)試也是一項很費時的工作。ITU-T針對G.729A提供了8組測試碼，只要通過了這8組測試碼，就可以認為程序基本正確了，這8組測試碼分別針對程序中的不同位置而設定如下：

algthm - 算法中的條件部分
erasure - 幀刪除恢復
fixed -固定碼本搜索
lsp -LSP系數(shù)量化
overflow -合成器中的溢出檢查
parity -奇偶校驗
pitch -基音周期搜索
speech -一般語音文件
tame -訓練過程

采用的調(diào)試步驟是首先針對測試碼中最短的algthm.in的第一幀邊編程邊調(diào)試，也就是每編好一個函數(shù)，就將algthm.in的第一幀通過該函數(shù)后的輸出數(shù)據(jù)和C語言的相應輸出數(shù)據(jù)相比較，并針對出現(xiàn)的錯誤修改函數(shù)內(nèi)容，由于對剛編完的函數(shù)進行調(diào)試，對函數(shù)結構和指令記憶會比較清晰。這樣，當編碼器完成后，algthm.in的第一幀也就基本通過了。然后再繼續(xù)調(diào)試第二幀，當?shù)诙餐ㄟ^后，程序中所剩的錯誤也就不多了。等到通過了第10幀，就可以開始大規(guī)模地進行仿真了。對于解碼部分，由于程序比較短，就采用了先把全部程序編完，再進行調(diào)試的方法。

程序的優(yōu)化

編碼模塊與解碼模塊是按照G.729編解碼器的C語言定點源程序改寫的，雖然定點的C語言程序已經(jīng)為DSP的實現(xiàn)作了一定的優(yōu)化，但為在一個DSP芯片上實現(xiàn)盡量多路的編解碼，必須根據(jù)C54x芯片的功能和特點對程序進行一定的優(yōu)化。在編寫DSP程序時，要想提高運行效率，就要充分利用C54x DSP芯片具有的各種硬件資源，并適當?shù)貙Τ绦蚪Y構進行一定調(diào)整，采用的主要方法有以下幾種：

充分利用各種延時

C54x芯片指令中的跳轉、循環(huán)、調(diào)用子函數(shù)等指令都有延時的格式如B[D]，BC[D]，RPT[D]，RPTB[D]，CALL[D]，CC[D]，RET[D]，RC[D]等，這些指令允許利用他們執(zhí)行過程中的等待周期預先執(zhí)行一兩條其他指令，適當調(diào)整程序結構就可以充分利用這些等待周期，從而提高程序執(zhí)行速度。

充分利用塊指令循環(huán)功能

C54x DSP芯片還提供了塊指令循環(huán)功能，此功能可以大大地提高執(zhí)行循環(huán)的速度，但是此功能只能在一重循環(huán)中使用，因為它只提供了一個循環(huán)記數(shù)寄存器BRC，所以在遇到多重循環(huán)時就要盡量把這個功能用在最里層的循環(huán)中，最里層循環(huán)是執(zhí)行次數(shù)最多的循環(huán)。

利用DSP芯片提供的各種寄存器

適當?shù)乩酶鞣N寄存器也能顯著地提高程序的執(zhí)行速度。特別是當一個函數(shù)在程序中被頻繁地調(diào)用，它的賦值可以減少執(zhí)行時鐘周期。

利用指令中的移位功能

C54x DSP在做賦值和數(shù)值運算之前可以自動對操作數(shù)進行一定位數(shù)的移位，這樣就可以將移位運算和其它運算結合到一條指令中。另外，利用這種移位功能可以代替一些乘數(shù)為2的冪乘法，雖然有這樣的限制，但是在許多濾波器和函數(shù)中確實有這樣的運算，帶立即數(shù)的乘法需要兩個指令周期，而移位只需一個指令周期，并且如果條件允許還可以將其結合到其它指令中，從而大大節(jié)省運算量。

利用DELAY指令進行賦值操作

另外，在程序中有大量的賦值操作，即將一個內(nèi)存變量的值賦給另一個內(nèi)存變量。特別是在搜索碼本的時候有大量的賦值操作，并且賦值的兩個變量是固定的。一般的方法是將第一個變量讀入到累加器或寄存器TREG中，再將累加器的值賦到第二個變量中。此過程要用兩條單周期指令。C54x提供了一個移動緩沖區(qū)的指令DELAY，可以在一個指令周期內(nèi)將內(nèi)存單元的值復制到它后面的相鄰的內(nèi)存單元內(nèi)。雖然DELAY指令一般是用來移動緩沖區(qū)的，但只要在給變量分配內(nèi)存時將需要賦值的變量相鄰分配，就可以在一個指令周期內(nèi)完成賦值操作。

利用寄存器代替某些臨時變量

程序中往往有很多的臨時變量，有的臨時變量應用到自始至終，但是有的臨時變量只是在程序中的某段區(qū)域使用，只是暫時做數(shù)據(jù)存儲之用，對這類變量就可以酌情使用寄存器代替。由于對寄存器可以直接進行操作，而不需要進行取數(shù)、存數(shù)操作，從而可以大大提高程序運行速度。

盡量利用尋址寄存器

C54x提供了八個尋址寄存器AR0-AR7，使用它們可以進行尋址操作，并且可以控制它們的值隨著指令執(zhí)行而增減。充分利用它們進行尋址可以顯著提高運行速度。

實現(xiàn)結果

運算量統(tǒng)計

在對某一幀實際語音的處理過程中，編解碼器算法的，各個部分運算量所占比例顯示在表1中。運算量較大的部分是LSP系數(shù)的矢量量化與激勵碼本（自適應碼本和隨機碼本）的搜索。這兩個部分的運算量大約占全部編解碼運算量的80％以上。

由于G.729A算法中的LSP系數(shù)的量化、自適應碼本和隨機碼本的搜索等運算量較大的部分的計算復雜度都是固定的，對于不同的輸入所用的指令周期數(shù)目只有很小的改變，所以整個編解碼器的運算量也是基本固定的，在幀與幀之間只有很小的波動，基本在15MIPS附近波動，其中編碼部分約占13MIPS，解碼部分約占2MIPS。