ADC，中文名為模數(shù)轉(zhuǎn)換器。ADC在設(shè)計時，ADC結(jié)構(gòu)主要分類兩種，并行結(jié)構(gòu)和分段結(jié)構(gòu)。但是，ADC結(jié)構(gòu)并不是本文討論內(nèi)容。為增進大家對ADC的認(rèn)識，本文將對ADC的數(shù)字輸出予以介紹。如果你對ADC具有興趣，不妨繼續(xù)往下閱讀哦。
使用數(shù)字接口時，無論何種數(shù)字輸出，都有一些相同的規(guī)則和事項需要考慮。首先，為實現(xiàn)最佳端接，接收器(FPGA或ASIC)端最好使用真正的電阻終端。接收器端的反射可能會破壞系統(tǒng)的時序預(yù)算。使用CMOS和LVDS輸出時，如果系統(tǒng)中有多個ADC，不要使用來自某個ADC的DCO(數(shù)據(jù)時鐘輸出)，否則可能導(dǎo)致時序錯誤以及接收器不適當(dāng)?shù)夭蹲綌?shù)據(jù)。在兩個ADC之間需要保持精確時序的I/Q系統(tǒng)中，這點尤其要注意。即使兩個ADC位于同一封裝中，也需要針對各ADC使用適當(dāng)?shù)腄CO輸出，從而保持精確的時序關(guān)系。另一個需要注意的重要參數(shù)是數(shù)據(jù)格式。必須確保ADC和接收器采用同一數(shù)據(jù)格式(二進制補碼或偏移二進制)。此外，數(shù)據(jù)轉(zhuǎn)換速度也很重要。隨著數(shù)據(jù)速率提高，接收器能夠正確捕捉數(shù)據(jù)的距離減小，原因是互連和電纜帶寬限制，以及由此引起的符碼間干擾等問題。這些只是為什么必須將互連視作傳輸線路的其中幾個原因。以這種方式處理互連并了解傳輸線路的特性很重要。當(dāng)數(shù)據(jù)速率提高時，以這種方式了解互連變得更加重要。必須確保導(dǎo)線尺寸正確，并且信號層與返回層之間的間距適當(dāng)。此外還必須選擇具有穩(wěn)定介電特性的電路板材料，使得走線特性在整個互連長度上的波動盡可能小。理想情況下，傳輸線路可以傳播到無窮遠處，但在實際應(yīng)用中，這顯然是不可能的。集膚效應(yīng)、電介質(zhì)損耗和輻射損耗等因素全都會影響傳輸線路參數(shù)，降低信號質(zhì)量。因此，必須以正確的物理參數(shù)適當(dāng)設(shè)計傳輸線路，并且確保發(fā)送器與接收器的阻抗匹配。這樣做能夠節(jié)省電能，并將最高質(zhì)量的信號傳輸給接收器。
使用CMOS輸出時，有多個方面需要考慮。首先考慮邏輯電平的典型開關(guān)速度(約1V/ns)、輸出負(fù)載(每個門約10pF)和充電電流(每路輸出約10mA)。應(yīng)當(dāng)采用盡可能小的容性負(fù)載，使充電電流最小。這可以利用盡可能短的走線僅驅(qū)動一個門來實現(xiàn)，最好沒有任何過孔。此外還可以利用阻尼電阻來盡量降低充電電流。之所以必須將這些電流降至最小，是因為它們會迅速疊加。例如，一個四通道14位ADC的瞬態(tài)電流可能高達14 x 4 x 10 mA = 560 mA!串聯(lián)阻尼電阻有助于抑制如此大的瞬態(tài)電流，降低輸出瞬態(tài)效應(yīng)產(chǎn)生的噪聲，從而防止輸出在ADC中造成額外的噪聲和失真。
與CMOS相比，LVDS有幾項優(yōu)勢很吸引人，包括：轉(zhuǎn)換器采樣速率更高而功耗更低、支持更高的數(shù)據(jù)速率、抗擾度更高以及驅(qū)動距離更長等。使用CMOS等單端信號時，印刷電路板上的噪聲明顯較多，這是因為CMOS輸出切換感應(yīng)的大量瞬態(tài)電流引起接地反彈。這種噪聲更有可能耦合到ADC時鐘和模擬輸入中，導(dǎo)致SNR和SFDR性能下降。LVDS和CML采用差分信號，雖然并未完全消除CMOS中的接地反彈，但至少大大降低了這種效應(yīng)。由于采用差分信號，系統(tǒng)本身就能抑制共模噪聲，防止SNR和SFDR性能受損。LVDS和CML信號是平衡的，因此串?dāng)_被降至最小。由于信號的低壓和差分性質(zhì)，電磁干擾(EMI)同樣降低。
提高可用帶寬、改善動態(tài)范圍、降低系統(tǒng)噪聲的需求，導(dǎo)致轉(zhuǎn)換器設(shè)計的采樣速率和分辨率不斷提高，因而必須使用速度更快、效率更高的數(shù)據(jù)接口。為此推出的JESD204標(biāo)準(zhǔn)利用CML技術(shù)實現(xiàn)其物理接口。該標(biāo)準(zhǔn)最初要求高達3.125Gbps的輸出速率，這一數(shù)據(jù)速率超過了CMOS和LVDS的能力。最新版本JESD204B規(guī)定了輸出數(shù)據(jù)速率高達12.5Gbps的幾類轉(zhuǎn)換器，CMOS和LVDS接口完全遙不可及。然而，使用差分信號雖然有這么多優(yōu)勢，但仍有幾點必須注意。
以上便是此次小編帶來的“ADC”相關(guān)內(nèi)容，通過本文，希望大家對ADC數(shù)字輸出具備一定的了解。如果你喜歡本文，不妨持續(xù)關(guān)注我們網(wǎng)站哦，小編將于后期帶來更多精彩內(nèi)容。最后，十分感謝大家的閱讀，have a nice day!
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