一種應(yīng)用于UHF讀寫器的數(shù)字跳頻技術(shù)
摘要:針對(duì)超高頻(UHF)讀卡器在實(shí)際應(yīng)用中容易出現(xiàn)盲區(qū)而無(wú)法順利讀取標(biāo)簽的情況,提出了應(yīng)用于UHF讀寫器的數(shù)字跳頻技術(shù)方案。通過(guò)上位機(jī)軟件發(fā)送數(shù)字跳頻參數(shù)給FPGA,F(xiàn)PGA根據(jù)得到的參數(shù)對(duì)集成鎖相環(huán)芯片Si4133、功率放大器RF2173及外設(shè)進(jìn)行配置,得到數(shù)字跳頻的栽波信號(hào)。測(cè)試結(jié)果證明,該方案應(yīng)用于UHF讀卡器項(xiàng)目中,能順利讀到標(biāo)簽。
關(guān)鍵詞:UHF讀寫器;RFID;數(shù)字跳頻;頻率合成
引言
RFID技術(shù)的發(fā)展為物聯(lián)網(wǎng)的廣泛應(yīng)用提供了技術(shù)支持,超高頻(UHF)讀寫器憑借讀取距離遠(yuǎn)、速度快的特點(diǎn),未來(lái)必將在各個(gè)行業(yè)得到廣泛的應(yīng)用。目前,國(guó)內(nèi)的大部分UHF讀寫器都是基于單頻點(diǎn)或者頻帶較窄,在讀取標(biāo)簽的過(guò)程中容易出現(xiàn)盲區(qū),導(dǎo)致無(wú)法順利讀取標(biāo)簽。
本文提出了一種基于FPGA的數(shù)字跳頻技術(shù),通過(guò)上位機(jī)設(shè)置中心頻點(diǎn)和跳頻步進(jìn),利用FPGA對(duì)集成鎖相環(huán)芯片進(jìn)行配置,得到期望的頻率,實(shí)現(xiàn)跳頻讀取標(biāo)簽,從而解決了實(shí)際情況中的盲區(qū)問題。
1 總體框架
UHF讀寫器總體設(shè)計(jì)框圖如圖1所示。主控芯片采用Altera公司的Cyclone III系列FPGA芯片EP3C25Q240C8。該芯片有24 624個(gè)LE、149個(gè)用戶I/O口、608 256位存儲(chǔ)器、4個(gè)鎖相環(huán);外部接口多,資源豐富,非常適合在早期研發(fā)階段擴(kuò)展各種功能。
FPGA外擴(kuò)512MB SRAM和64 MB NOR Flash存儲(chǔ)器,能夠?qū)崿F(xiàn)SOPC設(shè)計(jì)、操作系統(tǒng)移植、讀寫器擴(kuò)展的功能(比如網(wǎng)絡(luò)接入能力);有USB外設(shè),方便數(shù)據(jù)的USB傳輸;利用串口轉(zhuǎn)USB芯片CP2102,可方便上位機(jī)軟件實(shí)現(xiàn)對(duì)硬件的配置參數(shù)進(jìn)行控制。
FPGA從上位機(jī)發(fā)送的命令碼中解碼出各種配置參數(shù),完成射頻發(fā)射電路中Si4133中心頻率以及跳頻步進(jìn)的設(shè)置,對(duì)功率放大器芯片RF21 73的工作模式進(jìn)行選擇,實(shí)現(xiàn)EPC GEN2協(xié)議規(guī)定的與標(biāo)簽交互命令的PIE編碼和FM0,Miller 2、4、8解碼,將讀取到的標(biāo)簽EPC通過(guò)串口發(fā)送給上位機(jī)軟件,實(shí)現(xiàn)人機(jī)交互。
2 鎖相環(huán)芯片Si4133工作原理
Si4133是Silicon Laboratories公司推出的一款應(yīng)用于GSM和GPRS無(wú)線通信的芯片,內(nèi)部含有集成壓控振蕩器的多邊帶射頻頻率合成器。其內(nèi)部框圖如圖2所示。
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該芯片包含3路獨(dú)立的PLL,分別由相位檢測(cè)器(PD)、環(huán)路濾波器(LF)、壓控振蕩器(VCO)以及可編程分頻器構(gòu)成。其中RF1、RF2的輸出端口復(fù)用,所以RF1和RF2只能由其中一路頻率輸出。圖3為實(shí)際應(yīng)用電路圖。
以RF2這一路為例,外部晶振輸入頻率fXIN經(jīng)過(guò)R分頻得到fXIN/R,與輸出頻率fRFOUT的N分頻信號(hào)fRFOUT/N一起送入相位檢測(cè)器進(jìn)行相位比較,得到一個(gè)與相位差成正比的模擬電壓u(t),該電壓經(jīng)過(guò)環(huán)路濾波器得到一個(gè)直流分量作為壓控振蕩器的輸入,對(duì)壓控振蕩器進(jìn)行頻率調(diào)整。當(dāng)fXIN/R=fRFOUT/N時(shí),電路的輸出頻率趨于穩(wěn)定,實(shí)現(xiàn)頻率鎖定,RFOUT輸出頻率為。
RF1的壓控振蕩器中心頻率為947 MHz~1.72GHz,RF2的壓控振蕩器中心頻率為789 MHz~1.43GHz,IF的壓控振蕩器中心頻率為526~952 MHz。由于EPC GEN2協(xié)議規(guī)定的RFID頻率為860~960 MHz,故選擇RF2生成載波信號(hào),中心頻率在920~928 MHz之間進(jìn)行跳頻。
Si4133采用I2C總線對(duì)內(nèi)部9個(gè)寄存器進(jìn)行配置,從而實(shí)現(xiàn)軟件控制參數(shù)。寄存器0~8分別為:主配置寄存器、鑒相器增益寄存器、掉電寄存器、RF1的N分頻寄存器、RF2的N分頻寄存器、中頻的N分頻寄存器、RF1的R分頻寄存器、RF2的R分頻寄存器、中頻的R分頻寄存器。每個(gè)寄存器的寫控制字為22位,前18位為數(shù)據(jù)位,其中高位在前,后4位為寄存器地址,寫寄存器需滿足圖4所示的串行接口時(shí)序圖。
為利用FPGA內(nèi)部的嵌入式邏輯分析儀對(duì)實(shí)際的信息進(jìn)行采樣得到的部分波形圖,如圖5所示。可以看到,對(duì)Si4133進(jìn)行配置的波形符合時(shí)序圖,完成了對(duì)Si4133的配置,達(dá)到了預(yù)期的效果。
3 上位機(jī)軟件設(shè)計(jì)
上位機(jī)軟件采用Microsoft公司的VC++6.0編寫,使用API函數(shù)方式編程。串口上位機(jī)編程分4個(gè)步驟:打開串口、配置參數(shù)、讀寫數(shù)據(jù)、關(guān)閉串口。下面詳細(xì)介紹各個(gè)步驟用到的一些函數(shù)。
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編譯通過(guò)后,PC機(jī)通過(guò)串口線連接到FPGA電路板,圖6為上位機(jī)發(fā)送跳頻配置參數(shù),F(xiàn)PGA在讀取到標(biāo)簽號(hào)后,將數(shù)據(jù)發(fā)送給上位機(jī)。
4 硬件測(cè)試
圖7為用安捷倫的頻譜儀實(shí)際測(cè)試的頻譜圖??梢钥吹剑行念l率與軟件設(shè)置的924 MHz一致,輸出功率為16.22 dBm。由測(cè)試結(jié)果可以看出,功率輸出、相位噪聲、雜散抑制等都達(dá)到較好的效果,應(yīng)用于UHF讀寫器項(xiàng)目中,能夠順利工作。通過(guò)上位機(jī)設(shè)置中心頻率為924MHz,跳頻步進(jìn)為1 MHz。讀取到的標(biāo)簽號(hào)為300000000000000000000001C3F2,為十六進(jìn)制顯示,與圖6中輸出信息中的標(biāo)簽號(hào)相同。
結(jié)語(yǔ)
本文介紹了如何通過(guò)上位機(jī)軟件發(fā)送數(shù)字跳頻的參數(shù)給FPGA,F(xiàn)PGA根據(jù)解碼得到的參數(shù)對(duì)集成鎖相環(huán)芯片Si4133、功率放大器和外設(shè)進(jìn)行配置,得到數(shù)字跳頻的載波信號(hào)。在讀取標(biāo)簽的工程中,能夠解決之前固定頻點(diǎn)時(shí)的盲區(qū)問題,順利讀取到標(biāo)簽。