有源晶振輸出串聯(lián)電阻的作用講解
一般大公司硬件電路都有最小化設(shè)計(jì),是長(zhǎng)期經(jīng)驗(yàn)總結(jié)出來的,為的是減少重復(fù)性勞動(dòng)和確保產(chǎn)品質(zhì)量。大家畫圖基本上直接抄模塊電路,審查的人也按照標(biāo)準(zhǔn)電路檢查,這樣就不用每次都考慮如何設(shè)計(jì)。你說的晶振輸出串電阻就來自于最小化設(shè)計(jì),對(duì)于數(shù)字電路里最重要的時(shí)鐘源部分,應(yīng)該特別注意保證信號(hào)完整性,最小化設(shè)計(jì)中晶振外圍電路除了電阻還要有一些其他器件。
串電阻是為了減小反射波,避免反射波疊加引起過沖。有時(shí),不同批次的板子特性不一樣,留個(gè)電阻位置便于調(diào)整板子狀態(tài)到最佳。如無必要串電阻,就用0歐電阻連接。反射波在大部分電路里有害,但PCI卻恰恰利用了反射波形成有效信號(hào)。
一、減少諧波,有源晶體輸出的是方波,這將引起諧波干擾,尤其是阻抗嚴(yán)重不匹配的情況下,加上電阻后,該電阻將與輸入電容構(gòu)成RC積分平滑電路,將方波轉(zhuǎn)換為近似正弦波,雖然信號(hào)的完整性受到一定影響,但由于該信號(hào)還要經(jīng)過后級(jí)放大、整形后才作為時(shí)鐘信號(hào),因此,性能并不受影響,該電阻的大小需要根據(jù)輸入端的阻抗、輸入等效電容,有源晶體的輸出阻抗等因素選擇。
二、阻抗匹配,減小回波干擾及導(dǎo)致的信號(hào)過沖。我們知道,只要阻抗不匹配,都會(huì)產(chǎn)生信號(hào)反射,即回波,有源晶體的輸出阻抗通常都很低,一般在幾百歐以ac下,而信號(hào)源的輸入端在芯片內(nèi)部結(jié)構(gòu)上通常是運(yùn)放的輸入端,由芯片的內(nèi)部電路與外部的無源石英晶體構(gòu)成諧振電路(使用有源晶體后就不需要這個(gè)晶體了),這個(gè)運(yùn)放的輸出阻抗都在兆歐以上。