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賽普拉斯PSoC可編程片上系統(tǒng)器件出貨量已突破5億片
日前，賽普拉斯半導(dǎo)體公司宣布其深受廣大客戶歡迎的 PSoC® 可編程片上系統(tǒng)的出貨量已突破 5 億片。PSoC 大規(guī)模的商業(yè)化交付始于 2002 年。截至 2006 年 6 月，賽普拉斯的出貨量就曾達(dá)到了 1 億片。到 2007 年 9
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賽普拉斯PSoC可編程片上系統(tǒng)器件出貨量已突破5億片
日前，賽普拉斯半導(dǎo)體公司宣布其深受廣大客戶歡迎的 PSoC® 可編程片上系統(tǒng)的出貨量已突破 5 億片。PSoC 大規(guī)模的商業(yè)化交付始于 2002 年。截至 2006 年 6 月，賽普拉斯的出貨量就曾達(dá)到了 1 億片。到 2007 年 9
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解析高速數(shù)/模轉(zhuǎn)換器(DAC)的建立和保持時間
介紹 為了達(dá)到高速數(shù)/模轉(zhuǎn)換器(DAC)的最佳性能，需要嚴(yán)格滿足數(shù)字信號的時序要求。隨著時鐘頻率的提高，數(shù)字接口的建立和保持時間成為系統(tǒng)設(shè)計人員需要重點(diǎn)關(guān)注的參數(shù)。本應(yīng)用筆記對建立和保持時間進(jìn)行詳盡說明，
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姿態(tài)角測試研究
研究飛行體姿態(tài)角測試技術(shù)，提出了一種姿態(tài)角測試方法，給出了可行的實(shí)現(xiàn)方案和實(shí)測曲線，用卡爾丹角結(jié)合測試曲線對被測體姿態(tài)進(jìn)行了分析。通過實(shí)際測試，證明了該測試方法原理可行。
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滿足多媒體處理器需求的動態(tài)電源管理技術(shù)
有源電源管理 片上電源管理技術(shù)分為兩大類，管理工作系統(tǒng)功耗與管理待機(jī)功耗。 有源電源管理分為三個領(lǐng)域：動態(tài)電壓與頻率縮放 (DVFS)、自適應(yīng)電壓調(diào)整 (AVS) 與動態(tài)電源切換 (DPS)。靜態(tài)功耗管理需要確保閑置
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數(shù)據(jù)轉(zhuǎn)換器的衡量標(biāo)準(zhǔn)：演進(jìn)歷程
數(shù)據(jù)轉(zhuǎn)換器有意義的衡量方法是什么？就數(shù)據(jù)轉(zhuǎn)換器自身而言，它是相當(dāng)容易定義的。數(shù)據(jù)轉(zhuǎn)換器是通過模數(shù)轉(zhuǎn)換器(ADC)將連續(xù)的電信號（即模擬信號）轉(zhuǎn)換為數(shù)碼字〔以比特（bit）為單位〕或反過來，通過數(shù)模轉(zhuǎn)換器(DAC)將
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如何發(fā)現(xiàn)并解決FPGA設(shè)計中的時序問題
耗費(fèi)數(shù)月精力做出的設(shè)計卻無法滿足時序要求，這確實(shí)非常令人傷心。然而，試圖正確地對設(shè)計進(jìn)行約束以保證滿足時序要求的過程幾乎同樣令人費(fèi)神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
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醫(yī)療信息通信系統(tǒng)
可備帶、可植/侵主的健康醫(yī)療器件已大量涌現(xiàn)，如常見的指尖式血氧傳感器、腕表型血糖傳感器、腕表型睡眠器質(zhì)測量儀、可植入身份識別組件等，而新一代超低功耗收發(fā)器將技術(shù)水平提高到一個新的高度，若這些器件只能單獨(dú)地工作，通信資源就不能充分地利用，因此BAN的研發(fā)勢在必行。當(dāng)然，BAN是一種獨(dú)特的局域網(wǎng)，人體組織對無線電波有吸收作用，因此BAN物理層需要創(chuàng)新的技術(shù)，同時還要考慮人體安全性的因素，此外，檢測手段技術(shù)的多樣性也比其它局域網(wǎng)復(fù)雜。這些問題有待于解決。(
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第五代肖特基二極管（Vishay）
日前，Vishay推出四款第五代高性能 45 V 和 100V 肖特基二極管 --- 6CWT04FN、10WT10FN、20CWT10FN 和 20WT04FN 。Vishay此次推出的器件將 D-Pak 的電流能力擴(kuò)展至高達(dá) 20 A，從而確定了業(yè)界的新標(biāo)準(zhǔn)。這些器件采用次
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如何發(fā)現(xiàn)并解決FPGA設(shè)計中的時序問題
耗費(fèi)數(shù)月精力做出的設(shè)計卻無法滿足時序要求，這確實(shí)非常令人傷心。然而，試圖正確地對設(shè)計進(jìn)行約束以保證滿足時序要求的過程幾乎同樣令人費(fèi)神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
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如何發(fā)現(xiàn)并解決FPGA設(shè)計中的時序問題
如何發(fā)現(xiàn)并解決FPGA設(shè)計中的時序問題
