在嵌入式系統(tǒng)設(shè)計(jì)中我們經(jīng)常要使用到各種頻率的時(shí)鐘,供給DSP或者FPGA等硬件芯片,使其正常工作。
用于SOC或塊級(jí)時(shí)鐘的可配置分頻器
摘要:在EAST分布式中央定時(shí)同步系統(tǒng)中,時(shí)鐘分頻和觸發(fā)延遲電路是分布式節(jié)點(diǎn)的核心。為了完成對(duì)基準(zhǔn)時(shí)鐘信號(hào)進(jìn)行多路任意整數(shù)倍的等占空比的分頻,并對(duì)輸入的觸發(fā)脈沖進(jìn)行多路任意時(shí)間的延遲輸出,本設(shè)計(jì)中采用VHDL