// 時鐘默認(rèn)情況 // FLL時鐘 FLL選擇 XT1 // 輔助時鐘 ACLK選擇 XT1 32768Hz // 主系統(tǒng)時鐘 MCLK選擇 DCOCLKDIV 8000000Hz // 子系統(tǒng)時鐘 SMCLK選擇 DCOCLKDIV 8000000Hz // TA1選擇ACLK,最大計(jì)數(shù)值為6
關(guān)于STM32的串口溢出中斷
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