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提高遙測信號處理器測試性的一種方法
可測試性定義為：產(chǎn)品能及時準(zhǔn)確地確定其狀態(tài)，隔離其內(nèi)部故障的設(shè)計特性，以提高產(chǎn)品可測試性為目的而進(jìn)行的設(shè)計被稱為可測試性設(shè)計?？蓽y試性是同可靠性、維修性相并列的一門新型學(xué)科，其發(fā)展和應(yīng)
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一種提高遙測信號處理器測試性方法
可測試性定義為：產(chǎn)品能及時準(zhǔn)確地確定其狀態(tài)，隔離其內(nèi)部故障的設(shè)計特性，以提高產(chǎn)品可測試性為目的而進(jìn)行的設(shè)計被稱為可測試性設(shè)計。
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一種提高遙測信號處理器測試性方法
摘要 針對遙測信號處理器的設(shè)計原理，增加少量硬件電路，利用其自身FPGA剩余邏輯資源完成自檢模塊設(shè)計，實現(xiàn)了信號處理器BIT測試功能，提高了信號處理器在掛機(jī)狀態(tài)下的測試覆蓋率和故障檢測率。 關(guān)鍵詞 FPGA；BIT；
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基于直接數(shù)字頻率合成的可編程遙測信號源
摘要：針對傳統(tǒng)的遙測信號源缺乏靈活可配置性、通用性差的問題，提出采用FPGA和DDS技術(shù)為核心設(shè)計靈活可配置的可編程遙測信號源。該信號源的硬件電路主要由低成本FPGA芯片和DDS芯片組成，采用Verilog語言進(jìn)行編程，使
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基于FPGA和LabVIEW的遙測信號模擬源設(shè)計
摘要：基于FPGA和LabVIEW設(shè)計了用于某遙測組件測試的專用設(shè)備。運用DDS技術(shù)實現(xiàn)傳輸速率可變的LNDS信號，并使用LabVIEW圖形編程工具，實現(xiàn)了數(shù)字信號源的交互界面，可以產(chǎn)生由上住機(jī)程控信號傳輸速率和數(shù)據(jù)內(nèi)容可變的
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基于PXI總線的遙測信號測試平臺的設(shè)計
介紹了一種基于PXI總線的測試平臺，以實現(xiàn)遙測系統(tǒng)中PCM碼的持續(xù)無丟幀存儲和模擬各種傳感器信號的功能。
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基于PXI總線的遙測信號測試平臺的設(shè)計
介紹了一種基于PXI總線的測試平臺，以實現(xiàn)遙測系統(tǒng)中PCM碼的持續(xù)無丟幀存儲和模擬各種傳感器信號的功能。
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日本超高速因特網(wǎng)衛(wèi)星遙測信號出現(xiàn)異常
日本宇宙航空研究開發(fā)機(jī)構(gòu)20日說，今年2月發(fā)射的“紐帶”號超高速因特網(wǎng)衛(wèi)星遙測信號出現(xiàn)異常，目前原因仍在調(diào)查中。根據(jù)宇宙航空研究開發(fā)機(jī)構(gòu)當(dāng)天發(fā)布的新聞公報，日本當(dāng)?shù)貢r間19日1時38分左右，“紐
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