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FPGA設(shè)計(jì)的高速FIFO電路技術(shù)
FPGA設(shè)計(jì)的高速FIFO電路技術(shù)
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3DES加密算法及其FPGA設(shè)計(jì)
摘要： 介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計(jì)實(shí)現(xiàn)。采用了狀態(tài)機(jī)和流水線技術(shù)，使得在面積和速度上達(dá)到最佳優(yōu)化；添加了輸入和輸出接口的設(shè)計(jì)以增強(qiáng)該算法應(yīng)用的靈活性。各模塊均用硬件描述語(yǔ)言實(shí)現(xiàn)
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簡(jiǎn)單MicroBlaze微控制器的理念
MicroBlaze是一款基于構(gòu)造的的嵌入式微處理器，它的顯著優(yōu)勢(shì)在于能滿足復(fù)雜應(yīng)用的需求，在除了運(yùn)行簡(jiǎn)單的通用應(yīng)用以外，還能運(yùn)行操作系統(tǒng)。
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FPGA設(shè)計(jì)的注意事項(xiàng)
FPGA設(shè)計(jì)的注意事項(xiàng)
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基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法
基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法
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Virtex-5FPGA設(shè)計(jì)Gbps無線通信技術(shù)設(shè)計(jì)計(jì)算
本文基于Virtex-5FPGA設(shè)計(jì)面向未來移動(dòng)通信標(biāo)準(zhǔn)的Gbps無線通信基站系統(tǒng)，具有完全的可重配置性，可以完成MIMO、OFDM及LDPC等復(fù)雜信號(hào)處理算法，實(shí)現(xiàn)1Gbps速率的無線通信。
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Virtex-5FPGA設(shè)計(jì)Gbps無線通信技術(shù)設(shè)計(jì)計(jì)算
本文基于Virtex-5FPGA設(shè)計(jì)面向未來移動(dòng)通信標(biāo)準(zhǔn)的Gbps無線通信基站系統(tǒng)，具有完全的可重配置性，可以完成MIMO、OFDM及LDPC等復(fù)雜信號(hào)處理算法，實(shí)現(xiàn)1Gbps速率的無線通信。
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基于Virtex-5 FPGA設(shè)計(jì)Gbps無線通信基站
LTE、IMT-Advanced等未來移動(dòng)通信系統(tǒng)要支持大量的寬帶用戶和極高的空中接口速率，使用MIMO、OFDM、LDPC等復(fù)雜的通信信號(hào)處理算法，具有動(dòng)態(tài)可重配置、計(jì)算資源動(dòng)態(tài)調(diào)度能功能，對(duì)基站的計(jì)算處理和互連提出了極高的要求。以單平臺(tái)多系列的Virtex-5系列FPGA為核心設(shè)計(jì)的Gpbs無線通信基站，采用基于交換的互連和分組的數(shù)據(jù)傳輸機(jī)制，可以驗(yàn)證各種未來無線通信所使用的算法與技術(shù)，實(shí)現(xiàn)Gbps的無線傳輸通信。
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基于Virtex-5 FPGA設(shè)計(jì)Gbps無線通信基站
LTE、IMT-Advanced等未來移動(dòng)通信系統(tǒng)要支持大量的寬帶用戶和極高的空中接口速率，使用MIMO、OFDM、LDPC等復(fù)雜的通信信號(hào)處理算法，具有動(dòng)態(tài)可重配置、計(jì)算資源動(dòng)態(tài)調(diào)度能功能，對(duì)基站的計(jì)算處理和互連提出了極高的要求。以單平臺(tái)多系列的Virtex-5系列FPGA為核心設(shè)計(jì)的Gpbs無線通信基站，采用基于交換的互連和分組的數(shù)據(jù)傳輸機(jī)制，可以驗(yàn)證各種未來無線通信所使用的算法與技術(shù)，實(shí)現(xiàn)Gbps的無線傳輸通信。
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基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)
當(dāng)設(shè)計(jì)的系統(tǒng)需要對(duì)數(shù)字信號(hào)進(jìn)行處理時(shí)，常采用通用 DSP（Digital Signal Process）處理器，這樣的設(shè)計(jì)方案通用性好，且還有各種較為成熟的 DSP算法可以參考。但是，這類方案通常是雙核設(shè)計(jì)，即采用通用控制器（MCU）加上通用 DSP處理器實(shí)現(xiàn)，在實(shí)現(xiàn)系統(tǒng)時(shí)開發(fā)的復(fù)雜程度、難度都較大，也難以滿足定制特殊處理的需要。為了解決這些問題，人們開始尋求新的設(shè)計(jì)方案，基于通用處理器加上FPGA（大規(guī)?？删庨T陣列）的架構(gòu)方案逐漸成為主流，在新的方案中通用控制器完成控制和管理功能，專用的數(shù)字信號(hào)處理和組合邏輯功能由 FPGA實(shí)現(xiàn)，使得設(shè)計(jì)開銷與復(fù)雜程度明顯降低。
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直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn)
直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn)
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基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)
當(dāng)設(shè)計(jì)的系統(tǒng)需要對(duì)數(shù)字信號(hào)進(jìn)行處理時(shí)，常采用通用 DSP（Digital Signal Process）處理器，這樣的設(shè)計(jì)方案通用性好，且還有各種較為成熟的 DSP算法可以參考。但是，這類方案通常是雙核設(shè)計(jì)，即采用通用控制器（MCU）加上通用 DSP處理器實(shí)現(xiàn)，在實(shí)現(xiàn)系統(tǒng)時(shí)開發(fā)的復(fù)雜程度、難度都較大，也難以滿足定制特殊處理的需要。為了解決這些問題，人們開始尋求新的設(shè)計(jì)方案，基于通用處理器加上FPGA（大規(guī)模可編門陣列）的架構(gòu)方案逐漸成為主流，在新的方案中通用控制器完成控制和管理功能，專用的數(shù)字信號(hào)處理和組
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如何有效地管理FPGA設(shè)計(jì)中的時(shí)序問題
一、摘要 從簡(jiǎn)單SRAM接口到高速同步接口，TimingDesigner軟件允許設(shè)計(jì)者在設(shè)計(jì)流程的初期就判斷出潛在的時(shí)序問題，盡最大可能在第一時(shí)間解決時(shí)序問題。在設(shè)計(jì)過程的早期檢測(cè)到時(shí)序問題，不僅節(jié)省時(shí)間，而且可以更
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借助物理綜合提高FPGA設(shè)計(jì)效能
隨著FPGA密度的增加，系統(tǒng)設(shè)計(jì)人員能夠開發(fā)規(guī)模更大、更復(fù)雜的設(shè)計(jì)，從而將密度優(yōu)勢(shì)發(fā)揮到最大。這些大規(guī)模設(shè)計(jì)基于這樣的設(shè)計(jì)需求——需要在無線通道卡或者線路卡等現(xiàn)有應(yīng)用中加入新功能，或者通過把兩種芯片功能合
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借助物理綜合提高FPGA設(shè)計(jì)效能
借助物理綜合提高FPGA設(shè)計(jì)效能
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采用中檔FPGA設(shè)計(jì)面向PCI Express系統(tǒng)的解決方案
本文將探討PCI標(biāo)準(zhǔn)的局限性，以及下一代PCI Express是如何以節(jié)約成本的方式得以實(shí)現(xiàn)的。
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出租車計(jì)價(jià)器的FPGA設(shè)計(jì)
O 引 言 FPGA(Field Programmable Gate Array，現(xiàn)場(chǎng)可編程門陣列)是一種高密度可編程邏輯器件，它支持系統(tǒng)可編程，通過寫入不同的配置數(shù)據(jù)就可以實(shí)現(xiàn)不同的邏輯功能。使用FPGA來設(shè)計(jì)電子系統(tǒng)，具有設(shè)計(jì)周期短
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數(shù)字圖像空域?yàn)V波算法的FPGA設(shè)計(jì)與實(shí)現(xiàn)
在圖像通信、遙感圖像分析、醫(yī)學(xué)成像診斷等應(yīng)用領(lǐng)域，為了便于顯示、觀察或進(jìn)行進(jìn)一步的處理，常常需要對(duì)原始的數(shù)字圖像進(jìn)行特征提取(如邊緣檢測(cè)、邊緣銳化)、噪聲平滑濾波、幾何校正等處理，這類圖像處理技術(shù)稱為
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模塊化FPGA設(shè)計(jì)在某雷達(dá)接收機(jī)中的應(yīng)用
0 引言 目前基于FPGA和DSP結(jié)構(gòu)的軟件無線電技術(shù)被廣泛應(yīng)用在數(shù)字接收機(jī)設(shè)計(jì)中，雷達(dá)接收機(jī)領(lǐng)域的數(shù)字化技術(shù)也在日趨發(fā)展，如何借助數(shù)字化的軟硬件優(yōu)勢(shì)設(shè)計(jì)出易實(shí)現(xiàn)、靈活，并滿足不同性能指標(biāo)和目的的數(shù)字接收
