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JavaCard指令處理器的FPGA設(shè)計(jì)
JavaCard指令處理器的FPGA設(shè)計(jì)
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基于C/C++的大規(guī)模FPGA設(shè)計(jì)
背景可編程邏輯器件的設(shè)計(jì)方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設(shè)計(jì)的日益復(fù)雜和可編程邏輯器件規(guī)模的不斷擴(kuò)大，人們不停地尋求更加抽象的行為級設(shè)計(jì)方法，以便在盡可能短時間內(nèi)完成自
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基于C/C++的大規(guī)模FPGA設(shè)計(jì)
背景可編程邏輯器件的設(shè)計(jì)方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設(shè)計(jì)的日益復(fù)雜和可編程邏輯器件規(guī)模的不斷擴(kuò)大，人們不停地尋求更加抽象的行為級設(shè)計(jì)方法，以便在盡可能短時間內(nèi)完成自
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基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法
FPGA近年來在越來越多的領(lǐng)域中應(yīng)用，很多大通信系統(tǒng)（如通信基站等）都用其做核心數(shù)據(jù)的處理。但是過長的編譯時間，在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發(fā)
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Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 （Xilinx, Inc. (NASDAQ: XLNX) ）日前在進(jìn)駐北京新址的慶典上,強(qiáng)調(diào)其對高增長的中國市場的承諾。該公司不斷擴(kuò)大其在亞太地區(qū)的影響力，包括開設(shè)研發(fā)中心，并將本地銷售、市場營銷
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一種浮點(diǎn)反正切函數(shù)的FPGA設(shè)計(jì)和實(shí)現(xiàn)
快速精確的反正弦函數(shù)運(yùn)算在現(xiàn)代工程中應(yīng)用廣泛。為了提高反正弦函數(shù)的精度和計(jì)算能力， 研究了基于CORD IC算法的反正弦函數(shù)運(yùn)算器的FPGA 實(shí)現(xiàn)， 并通過改進(jìn)算法減小了誤差， 使誤差精度達(dá)到10--4 數(shù)量級。并在X ili
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Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
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Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
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Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
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Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
Xilinx技術(shù)總監(jiān)：為FPGA設(shè)計(jì)帶來革命性變革
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一種浮點(diǎn)反正切函數(shù)的FPGA設(shè)計(jì)和實(shí)現(xiàn)
一種浮點(diǎn)反正切函數(shù)的FPGA設(shè)計(jì)和實(shí)現(xiàn)
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正交幅度調(diào)制解調(diào)器的FPGA設(shè)計(jì)與仿真
摘要：正交幅度調(diào)制技術(shù)(QAM)是一種功率和帶寬相對高效的信道調(diào)制技術(shù)，因此在信道調(diào)制技術(shù)中得到了廣泛的應(yīng)用。它的載波信號的FPGA實(shí)現(xiàn)一般采用查找表的方法，為了達(dá)到高精度要求，需要耗費(fèi)大量的ROM資源。提出了一
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正交幅度調(diào)制解調(diào)器的FPGA設(shè)計(jì)與仿真
摘要：正交幅度調(diào)制技術(shù)(QAM)是一種功率和帶寬相對高效的信道調(diào)制技術(shù)，因此在信道調(diào)制技術(shù)中得到了廣泛的應(yīng)用。它的載波信號的FPGA實(shí)現(xiàn)一般采用查找表的方法，為了達(dá)到高精度要求，需要耗費(fèi)大量的ROM資源。提出了一
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基于高速定點(diǎn)FFT算法的FPGA設(shè)計(jì)方案
基于高速定點(diǎn)FFT算法的FPGA設(shè)計(jì)方案
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FPGA設(shè)計(jì)者的五項(xiàng)基本功
記得《佟林傳》里，佟林練的基本功是“繞大樹、解皮繩”，然后才練成了什么“鬼影隨行、柳葉綿絲掌”。在我看來，成為一名說得過去的FPGA設(shè)計(jì)者，需要練好5項(xiàng)基本功：仿真、綜合、時序分析、調(diào)試
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Altera與嵌入式聯(lián)盟合作，優(yōu)化FPGA設(shè)計(jì)流程
Altera與嵌入式聯(lián)盟合作伙伴一起，提供業(yè)界最全面的一流處理器、軟件開發(fā)工具、操作系統(tǒng)以及知識產(chǎn)權(quán)(IP)內(nèi)核，這些都含在一個FPGA設(shè)計(jì)流程中。從多種處理器中進(jìn)行選擇，以滿足您的成本、功耗、實(shí)時和應(yīng)用處理需求。
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提高FPGA設(shè)計(jì)效能的方法
隨著FPGA密度的增加，系統(tǒng)設(shè)計(jì)人員能夠開發(fā)規(guī)模更大、更復(fù)雜的設(shè)計(jì)，從而將密度優(yōu)勢發(fā)揮到最大。這些大規(guī)模設(shè)計(jì)基于這樣的設(shè)計(jì)需求——需要在無線通道卡或者線路卡等現(xiàn)有應(yīng)用中加入新功能，或者通過把兩種
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提高FPGA設(shè)計(jì)效能的方法
提高FPGA設(shè)計(jì)效能的方法
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FPGA設(shè)計(jì)當(dāng)中的功耗問題研究
FPGA設(shè)計(jì)當(dāng)中的功耗問題研究
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現(xiàn)代FPGA設(shè)計(jì)的能源優(yōu)化方案
現(xiàn)代FPGA設(shè)計(jì)的能源優(yōu)化方案
