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[導(dǎo)讀]本應(yīng)用筆記主要介紹如何對DS26303進(jìn)行正確編程,啟用2048kHz同步接口模式,以支持綜合定時供給系統(tǒng)(BITS)或定時供給單元(SSU)等時鐘分配應(yīng)用。應(yīng)該注意的是,目前有兩款DS26303產(chǎn)品可供使用:DS26303-120和DS26303-75。二者之間唯一的區(qū)別在于默認(rèn)的E1線路阻抗設(shè)置。必須注意這一特點,確保在設(shè)計階段和生產(chǎn)階段使用相同型號的器件。

引言

DS26303 E1/T1/J1八通道線路接口單元(LIU)一個鮮為人知的功能是:能夠發(fā)射、接收符合國際電信聯(lián)盟ITU-T建議G.703 (2001年11月)第13條規(guī)定的2048kHz同步接口(T12)信號。本應(yīng)用筆記主要介紹如何對DS26303進(jìn)行正確編程,啟用2048kHz同步接口模式,以支持綜合定時供給系統(tǒng)(BITS)或定時供給單元(SSU)等時鐘分配應(yīng)用。應(yīng)該注意的是,目前有兩款DS26303產(chǎn)品可供使用:DS26303-120和DS26303-75。二者之間唯一的區(qū)別在于默認(rèn)的E1線路阻抗設(shè)置。必須注意這一特點,確保在設(shè)計階段和生產(chǎn)階段使用相同型號的器件。

DS26303設(shè)置工作在2048kHz同步接口模式

對DS26303編程,使其支持2048kHz同步接口,這個過程需要多個操作步驟,用到了一些未在DS26303數(shù)據(jù)表中列出的寄存器。本文“附錄”給出了所有沒有列出的寄存器的說明。

在啟用2048kHz同步接口模式之前,有必要執(zhí)行一些配置操作,確保DS26303按照所需要的流程工作。

第一步,更改內(nèi)部時鐘,利用LIU通道對應(yīng)的發(fā)送時鐘(通常為TCLK輸入),取代主時鐘(MCLK輸入)。默認(rèn)情況下,啟用2048kHz同步接口模式后,DS26303將通用MCLK輸入用作時鐘源。這會使TTIP/TRING引腳的輸出信號鎖頻至MCLK輸入,而非TCLK輸入??墒褂靡韵萝浖渲脤S26303編程,采用TCLK輸入作為時鐘源。

將地址為0x1F的ADDP寄存器設(shè)置為0x03,選擇全局測試寄存器組。

將地址為0x07的TXDIG寄存器設(shè)置為0x10。將TXDIG寄存器的第4位置1,2048kHz同步接口模式將使用TCLK輸入,而非MCLK輸入。需要注意的是,更改TXDIG寄存器的第4位會影響到將MCLK輸入用作時鐘源的其它兩個功能,即:發(fā)射全1 (TAOE)和自動發(fā)射全1 (ATAOS)功能。因此,禁用2048kHz同步接口模式后,需要將該位置0。但是,如果啟用TAOE或ATAOS后,設(shè)計人員希望將TCLK輸入用作時鐘源,則可將TXDIG寄存器的第4位置1。

第二步,更改短路檢測電路(SCDC)的電流門限,防止關(guān)閉TTIP/TRING發(fā)射器輸出。默認(rèn)情況下,啟用2048kHz同步接口模式后,DS26303電流門限不正確。要利用正確的短路電流設(shè)置DS26303,須進(jìn)行下述軟件配置。

將地址為0x1F的ADDP寄存器設(shè)置為0x04至0x0B,將分別選擇LIU1測試至LIU8測試寄存器組。

將地址為0x05的TXCMDA寄存器設(shè)置為下列數(shù)值之一(表1),這些數(shù)值應(yīng)與模板選擇(TS)寄存器的數(shù)值同步。譬如,如果將TS寄存器配置為E1 75Ω模式,則將TXCMDA寄存器設(shè)置為0x33。此外,在啟用G.703 2048kHz同步接口模式后,不應(yīng)關(guān)閉TS寄存器的發(fā)射阻抗端接。注意,TXCMDA寄存器的7:6位應(yīng)始終保持為0;第5位控制SCDC控制使能;第4:0位包含新的短路電流門限,盡管可對門限進(jìn)行調(diào)整,但不建議這樣做,因為選擇這些數(shù)值的目的是防止器件損壞。

 

TS Mode Setting TXCMDA Value
E1 75Ω 0x33
E1 120Ω 0x2F

 

表1. TXCMDA寄存器設(shè)置

在完成上述兩個配置步驟后,DS26303被正確配置為支持2048kHz同步接口模式。

設(shè)置DS26303的一個或更多通道,使其支持2048kHz同步接口模式時,可按照下述軟件配置。

將地址0x1F的ADDP寄存器設(shè)置為0x01,選擇獨立LIU寄存器組。

將地址0x08的G703EN寄存器設(shè)置為所要求的數(shù)值,以針對適當(dāng)?shù)腖IU通道啟用2048kHz同步接口模式。

假定現(xiàn)已按照上面的建議禁用TTIP/TRING發(fā)射輸出,則通過下述軟件配置啟用發(fā)射器輸出。

將地址0x1F的ADDP寄存器設(shè)置為0x00,選擇主寄存器組。

將地址0x12的OEB寄存器設(shè)置為所要求的數(shù)值,以針對G703EN寄存器啟用的相同LIU通道使能TTIP/TRING發(fā)射器輸出。

結(jié)論

對DS26303的默認(rèn)值進(jìn)行的更改后,器件可完全支持ITU-T G.703 2048kHz同步接口(T12)規(guī)范。本應(yīng)用筆記說明了必要的更改,以及有關(guān)的背景信息,并介紹了詳細(xì)的配置流程。借助這些信息和DS26303數(shù)據(jù)資料,設(shè)計人員可以將2048kHz同步接口功能集成到BITS或SSU設(shè)計中。

附錄:DS26303寄存器信息

DS26303的寄存器空間地址為0x00至0x1F,采用存儲區(qū)模式,包含所有LIU通道的配置和狀態(tài)信息。地址為0x1F的ADDP寄存器為特殊寄存器,存放訪問不同寄存器組的指針。對于每個指定的寄存器組,該寄存器的功能和數(shù)值不變。不過,對ADDP寄存器的更改將改變當(dāng)前寄存器組,從而改變地址為0x00至0x1E的寄存器功能和數(shù)值。

下述內(nèi)容為啟用ITU-T G.703 2048kHz同步接口(T12)所需的寄存器的詳細(xì)信息,以及對每一位的描述。

寄存器名稱:ADDP

寄存器組:存在于所有寄存器組

寄存器描述:地址指針

寄存器地址:1Fh

 

Bit # 7 6 5 4 3 2 1 0
Name ADDP7 ADDP6 ADDP5 ADDP4 ADDP3 ADDP2 ADDP1 ADDP0
Default 0 0 0 0 0 0 0 0

 

第7至0位:地址指針(ADDP)。  用于選擇、切換主寄存器組、副寄存器組、獨立LIU寄存器組、BERT寄存器組和任何測試寄存器組的指針。譬如,軟件必須將ADDP寄存器設(shè)置為0x00,以訪問主寄存器組;設(shè)置為0xAA,以訪問副寄存器組;設(shè)置為0x01,以訪問獨立的LIU寄存器組;或設(shè)置為0x02,以訪問BERT寄存器組。請參考表2,了解如何選擇適當(dāng)?shù)募拇嫫鹘M。 

表2. 地址指針寄存器組的選擇

 

ADDP Register Value Register Bank Name
0x00 Primary
0xAA Secondary
0x01 Individual LIU
0x02 BERT
0x03 Global Test
0x04 LIU1 Test
0x05 LIU2 Test
0x06 LIU3 Test
0x07 LIU4 Test
0x08 LIU5 Test
0x09 LIU6 Test
0x0A LIU7 Test
0x0B LIU8 Test

 

寄存器名稱:G703EN

寄存器組:獨立LIU寄存器組

寄存器描述:ITU-T G.703 2048kHz同步接口啟用

寄存器地址:08h

第7至0位:G703啟用(G703EN)?! ‘?dāng)該位清0,關(guān)聯(lián)的LIU通道的發(fā)射器和接收器處于正常的T1/E1/J1模式。該位置1時,關(guān)聯(lián)的LIU通道的發(fā)射器和接收器處于ITU-T G.703 2048kHz同步接口(T12)模式。

注:該功能僅適用于A2及更高版本器件。

寄存器名稱:TXCMDA

寄存器組:LIU測試寄存器組1至8

寄存器描述:發(fā)射線路驅(qū)動器自定義模式A

寄存器地址:05h

 

Bit # 7 6 5 4 3 2 1 0
Name Reserved Reserved SCDCOR SCC4 SCC3 SCC2 SCC1 SCC0
Default 0 0 0 0 0 0 0 0

 

第7至6位:保留,這些位應(yīng)保持清0。

第5位:短路檢測電流控制(SCDCOR)。該位清0,則啟用默認(rèn)的線路驅(qū)動器電流門限;置1時,則由默認(rèn)的線路驅(qū)動器電流門限取代,該值由SCC[4:0]設(shè)置。

第4至0位:短路電流(SCC[4:0])。如果短路檢測電流控制(SCDCOR)位置1,則這五位的二進(jìn)制加權(quán)值設(shè)置為短路檢測電流門限。如果線路驅(qū)動器電流超過該值,則禁用發(fā)射器,驅(qū)動器故障監(jiān)控狀態(tài)置1。

注:該功能僅適用于A2及更高版本器件。

寄存器名稱:TXDIG

寄存器組:全局測試寄存器組

寄存器描述:發(fā)射數(shù)字測試模式

寄存器地址:07h

 

Bit # 7 6 5 4 3 2 1 0
Name Reserved Reserved Reserved CLKS Reserved Reserved Reserved Reserved
Default 0 0 0 0 0 0 0 0

 

第7至5位:保留。該位應(yīng)保持重置為0。

第5位:時鐘選擇模式(CLKS)。該位清0時,如果LIU通道處于下述模式,則每個LIU通道的發(fā)射時鐘源為主時鐘:發(fā)射全1、自動發(fā)射全1、ITU-T G.703 2048kHz同步接口(T12)和工廠測試。置1時,如果LIU通道處于上述任何一種模式,則每個LIU通道的發(fā)射時鐘源為關(guān)聯(lián)的TCLK引腳(或者,如啟用遠(yuǎn)程環(huán)回,則為恢復(fù)時鐘)。

第3至0位:保留。這些位應(yīng)保持清0。

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