摘 要： 設計了基于FPGA的片上網絡系統(tǒng)硬件平臺。系統(tǒng)由大容量的FPGA、存儲器、高速A/D與D/A、通信接口和一個擴展的ARM９系統(tǒng)組成。完成了集高速數字信號處理、視頻編解碼和網絡傳輸功能與一體的多核系統(tǒng)設計。針對典型的3×3 2D Mesh結構的NoC系統(tǒng)應用進行了探討，闡述了NoC系統(tǒng)設計過程中的關鍵技術，并使用SigXplorer軟件對系統(tǒng)的信號完整性解決方案進行了PCB的反射與串擾仿真。
關鍵詞: 片上網絡；信號完整性；驗證平臺；片上端接
IC制造技術的發(fā)展推動著芯片向更高集成度方向前進，從而能夠將整個系統(tǒng)設計到單個芯片中構成片上系統(tǒng)SoC（System on Chip）。SoC采用全局同步型共享總線通信結構。這類系統(tǒng)由于掛在總線上的設備在通信時對總線的獨占性以及單一系統(tǒng)總線對同步時鐘的要求，使得在片上IP核越來越多的芯片中，不可避免地存在通信效率低下、全局同步時鐘開銷大等問題。
片上網絡NoC(Network on Chip)的提出有效地解決了上述問題。該系統(tǒng)借鑒了計算機網絡中分組交換的通信方法，可以根據應用靈活地采用多種網絡拓撲結構互連片上IP核[1]。各IP核間有多條鏈路可以進行并行通信，由FIFO跨接處于異步時鐘域中的IP核，實現全局異部局部同步時鐘系統(tǒng)。具有可擴展性好、低互連功耗和低延遲等特點。
然而目前NoC還處于研究階段，國內許多科研機構和院校圍繞著網絡拓撲結構、映射算法、路由算法、測試方法、路由節(jié)點的設計等展開研究[2]。各種基礎理論的驗證通常依賴于軟件
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