接收信號(hào)處理芯片AD6634及其在軟件無(wú)線電中的應(yīng)用

    摘要：AD6634是Analog Devices公司的四通道寬帶可編程數(shù)字接收信號(hào)處理芯片。文中介紹了AD6634的內(nèi)部結(jié)構(gòu)和基本功能特點(diǎn)，給出了基于AD6634的通用可編程中頻軟件無(wú)線接收系統(tǒng)的結(jié)構(gòu)，同時(shí)給出了系統(tǒng)中AD轉(zhuǎn)換、FIFO和DSP等器件的選擇方向，最后討論了AD6634主要參數(shù)的設(shè)置方法。

    關(guān)鍵詞：軟件無(wú)線電 AD6634 接口 參數(shù)設(shè)置

1 引言

1992年5月，Miltre公司的Jeo Mitoa首次提出了軟件無(wú)線電的概念，其基本思想是在一個(gè)通用可編程硬件平臺(tái)上，通過(guò)軟件編程的方法來(lái)完成通信的各種功能，并將A/D、D/A轉(zhuǎn)換盡量靠近天線，盡可能多地實(shí)現(xiàn)系統(tǒng)功能軟件化。其通用的硬件平臺(tái)可用可編程數(shù)字信號(hào)處理器（DSP）來(lái)實(shí)現(xiàn)。但是由于器件發(fā)展水平的限制，常用A/D轉(zhuǎn)換器件的軟件速率一般只能達(dá)到幾十MHz到幾百M(fèi)Hz，因而不能在射頻頻域進(jìn)行數(shù)字化采樣。另外，DSP的處理速度比較低，通常是將整個(gè)系統(tǒng)分成射頻部分、中頻部分和基頻部分分別處理。即在射頻部分將信號(hào)模擬下變頻到10MHz至100MHz的中頻段，然后在中頻實(shí)現(xiàn)采樣數(shù)字化，由于中頻采樣后信號(hào)對(duì)DSP的處理速度要求依然很高，比如，如果取樣速率在30～50MHz，則至少需要5000MIPS（million instructions per second）的DSP才能滿足實(shí)時(shí)處理要求。而目前單個(gè)DSP器件很難滿足采樣信號(hào)直接處理的實(shí)時(shí)性要求，所以，必須在中頻段進(jìn)行數(shù)字下變頻處理，降低數(shù)據(jù)的速率，同時(shí)要確保輸出的數(shù)據(jù)不混疊，這樣才能夠在基帶處理部分恢復(fù)原始信號(hào)。采用AD公司的四通道接收信號(hào)處理芯片AD6634能夠很好的實(shí)現(xiàn)這一功能。

圖1

2 AD6634的功能特點(diǎn)

AD6634能同時(shí)處理四個(gè)不同的輸入信號(hào)，其基本功能是對(duì)輸入采樣數(shù)據(jù)進(jìn)行正交混頻，以將采樣信號(hào)從中頻變到基帶；之后再對(duì)混 頻后的信號(hào)進(jìn)行抽取以降低數(shù)據(jù)速率，從而方便DSP的處理；其內(nèi)置濾波器濾除帶外信號(hào)，并提取所需要的信號(hào)等。AD6634的基本結(jié)構(gòu)原理如圖1所示。其基本功能特點(diǎn)如下:

·帶有80Msps寬帶雙輸入端口（14位線性部分，3位指數(shù)部分），能同時(shí)處理兩個(gè)WCDMA通道或者4個(gè)GSM/EDGE，IS136通道。輸入數(shù)據(jù)格式靈活，并可由內(nèi)部寄存器字控制。

·四路獨(dú)立的數(shù)字接收通道，可同時(shí)處理四路不同的輸入信號(hào)，也可四個(gè)通道同時(shí)時(shí)同一輸入寬帶信號(hào)，每一通道都可配置處理來(lái)自任一端口的數(shù)據(jù)，這樣就可以根據(jù)輸入信號(hào)的不同來(lái)靈活設(shè)計(jì)。

·具有雙16位并行輸出端口，可提高數(shù)據(jù)輸出速率。

·有32位復(fù)數(shù)可調(diào)NCO，可保證足夠的混頻信號(hào)精度。

·rCIC2是二階積分梳狀濾波器，內(nèi)插因子最大可達(dá)512，抽取因子最大為4096，數(shù)據(jù)變化率為兩者之比；5階CIC濾波（CIC5）的抽取因子從2～32；可編程RAM系數(shù)濾波（RCF）抽取因子從1～256。因而可滿足對(duì)輸入信號(hào)的抽取，降低數(shù)據(jù)速率的要求。

·可選擇96dB范圍的可編程數(shù)字AGC回路，并可直接和RAKE接收機(jī)接口。

·JTAG邊界掃描測(cè)試，符合IEEE標(biāo)準(zhǔn)1149.1規(guī)范。

·采用3.3V I/O和2.5V CMOS內(nèi)核雙電壓供電，優(yōu)點(diǎn)明顯，因?yàn)?.3V的I/O提高了驅(qū)動(dòng)能力，且易于和外圍芯片進(jìn)行接口，而2.5V內(nèi)核則大大降低了芯片功耗。

3 中頻軟件無(wú)線電的硬件電路

利用AD6634來(lái)設(shè)計(jì)通用可編程中頻軟件無(wú)線接收系統(tǒng)的基本思路是：首先將抗混疊濾波后的信號(hào)輸入AD進(jìn)行采樣轉(zhuǎn)換，并將AD輸出信號(hào)作為AD6634的輸入信號(hào)，然后通過(guò)兩個(gè)數(shù)字混頻器來(lái)和數(shù)控蕩器產(chǎn)生的正弦、余弦信號(hào)相乘，再由抽取濾波器抽取以輸出數(shù)據(jù)速率降低的數(shù)字基帶信號(hào)，最后經(jīng)FIFO緩沖后，送入DSP進(jìn)行基帶處理?；谧詈蠼?jīng)FIFO緩沖后，送入DSP進(jìn)行基帶處理?；贏D6634的中頻軟件無(wú)線電（SDR）的結(jié)構(gòu)原理如圖2所示。由圖2可以看出，系統(tǒng)中的主要IC除了AD6634外，還有AD轉(zhuǎn)換、FIFO、DSP、FPGA等。

A/D轉(zhuǎn)換器選用AD公司的AD9238，該芯片具有12位采樣精度，最大采樣速率為65MHz，信噪比（SNR）為70dB，無(wú)雜散動(dòng)態(tài)范圍為85dB。ASD9238為兩路輸入、兩路輸出定點(diǎn)模數(shù)轉(zhuǎn)換器件，具有偏移二進(jìn)制和二進(jìn)制補(bǔ)碼兩種數(shù)據(jù)輸出格式，可以和AD6634直接接口。

由于AD6634的兩路獨(dú)立輸出不方便與DSP（TMS320C6711）進(jìn)行直接連接，另外，如果直接用DSP的EMIF接口來(lái)直接接收也會(huì)增加DSP的負(fù)擔(dān)且不可靠，而如果EMIF不能及時(shí)接收，端口上的數(shù)據(jù)就會(huì)被新的數(shù)據(jù)所代替，從而造成數(shù)據(jù)的漏讀。為了避免數(shù)據(jù)丟失，必須在AD6634和DSP之間加上緩存。設(shè)計(jì)時(shí)可以用RAM、雙口RAM或FIFO。RAM或雙口RAM實(shí)時(shí)性好、地址控制簡(jiǎn)單，但需要雙路地址總線，且芯片面積大，性價(jià)比較低。而FIFO可以采用不同的寫入和讀出速率，地址控制較為簡(jiǎn)單，很容易與AD6634和DSP接口相連接，且芯片面積小，節(jié)省了PCB面積，性價(jià)比較高。因此，本設(shè)計(jì)選用了TI公司的選通式先入先出FIFO SN74ACT7804。這是512×18位的高速FIFO器件，在LDCK的上升沿寫入數(shù)據(jù)，在UNCK上升沿讀出數(shù)據(jù)，F(xiàn)IFO的各種狀態(tài)位（FULL，HF等）很容易作為數(shù)據(jù)讀寫的控制位，方便了接口的設(shè)計(jì)。

圖2

    設(shè)計(jì)時(shí)可選用Altera公司的FPGA芯片EPF10K10ATC100-3來(lái)完成AD6634的初始化以及系統(tǒng)時(shí)鐘的產(chǎn)生和控制等。EPF10K10ATC100-3有576個(gè)邏輯單元，6144個(gè)RAM bit，完全滿足系統(tǒng)的需要。DSP則可選擇TI公司的浮點(diǎn)DSP芯片TMS320C6711-150。TMS320C6711的主頻高達(dá)150MHz，芯片的外部存儲(chǔ)器接口EMIF支持各種同步和異步存儲(chǔ)器，同時(shí)也支持FIFO。

4 AD6634的主要參數(shù)設(shè)置

AD6634的參數(shù)設(shè)置是整個(gè)系統(tǒng)性能的保證。主要包括：數(shù)控振蕩器頻率轉(zhuǎn)換、輸入使能控制、總的抽取因子及在各個(gè)階段的分配以及輸出格式的選擇等。

4．1 輸入使能控制

利用輸入使能控制（IENn）信號(hào)和時(shí)鐘沿可對(duì)AD6634中每一個(gè)濾波通道的工作模式進(jìn)行配置。AD6634的四種工作模式如下：

在模式0（Blank on IEN Low）時(shí)，若IEN為高，則新的數(shù)據(jù)在輸入時(shí)鐘的每一個(gè)上升沿被選通，而當(dāng)IEN為低時(shí)，輸入的數(shù)據(jù)用0來(lái)代替。當(dāng)IEN為高時(shí)，后端處理（rCIC2,CIC5,RCF）繼續(xù)進(jìn)行。

在模式1（Clock on IEN High）時(shí)，若IEN為高，數(shù)據(jù)將被鎖存，同時(shí)在IEN為高期間，新的數(shù)據(jù)在輸入時(shí)鐘的上升沿被選通；而當(dāng)IEN是低時(shí)，輸入數(shù)據(jù)不再被鎖存。此時(shí)NCO停止，但后端處理仍在繼續(xù)。

在模式2（Clock on IEN Transition to High）時(shí)，數(shù)據(jù)僅在IEN上升轉(zhuǎn)換后的第一個(gè)時(shí)鐘的上升沿被鎖存。雖然數(shù)據(jù)僅在第一個(gè)有效時(shí)鐘被鎖存，但后端處理仍在繼續(xù)。

模式3(Clock on IEN Transition to Low)和模式2近似，只是在IEN下降轉(zhuǎn)換時(shí)鎖存數(shù)據(jù)。不同的使能模式對(duì)應(yīng)不同的應(yīng)用。模式0適用于時(shí)分多路復(fù)用。模式2適用于輸入時(shí)鐘跑龍?zhí)子跀?shù)據(jù)輸入速率時(shí)的應(yīng)用，因?yàn)榇藭r(shí)有更多的濾波時(shí)隙（taps）被用于濾波計(jì)算。當(dāng)兩個(gè)AD與AD6634的一個(gè)輸入端口相連，或者可輸出交叉數(shù)據(jù)的單個(gè)AD（如AD9238）和AD6634的一個(gè)輸入端口相連時(shí)，為了節(jié)省輸入端口，以使AD6634可以同時(shí)處理四個(gè)不同的輸入信號(hào)，以使AD6634可以同時(shí)處理四個(gè)不同的輸入信號(hào)，可以使用模式2和3，即讓AD6634的一個(gè)通道工作在模式2，另一個(gè)通道工作在模式3，這樣，從一個(gè)通道輸入的交叉數(shù)據(jù)流就可以被分開(kāi)，從一個(gè)通道輸入的交叉數(shù)據(jù)流就可以被分開(kāi)，從而實(shí)現(xiàn)同時(shí)處理四個(gè)不同輸入信號(hào)的目的。

4.2 振蕩器頻率設(shè)置

AD6634的每一個(gè)通道都有兩個(gè)獨(dú)立的乘法器和一個(gè)32位的復(fù)數(shù)NCO。NCO能產(chǎn)生分辨率為fclk/2 32，范圍為-fclk/2～fclk/2的振蕩頻率。振蕩器的頻率可以按下式計(jì)算：NCOFREO=2 32MOD（fchange/fclk）

其中，NCOFREQ是32位整數(shù)，fchange是期望的通道頻率，fclk是AD6634的主時(shí)鐘頻率或者輸入的數(shù)據(jù)速率。

4.3 抽取率設(shè)置

總的抽取因子首先必須滿足抽取后系統(tǒng)頻帶不混疊，如果通道的帶寬是B，取樣率為fs，抽取因子為D，則最大的抽以率為D≤fs/(2B)，這樣抽取后才不會(huì)發(fā)生混疊；其次要考慮DSP的處理能力。DSP的處理能力決定了AD6634每秒輸出的數(shù)據(jù)量。輸出數(shù)據(jù)量和輸入數(shù)據(jù)量的比率就是AD6634的最小抽取率?？偟某槿∫蜃拥拇笮”仨氃谶@兩者之間?？偝槿∫蜃涌稍诟鱾€(gè)階段進(jìn)行分配。rCIC2和CIC5階段的抽取率是根據(jù)每個(gè)階段對(duì)混疊抑制的不同要求，通過(guò)查表計(jì)算得到的。比如rCIC2階段輸入的是取率為10MHz，帶寬為±7kHz的帶通信號(hào)，若要求此階段有100dB的混疊抑制，則首先應(yīng)計(jì)算出通帶相對(duì)與取樣率的百分比：

100×（7kHz/10MHz）=0.07

然后在表中100dB對(duì)應(yīng)的列中找到大于等于0.07的數(shù)值，這樣，其對(duì)應(yīng)行中的抽取值（抽取和內(nèi)插的比率）即為滿足要求的抽取率。越大的數(shù)值對(duì)應(yīng)的抽取越小。由于在第一個(gè)階段加大抽取率可以降低功耗，所以rCIC2階段的抽取率應(yīng)盡可能的大。

RAM系數(shù)濾波器是系數(shù)可編程的抽取濾波器，是較為靈活的部分。抗混疊濾波和匹配濾波的階數(shù)和系數(shù)可根據(jù)系統(tǒng)的具體需要和可用時(shí)鐘數(shù)來(lái)定。

4．4 輸出格式選擇

AD6634的每個(gè)通道有兩種工作模式：通道模式和AGC模式。其中AGC模式支持與RAKE接收機(jī)的直接接口。而在通道模式中，來(lái)自通道的I和Q數(shù)據(jù)則繞過(guò)AGC而直接從并行端口輸出。通道模式可提供兩種數(shù)據(jù)格式，每一種格式要用不同的并行端口時(shí)鐘（PCLK）周期來(lái)完成數(shù)據(jù)的傳輸。在16位交叉數(shù)據(jù)格式中，可用一個(gè)PCLK周期完成I通道數(shù)據(jù)傳送，下一個(gè)PCLK周期完成Q通道數(shù)據(jù)傳送，I和Q通道數(shù)據(jù)都是16位的；在8位并行格式中，可用一個(gè)PCLK周期同時(shí)完成I和Q通道的數(shù)據(jù)傳輸，此時(shí)的I和Q通道的數(shù)據(jù)都是8位的。具體采用哪一種格式應(yīng)考慮數(shù)據(jù)的精度和數(shù)據(jù)傳輸?shù)乃俣取?/P>

5 小結(jié)

詳細(xì)介紹了可編程數(shù)字下變頻器AD6634的結(jié)構(gòu)和特點(diǎn)，提出一種基于AD6634的通用中頻軟件無(wú)線接收系統(tǒng)的設(shè)計(jì)方案，給出了AD6634的外圍器件選擇方向，討論了AD6634主要參數(shù)的設(shè)置方法。文中介紹的軟件無(wú)線電接收系統(tǒng)充分體現(xiàn)了軟件無(wú)線電的可編程性和可重構(gòu)性，具有重要的實(shí)用價(jià)值。