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[導(dǎo)讀]摘要:隨著通信行業(yè)以及數(shù)字技術(shù)的不斷發(fā)展,市場(chǎng)上經(jīng)常需要多模通信信號(hào)或多制式數(shù)字調(diào)制信號(hào)發(fā)生器,本文介紹了采用軟件無(wú)線電思想,基于“DDR2+FPGA+DAC+DDS+寬帶調(diào)

摘要:隨著通信行業(yè)以及數(shù)字技術(shù)的不斷發(fā)展,市場(chǎng)上經(jīng)常需要多模通信信號(hào)或多制式數(shù)字調(diào)制信號(hào)發(fā)生器,本文介紹了采用軟件無(wú)線電思想,基于“DDR2+FPGA+DAC+DDS+寬帶調(diào)制器”的硬件結(jié)構(gòu)的信號(hào)發(fā)生裝置,實(shí)現(xiàn)了TD-SCDMA、WCDMA、TD-LTE、FDD-LTE等多模信號(hào)以及BPSK、QPSK、OQPSK、DQPSK、8PSK、16QAM、32QAM、64QAM、2FSK、4FSK、GMSK等數(shù)字調(diào)制信號(hào)的發(fā)生,能很好滿足現(xiàn)代信號(hào)模擬的實(shí)際需求。

1 引言

本設(shè)計(jì)針對(duì)市場(chǎng)的實(shí)際需求以及多模通信信號(hào)和多制式數(shù)字調(diào)制信號(hào)的特點(diǎn),設(shè)計(jì)了以FPGA為主,“DDR2+FPGA+DAC+DDS+寬帶調(diào)制器”為硬件架構(gòu)的多模多制式通信矢量信號(hào)發(fā)生裝置,利用FPGA可編程的特點(diǎn),在盡量簡(jiǎn)化硬件設(shè)計(jì)的情況下,可以發(fā)射TD-SCDMA、WCDMA、TD-LTE、FDD-LTE等多模信號(hào),發(fā)射BPSK、QPSK、OQPSK、DQPSK、8PSK、16QAM、32QAM、64QAM、2FSK、4FSK、GMSK等多調(diào)制格式數(shù)字調(diào)制信號(hào),并可以將用戶數(shù)據(jù)灌入DDR2,根據(jù)用戶實(shí)際需要發(fā)出,實(shí)現(xiàn)復(fù)雜信號(hào)模擬的功能。

2 設(shè)計(jì)目的

(1)多模通信信號(hào):GSM/TD-SCDMA/WCDMA/TD-LTE/FDD-LTE等通信制式非信令信號(hào)。

(2)多制式調(diào)制信號(hào):

● 調(diào)制格式:BPSK、QPSK、OQPSK、DQPSK、8PSK、16QAM、32QAM、64QAM、2FSK、4FSK、GMSK;

● 碼元速率:2ksps~40Msps;

● 濾波類型RC、RRC、GAUSS;

● α因子/bt:0.2~1。

(3)用戶數(shù)據(jù)發(fā)射。

(4)將上述信號(hào)調(diào)制到相應(yīng)的載波上。

3 硬件設(shè)計(jì)實(shí)現(xiàn)

隨著FPGA器件的快速發(fā)展,其高速大容量可編程的特點(diǎn)使其得到廣泛應(yīng)用,對(duì)多模多制式的設(shè)計(jì)需求需要選用FPGA進(jìn)行設(shè)計(jì),它主要完成數(shù)字信號(hào)處理工作。另外,由于TD-LTE、FDD-LTE的高數(shù)據(jù)量高速的要求,需要DDR2作為多模信號(hào)或用戶數(shù)據(jù)的存儲(chǔ)介質(zhì)。在基帶信號(hào)發(fā)生后,還需要將其DAC轉(zhuǎn)換后用寬帶正交調(diào)制器調(diào)制到各自載波上發(fā)射。另外,多模多制式信號(hào)的發(fā)生需要不同碼元速率的設(shè)計(jì),需要選用DDS分頻出高分辨率可變時(shí)鐘。所以該設(shè)計(jì)選用“DDR2+FPGA+DAC+DDS+寬帶調(diào)制器”硬件架構(gòu),其框圖如圖1。

 

 

圖1 硬件框圖

4 FPGA設(shè)計(jì)實(shí)現(xiàn)

該設(shè)計(jì)的重點(diǎn)是對(duì)多模多制式調(diào)制信號(hào)進(jìn)行數(shù)字信號(hào)處理,由FPGA完成,包括多模信號(hào)或用戶數(shù)據(jù)的插值、FIR成型濾波、CIC插值等處理;以及多制式信號(hào)的偽隨機(jī)信號(hào)產(chǎn)生、映射、插值、FIR成型濾波、頻偏系數(shù)生成、DDS及CIC插值等處理。FPGA處理流程見圖2。

 

 

圖2 FPGA處理流程

 

 

圖3 PN9序列示意圖

PN碼產(chǎn)生單元主要在時(shí)鐘的作用下可以不斷地產(chǎn)生原始的二進(jìn)制偽隨機(jī)序列,然后將產(chǎn)生的偽隨機(jī)序列進(jìn)行編碼及映射,以QPSK為例,每?jī)蓚€(gè)二進(jìn)制編碼構(gòu)成一個(gè)碼元,即為{(00),(01),(10),(11)}四種狀態(tài),再映射為星座圖上的相位點(diǎn),如IQ兩路幅度分別用9位補(bǔ)碼表示,則為hex{(1ff1ff),(1ff0ff),(0ff1ff),(0ff0ff)},用IQ的幅值來(lái)表示信號(hào)的矢量位置。QPSK星座圖見圖4。

 

 

圖4 QPSK星座圖

由于映射產(chǎn)生的是矩形脈沖信號(hào),信號(hào)幅度的突變也會(huì)使其占用的頻帶很寬,不利于傳輸,造成符號(hào)間干擾,導(dǎo)致接收機(jī)在檢測(cè)一個(gè)符號(hào)時(shí)發(fā)生錯(cuò)誤的概率增大,需要設(shè)計(jì)脈沖成形濾波器,而各種濾波器可以通過(guò)有限脈沖響應(yīng)數(shù)字FIR濾波器來(lái)實(shí)現(xiàn),因?yàn)镕IR濾波器有兩大優(yōu)點(diǎn):

(1)單位脈沖響應(yīng)h(n)有限長(zhǎng),長(zhǎng)度為N的h(n)系統(tǒng)函數(shù)

,H(z)在z平面有(N-1)個(gè)零點(diǎn),原點(diǎn)z=0是(N-1)階重極點(diǎn)而無(wú)其它極點(diǎn),因而是穩(wěn)定的;

 

(2)在滿足一定條件下(單位脈沖響應(yīng)奇對(duì)稱或偶對(duì)稱),保證嚴(yán)格的線性相位。

它的基本算法是一種乘法-累加運(yùn)算,即不斷地輸入樣本x(n),經(jīng)過(guò)z-1延時(shí)后,再進(jìn)行乘法-累加,最后輸出濾波結(jié)果y(n)。其實(shí)現(xiàn)流程和輸出表達(dá)式如下所示。

 

 

式中,ai為濾波因子;x(n)表示濾波器在n時(shí)刻的輸入;y(n)為n時(shí)刻的輸出。[!--empirenews.page--]

由圖6可知FIR濾波器主要由一些延時(shí)器、乘法器和加法器等組成,其頻響的調(diào)整由濾波因子來(lái)控制。濾波因子可以通過(guò)對(duì)濾波器頻響采樣后經(jīng)過(guò)反傅立葉變換來(lái)得到,濾波因子的物理意義是濾波器頻響在時(shí)域上的反映,在該設(shè)計(jì)中可以利用MATLAB進(jìn)行仿真,得到各種濾波類型(RC、RRC、GAUSS)、不同滾降系數(shù)(0.20-1.00)的濾波因子。濾波因子可以根據(jù)用戶需求和通信制式選用。

 

 

圖5 FIR濾波器流程圖

 

 

圖6 CIC插值濾波器流程圖

 

 

圖7 信號(hào)測(cè)試

在該設(shè)計(jì)中,基帶信號(hào)的碼元速率變化范圍很大,如果將成形后的數(shù)據(jù)直接輸出給D/A轉(zhuǎn)換器,輸出信號(hào)必然帶有D/A工作時(shí)鐘信號(hào),而我們?cè)O(shè)計(jì)的基帶帶寬大,要濾除時(shí)鐘但不影響信號(hào),模擬低通濾波器將很難設(shè)計(jì),所以我們?cè)鎏砹薈IC插補(bǔ)濾波模塊來(lái)提高DAC的采樣時(shí)鐘,CIC濾波器可以用來(lái)實(shí)現(xiàn)抽取器和內(nèi)插器,它具有結(jié)構(gòu)簡(jiǎn)單、規(guī)整以及需要的存儲(chǔ)量小的優(yōu)點(diǎn)。由于它不需要乘法器,加之濾波器的所有系數(shù)均為1,而且利用積分環(huán)節(jié)減少了中間過(guò)程的存儲(chǔ)量,因此常常用在高速采樣和插值比很大的場(chǎng)合。CIC插值濾波器實(shí)現(xiàn)流程如下。

通過(guò)調(diào)節(jié)CIC插補(bǔ)濾波的插補(bǔ)比例,使D/A轉(zhuǎn)換器的時(shí)鐘在小范圍內(nèi)變化,并且最小時(shí)鐘信號(hào)也高于基帶信號(hào),這樣D/A后模擬低通濾波器將很容易設(shè)計(jì)。例如,本設(shè)計(jì)要求碼元速率達(dá)到2ksps~40Msps,此時(shí)基帶信號(hào)1kHz~20MHz,這就要求DAC后低通濾波截止頻率大于20MHz,DAC采樣時(shí)鐘理論上應(yīng)該大于20MHz,考慮工程實(shí)現(xiàn)應(yīng)大于40MHz,下表給出了該設(shè)計(jì)針對(duì)碼元速率變化所做的不同數(shù)據(jù)處理,通過(guò)改變CIC的插值率、每碼元點(diǎn)數(shù)、可以實(shí)現(xiàn)設(shè)計(jì)目的。

FPGA輸出數(shù)據(jù)經(jīng)過(guò)DAC轉(zhuǎn)換,低通濾波后由寬帶正交調(diào)制器調(diào)制到相應(yīng)的載波上發(fā)射。

在頻移鍵控2FSK、4FSK、MSK等調(diào)制格式時(shí),需要設(shè)計(jì)不同的頻偏來(lái)表示信息。在數(shù)字電路設(shè)計(jì)中,可以利用乘法器實(shí)現(xiàn)不同的頻偏。將FIR得到的數(shù)據(jù)乘以一個(gè)頻偏因子k來(lái)控制頻移鍵控的頻偏,由

可得

式(1)中map為隨機(jī)序列的映射值,ai為FIR的各濾波因子,Δf為頻移鍵控的頻偏,f為查正余弦表的時(shí)鐘,n為查表之前丟棄的數(shù)據(jù)位數(shù)(主要包括FIR和乘法器丟失),2即為正余弦表滿量。由式(1)可得

為正余弦表的有效位數(shù)。在設(shè)定頻偏Δf的情況下可以求出對(duì)應(yīng)的k值。

 

5 多模通信信號(hào)及用戶數(shù)據(jù)設(shè)置

多模通信信號(hào)主要處理流程和多制式信號(hào)類似,關(guān)鍵是將數(shù)據(jù)源切換到前面仿真好后存入DDR2的數(shù)據(jù),并按照各通信標(biāo)準(zhǔn)分別設(shè)置碼元速率、濾波類型和濾波因子等參數(shù)。具體設(shè)置參照表1。

 

 

6 測(cè)試結(jié)果

經(jīng)過(guò)實(shí)際驗(yàn)證,該方案很好地實(shí)現(xiàn)設(shè)計(jì)目的,硬件結(jié)構(gòu)簡(jiǎn)單,成本低,靈活性好,指標(biāo)高,已經(jīng)應(yīng)用在通信矢量信號(hào)發(fā)生器的設(shè)計(jì)中,相關(guān)產(chǎn)品已經(jīng)推向市場(chǎng),得到用戶認(rèn)可。

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