Cadence發(fā)布DSP內(nèi)核新產(chǎn)品，“最適合神經(jīng)網(wǎng)絡(luò)”

美國鏗騰電子科技有限公司(Cadence Design Systems)發(fā)布了用于計算機視覺及圖像處理的DSP內(nèi)核新產(chǎn)品“Tensilica Vision P6 DSP”。與現(xiàn)有產(chǎn)品“Tensilica Vision P5 DSP”相比，性能最多可提高4倍。

新產(chǎn)品 Vision P6 DSP的每周期處理的數(shù)據(jù)量增至9728bit，而現(xiàn)有的Vision P5 DSP為7168bit。而且，積和運算器的數(shù)量由64增至256，達到原來的4倍。還可通過選配方式實現(xiàn)對IEEE754標準半精度浮點運算(FP16)的支持。另外，P6與P5一樣，可以通過選配方式實現(xiàn)對單精度32bit浮點運算的支持。

據(jù)介紹，新產(chǎn)品還擴展了指令集，成為了最適合卷積神經(jīng)網(wǎng)絡(luò)用途的DSP內(nèi)核。而且，與其他GPU內(nèi)核相比，能以非常低的功耗實現(xiàn)兩倍的幀率。另外，還具備On The Fly數(shù)據(jù)壓縮功能，可在要求高性能的神經(jīng)網(wǎng)絡(luò)的全連通(Fully Connected)層中大幅減少所需要的內(nèi)存占用空間和帶寬。

Tensilica Vision P6 DSP將從2016年6月底開始向優(yōu)先客戶銷售。