摘要:對雙網(wǎng)數(shù)字傳真機硬件系統(tǒng)中的編碼和譯碼電路進行設(shè)計,并采用FPGA芯片進行系統(tǒng)實現(xiàn)和驗證。其中的編譯碼電路分別采用兩級編碼和快速譯碼的思路,利用硬件描述語言設(shè)計和仿真,簡化了邏輯電路的實現(xiàn)。驗證測試
雙網(wǎng)傳真機的編譯碼電路設(shè)計與實現(xiàn)
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