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一種密鑰可配置的DES加密算法的FPGA
摘 要： 在傳統(tǒng)的DES加密算法的基礎(chǔ)上，提出一種對密鑰實行動態(tài)管理的硬件設(shè)計方案，給出了其FPGA實現(xiàn)方法。通過對DES加密原理的分析，利用其子密鑰的生成與核心算法相關(guān)性
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利用匯編語言實現(xiàn)DES加密算法
利用匯編語言實現(xiàn)DES加密算法
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一種密鑰可配置的DES加密算法的FPGA
一種密鑰可配置的DES加密算法的FPGA
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3DES加密算法及其FPGA設(shè)計
摘要： 介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計實現(xiàn)。采用了狀態(tài)機(jī)和流水線技術(shù)，使得在面積和速度上達(dá)到最佳優(yōu)化；添加了輸入和輸出接口的設(shè)計以增強(qiáng)該算法應(yīng)用的靈活性。各模塊均用硬件描述語言實現(xiàn)
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基于ARM的3DES加密算法實現(xiàn)
基于ARM的3DES加密算法實現(xiàn)
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基于ARM的3DES加密算法實現(xiàn)
基于ARM的3DES加密算法實現(xiàn)
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基于FPGA的DES加密算法的高性能實現(xiàn)
在分析DES算法原理的基礎(chǔ)上，詳細(xì)闡述一種基于VHDL描述、FPGA實現(xiàn)的DES加密算法系統(tǒng)的設(shè)計和仿真結(jié)果。該系統(tǒng)采用了一種基于子密鑰預(yù)先計算的新型流水線設(shè)計方案，克服了傳統(tǒng)DES流水線實現(xiàn)方式的缺點，使系統(tǒng)的密鑰可動態(tài)刷新．并在硬件資源消耗有所降低的情況下，進(jìn)一步提高系統(tǒng)的處理速度，系統(tǒng)最高時鐘頻率為222．77 MHz．信息加密的速度為14．26 Gb／s，是最快軟件實現(xiàn)方式的112倍。同時系統(tǒng)還具有設(shè)計靈活，可靠性高，可重用性強(qiáng)．升級方便等特點。
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