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TI與MIT提出0.6V DSP設(shè)計
TI與MIT提出0.6V DSP設(shè)計
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ARM和DSP設(shè)計的地震加速度信號處理系統(tǒng)
摘 要：為滿足光纖傳感地震加速度計對實時性、高精度以及網(wǎng)絡(luò)化的要求，提出了基于ARM 和DSP雙核微處理器的嵌入式系統(tǒng)設(shè)計方案．對3x3耦合器輸出的相位已調(diào)加速度信號進行解調(diào)、頻譜分析，并提供了以太網(wǎng)傳輸控制接口
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ARM和DSP設(shè)計的地震加速度信號處理系統(tǒng)
ARM和DSP設(shè)計的地震加速度信號處理系統(tǒng)
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ARM和DSP設(shè)計的竹節(jié)紗控制系統(tǒng)伺服控制器方案
摘要：根據(jù)紡織行業(yè)中竹節(jié)紗生產(chǎn)的工藝要求，設(shè)計了基于ARM和DSP的雙CPU永磁同步電動機伺服控制器。利用ARM和觸摸液晶屏完成工藝參數(shù)的輸入與生產(chǎn)過程信息的顯示，支持圖形化人機界面和觸摸操作；利用DSP完成永磁同步
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ARM和DSP設(shè)計的竹節(jié)紗控制系統(tǒng)伺服控制器方案
ARM和DSP設(shè)計的竹節(jié)紗控制系統(tǒng)伺服控制器方案
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2010年兩岸TI教育者交流會在臺灣大學(xué)隆重舉行
2010 年 11 月 17 日， 第三屆大陸-臺灣兩岸高校TI DSP 設(shè)計邀請賽暨2010年兩岸TI教育者交流會，于11月1日至3日在臺灣大學(xué)隆重舉行。作為DSP技術(shù)全球領(lǐng)先的半導(dǎo)體公司，TI（德州儀器）DSP大學(xué)生設(shè)計大賽一直受到高校
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音頻信號采集與AGC算法的DSP設(shè)計方案
過去，對大音頻信號采用限幅方式，即對大信號進行限幅輸出，小信號不予處理。這樣，仍然存在音頻信號過小時，用戶自行調(diào)節(jié)音量，也會影響用戶的收聽效果。隨著電子技術(shù)，計算機技術(shù)和通信技術(shù)的迅猛發(fā)展，數(shù)字信號處
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音頻信號采集與AGC算法的DSP設(shè)計方案
過去，對大音頻信號采用限幅方式，即對大信號進行限幅輸出，小信號不予處理。這樣，仍然存在音頻信號過小時，用戶自行調(diào)節(jié)音量，也會影響用戶的收聽效果。隨著電子技術(shù)，計算機技術(shù)和通信技術(shù)的迅猛發(fā)展，數(shù)字信號處
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基于通道控制的雙余度DSP設(shè)計與實現(xiàn)
引言 具有自動控制功能的電子設(shè)備已廣泛應(yīng)用于我國多型機上，用于飛機上各機載設(shè)備的控制、調(diào)節(jié)等功能。如圖1所示，其控制系統(tǒng)主要由傳感器信號輸入、核心控制板及經(jīng)過處理驅(qū)動后的控制信號輸出，最后輸出到機上
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新的變步長LMS算法及DSP設(shè)計
Widrow和Hoff等人于1960年提出最小均方誤差(LMS)算法，由于其結(jié)構(gòu)簡單，計算量小，穩(wěn)定性好，易于實現(xiàn)等優(yōu)點而得到廣泛的應(yīng)用。LMS算法的缺點是收斂速度慢，它克服不了收斂速度和穩(wěn)態(tài)誤差這一對固有矛盾：在收斂的前
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新的變步長LMS算法及DSP設(shè)計
新的變步長LMS算法及DSP設(shè)計
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Radvision選擇飛思卡爾DSP設(shè)計高清多方視頻會議服務(wù)器
飛思卡爾半導(dǎo)體的高性能MSC8144多核數(shù)字信號處理器（DSP）已被Radvision選定，用在其最新的高清SCOPIAElite5000統(tǒng)一通信視頻基礎(chǔ)設(shè)施多方會議單元中。Radvision是業(yè)內(nèi)領(lǐng)先的基于IP和3G網(wǎng)絡(luò)的統(tǒng)一視頻通信產(chǎn)品的提供商
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基于通道控制的雙余度DSP設(shè)計與實現(xiàn)
引言 具有自動控制功能的電子設(shè)備已廣泛應(yīng)用于我國多型機上，用于飛機上各機載設(shè)備的控制、調(diào)節(jié)等功能。如圖1所示，其控制系統(tǒng)主要由傳感器信號輸入、核心控制板及經(jīng)過處理驅(qū)動后的控制信號輸出，最后輸出到機上
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基于通道控制的雙余度DSP設(shè)計與實現(xiàn)
基于通道控制的雙余度DSP設(shè)計與實現(xiàn)
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用FPGA動態(tài)探頭與數(shù)字VSA對DSP設(shè)計實時分析
隨著 FPGA 在數(shù)字通信設(shè)計領(lǐng)域（蜂窩基站、衛(wèi)星通信和雷達）的高性能信號處理電路中成為可行的選擇,分析和調(diào)試工具必須包括能幫助您在最短時間內(nèi)得到電路最佳性能的新技術(shù)。 雖然現(xiàn)在已經(jīng)有多種連接仿真與射頻
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用FPGA動態(tài)探頭與數(shù)字VSA對DSP設(shè)計實時分析
用FPGA動態(tài)探頭與數(shù)字VSA對DSP設(shè)計實時分析
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FPGA 設(shè)計工具視點
系統(tǒng)設(shè)計的理念需要集成不同領(lǐng)域的技術(shù)知識，在FPGA中更好地利用資源。隨著應(yīng)用對DSP功能的依賴程度越來越高，我們可讓處理器充分利用加速器的作用，從而大幅提高性能。
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FPGA 設(shè)計工具視點
系統(tǒng)設(shè)計的理念需要集成不同領(lǐng)域的技術(shù)知識，在FPGA中更好地利用資源。隨著應(yīng)用對DSP功能的依賴程度越來越高，我們可讓處理器充分利用加速器的作用，從而大幅提高性能。
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