可編程邏輯器件的基本結(jié)構(gòu)

可編程邏輯器件PLD的基本結(jié)構(gòu)如圖1所示。由圖可見(jiàn)，PLD器件由輸入控制電路、與陣列、或陣列及輸出控制電路組成。在輸人控制電路中，輸人信號(hào)經(jīng)過(guò)輸入緩沖單元產(chǎn)生每個(gè)輸入變量的原變量和反變量，并作為與陣列的輸入項(xiàng)。與陣列由若干個(gè)與門組成，輸入緩沖單元提供的各輸入項(xiàng)被有選擇地連接到各個(gè)與門輸入端，每個(gè)與門的輸出則是部分輸入變量的乘積項(xiàng)。各與門輸出又作為或陣列的輸入，這樣或陣列的輸出就是輸人變量的與或形式。輸出控制電路將或陣列輸出的與或式通過(guò)三態(tài)門、寄存器等電路，一方面產(chǎn)生輸出信號(hào)，另一方面作為反饋信號(hào)送回輸入端，以便實(shí)現(xiàn)更復(fù)雜的邏輯功能。因此，利用PLD器件可以方便地實(shí)現(xiàn)各種邏輯函數(shù)。

圖1 PLD的基本結(jié)構(gòu)

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