電路設(shè)計(jì)軟件解惑篇,protel電路設(shè)計(jì)軟件難點(diǎn)解答(下)
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電路設(shè)計(jì)軟件的作用大家都知道,如果缺少電路設(shè)計(jì)軟件,電路設(shè)計(jì)工作將難以進(jìn)行。目前市場(chǎng)上存在幾款主流電路設(shè)計(jì)軟件,其中protel電路設(shè)計(jì)軟件更為受用。為幫助大家使用這款電路設(shè)計(jì)軟件,本文將對(duì)protel相關(guān)難點(diǎn)進(jìn)行解答。如果你對(duì)本文內(nèi)容具有興趣,不妨繼續(xù)往下閱讀哦。
問:pcb里面的3d功能對(duì)硬件有何要求?
答:需要支持opengl。
問:protel的pld功能好像不支持流行的hdl語(yǔ)言?
答:protel pld使用的cupl語(yǔ)言,也是一種hdl語(yǔ)言。下一版本可以直接用vhdl語(yǔ)言輸入。
問:protel dxp的自動(dòng)布線效果是否可以達(dá)到原accel的水平?
答:有過之而無(wú)不及。
問:可不可以做不對(duì)稱焊盤?拖動(dòng)布線時(shí)相連的線保持原來(lái)的角度一起拖動(dòng)?
答:可以做不對(duì)稱焊盤。拖動(dòng)布線時(shí)相連的線不能直接保持原來(lái)的角度一起拖動(dòng)。
問:請(qǐng)問當(dāng)protel發(fā)揮到及至?xí)r,是否能達(dá)到高端eda軟件同樣的效果?
答:視設(shè)計(jì)而定。
問:protel里用的hdl是普通的vhdl?
答:protel pld不是,protel fpga是。
問:補(bǔ)淚滴后再鋪銅,有時(shí)鋪出來(lái)的網(wǎng)格會(huì)殘缺,怎么辦?
答:那是因?yàn)槟阍谘a(bǔ)淚滴時(shí)設(shè)置了熱隔離帶原因,你只需要注意安全間距與熱隔離帶方式。也可以用修補(bǔ)的辦法。
問:如何將一段圓弧進(jìn)行幾等分?
答:利用常規(guī)的幾何知識(shí),eda只是工具。
問:即將發(fā)布的新版protel會(huì)增加什么功能?價(jià)格大體是多少?
答:增加的功能達(dá)幾十項(xiàng),價(jià)格也會(huì)相應(yīng)提高。
問:在同一條導(dǎo)線上,怎樣讓它不同部分寬度不一樣,而且顯得連續(xù)美觀?
答:不能自動(dòng)完成,可以利用編輯技巧實(shí)現(xiàn)。
問:protel99se6自動(dòng)布線后,在集成塊的引腳附近會(huì)出現(xiàn)雜亂的走線,像毛刺一般,有時(shí)甚至是三角形的走線,需要進(jìn)行大量手工修正,這種問題怎么避免?
答:合理設(shè)置元件網(wǎng)格,再次優(yōu)化走線。
問:用protel畫圖,反復(fù)修改后,發(fā)現(xiàn)文件體積非常大(虛腫),導(dǎo)出后再導(dǎo)入就小了許多。為什么??有其他辦法為文件瘦身嗎?
答:其實(shí)那時(shí)因?yàn)閜rotel的鋪銅是線條組成的原因造成的,因知識(shí)產(chǎn)權(quán)問題,不能使用pads里的“灌水”功能,但它有它的好處,就是可以自動(dòng)刪除“死銅”。致與文件大,你用winzip壓縮一下就很小。不會(huì)影響你的文件發(fā)送。
問:畫原理圖時(shí),如何元件的引腳次序?
答:原理圖建庫(kù)時(shí),有強(qiáng)大的檢查功能,可以檢查序號(hào),重復(fù),缺漏等。也可以使用陣列排放的功能,一次性放置規(guī)律性的引腳。
問:如何免費(fèi)獲取以前的原理圖庫(kù)和pcb庫(kù)?
答:可從protel官網(wǎng)下載。
問:還想請(qǐng)教一下99se中橢圓型焊盤如何制作?放置連續(xù)焊盤的方法不可取,線路板廠家不樂意??煞裨谙乱话嬷屑尤脒@個(gè)設(shè)置項(xiàng)?
答:在建庫(kù)元件時(shí),可以利用非焊盤的圖素形成所要的焊盤形狀。在進(jìn)行pcb設(shè)計(jì)時(shí)使其具有相同網(wǎng)絡(luò)屬性,可向protel公司建議。
問:如何制作一個(gè)孔為2*4mm,外徑為6mm的焊盤?
答:在機(jī)械層標(biāo)注方孔尺寸,與制版商溝通具體要求。
問:請(qǐng)問,在protel中好像沒有TI公司的tms320系列,如何畫?
答:利用建庫(kù)工具,直接畫,并不復(fù)雜。
問:protel 中的pld功能如何使用?
答:在軟件的用戶手冊(cè)中有詳細(xì)的描述。
問:protel仿真可進(jìn)行原理性論證,如有詳細(xì)模型可以得到好的結(jié)果?
答:protel仿真完全兼容spice模型,可以從器件廠商處獲得免費(fèi)spice模型,進(jìn)行仿真。protel也提供建模方法,具有專業(yè)仿真知識(shí),可建立有效的模型。
問:如何編輯網(wǎng)絡(luò)表文件?
答:protel99se有專門的net編輯對(duì)話框。
問:為何鋪銅,文件哪么大?有何方法?
答:鋪銅數(shù)據(jù)量大可以理解,但如果過大,可能是您的設(shè)置不太科學(xué)。
問:有什么辦法讓原理圖的圖形符號(hào)可以縮放嗎?
答:不可以。
問:請(qǐng)問信號(hào)完整性分析的資料在什么地方購(gòu)買 ?
答:protel軟件配有詳細(xì)的信號(hào)完整性分析手冊(cè)。
問:請(qǐng)教鋪銅的原則?
答:鋪銅一般應(yīng)該在你的安全間距的2倍以上,這是layout的常規(guī)知識(shí)。
問:請(qǐng)問potel dxp在自動(dòng)布局方面有無(wú)改進(jìn)?導(dǎo)入封裝時(shí)能否根據(jù)原理圖的布局自動(dòng)排開?
答:pcb布局與原理圖布局沒有一定的內(nèi)在必然聯(lián)系,故此,potel dxp在自動(dòng)布局時(shí)不會(huì)根據(jù)原理圖的布局自動(dòng)排開。(根據(jù)子圖建立的元件類,可以幫助pcb布局依據(jù)原理圖的連接)。
問:為何通過軟件把power logic的原理圖轉(zhuǎn)化成protel后,在protel中無(wú)法進(jìn)行屬性修改,只要一修改,要么不實(shí)現(xiàn),要不就是全顯示屬性。
答:如全顯示,可以做一個(gè)全局性編輯,只顯示希望的部分。
問:請(qǐng)問在protel 99se中導(dǎo)入pads文件,為何焊盤屬性改了?
答:這多是因?yàn)閮煞N軟件和每種版本之間的差異造成,通常做一下手工體調(diào)整就可以了。
問:net名與port同名,pcb中可否連接?
答:可以,protel可以多種方式生成網(wǎng)絡(luò),當(dāng)你在在層次圖中以port-port時(shí),每張線路圖可以用相同的net名,它們不會(huì)因網(wǎng)絡(luò)名是一樣而連接.但請(qǐng)不要使用電源端口,因?yàn)槟鞘侨值摹?
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