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[導(dǎo)讀]   1 引 言   基于SOPC技術(shù)的交通事故自動(dòng)處理設(shè)備可置于每部機(jī)動(dòng)車輛中,達(dá)到自動(dòng)處理交通事故的目的,成本低,實(shí)用性、可擴(kuò)展性強(qiáng)。本設(shè)備設(shè)計(jì)目標(biāo):當(dāng)機(jī)動(dòng)車行駛途中遇到車禍,車主可首

  1 引 言

  基于SOPC技術(shù)的交通事故自動(dòng)處理設(shè)備可置于每部機(jī)動(dòng)車輛中,達(dá)到自動(dòng)處理交通事故的目的,成本低,實(shí)用性、可擴(kuò)展性強(qiáng)。本設(shè)備設(shè)計(jì)目標(biāo):當(dāng)機(jī)動(dòng)車行駛途中遇到車禍,車主可首先通過該設(shè)備通過配備的GPS進(jìn)行定位,通過設(shè)備上的GSM與交管部門取得聯(lián)系,通過設(shè)備上的攝像機(jī)記錄車禍現(xiàn)場和車牌號(hào)等相關(guān)信息,設(shè)備還可搭載基于SOPC上的無線電通訊設(shè)備實(shí)現(xiàn)與相關(guān)部門的語音通訊。

  2 硬件組成

  設(shè)計(jì)采用Altera公司的SOPC開發(fā)工具,系統(tǒng)的開發(fā)包括硬件和軟件兩大部分,使用SOPC Builder生成NIOS,NIOSⅡ嵌入式處理器。NIOS,NIOSⅡ嵌入式處理器開發(fā)工具允許用戶配置一個(gè)或多個(gè)NIOS,NIOSⅡCPU,從標(biāo)準(zhǔn)庫中添加外圍設(shè)備,綜合處理自定義系統(tǒng),與QuartusⅡ設(shè)計(jì)軟件一起編譯系統(tǒng)。硬件框圖如圖1所示。

  

 

  2.1 GPS與GSM部分

  NIOS-1同鍵盤、LED和LCD顯示器、汽車中控系統(tǒng)以及GPS系統(tǒng)等外部設(shè)備的連接比較簡單,GSM系統(tǒng)的連接較為復(fù)雜,將在軟件部分加以說明。這部分的工作流程是:來自汽車中控系統(tǒng)和GPS系統(tǒng)的信息可以顯示在LED和LCD顯示器上,也可以通過GSM系統(tǒng)進(jìn)行無線發(fā)送。用戶可以通過鍵盤對(duì)系統(tǒng)進(jìn)行控制,交管部門也可以通過GSM系統(tǒng)對(duì)汽車中控系統(tǒng)進(jìn)行遠(yuǎn)程無線控制。

  2.2 攝像頭部分

  采用SCCB控制器控制攝像頭。系統(tǒng)中使用的攝像頭型號(hào)是Omni Vision公司的OV7649CAMERACHIPS芯片及其配套的CMOS鏡頭。這是一款低電壓的CMOS圖像傳感器芯片,通過其特有的SCCB(Serial Camera ControlBus)總線的控制,可以實(shí)現(xiàn)全幀、半幀、子采樣等各種形式的圖像輸出,輸出格式可選擇配制成YUV,RGB或者原始RGB等,另外可進(jìn)行自動(dòng)曝光控制,圖像增益控制等,而所有的配置都是通過SCCB總線進(jìn)行更改。狀態(tài)機(jī)模型可簡化為6種狀態(tài):Idle空閑;Bit_Start比特開始;Bit_Mid_LOW比特傳輸中低位傳輸;Bit_Mid_HIGH比特傳輸中高位傳輸;Bit_End比特傳輸結(jié)束;Trans_End整個(gè)傳輸結(jié)束。根據(jù)具體的跳轉(zhuǎn)流程,用VHDL語言中的條件語句可以方便地完成,在此不再贅述。

  TYPE states IS(Idle,Bit_Start,Bit_Mid_LOW,Bit_Mid_HIGH,Bit_End,Trans_End);SIGNAL now-State:states;下面對(duì)其中填充幀數(shù)據(jù)的過程進(jìn)行描述:

  

 

  在仿真過程中,由于要就很長一段時(shí)間的信號(hào)進(jìn)行分析,所以限于篇幅,無法將仿真結(jié)果盡列于此。在工程實(shí)際使用中,SCCB總線控制模塊已經(jīng)被驗(yàn)證無誤,能夠正確地實(shí)現(xiàn)攝像頭的配置,并且拍出的圖片質(zhì)量也達(dá)到了預(yù)期水平。

  2.3 無線電通訊部分

  這一部分是整個(gè)系統(tǒng)中最復(fù)雜也是占用資源最多的一部分。在此重點(diǎn)闡述。該部分同樣采用SOPC技術(shù)實(shí)現(xiàn)的無線電通訊功能可以比傳統(tǒng)的無線電系統(tǒng)減少成本。并且整合了整個(gè)系統(tǒng)使其都基于FPGA開發(fā)板上。這部分的功能實(shí)現(xiàn)如下:將語音編解碼程序移植到兩個(gè)NIOSⅡ(NIOSⅡ-1,NIOSⅡ-2)軟核處理器上實(shí)現(xiàn);利用PCIIP核在FPGA中增加了32 B的PCI Slave總線接口。利用NIOSⅡ-3處理器實(shí)現(xiàn)了系統(tǒng)參數(shù)的動(dòng)態(tài)配置功能,并實(shí)現(xiàn)了原系統(tǒng)中通用控制器的控制管理功能;利用NIOSⅡ-4軟核處理器完成卷積碼編碼和維特比譯碼;在系統(tǒng)中加入了以太網(wǎng)IP核,配合外部以太網(wǎng)PHY接口芯片為電臺(tái)擴(kuò)展了以太網(wǎng)接口,并增加了SDRAM控制器,為系統(tǒng)外擴(kuò)了SDRAM存儲(chǔ)器,進(jìn)一步增強(qiáng)了電臺(tái)的數(shù)據(jù)處理能力。在用戶邏輯中設(shè)計(jì)了可變長度的匹配濾波器,完成擴(kuò)頻信號(hào)的解擴(kuò),數(shù)據(jù)的解調(diào)。

  在該部分系統(tǒng)中,NIOSⅡ-1處理器用來實(shí)現(xiàn)實(shí)時(shí)的24 k。32 k速率∑-△語音編碼器,NIOSⅡ-2處理器用來實(shí)現(xiàn)∑-△語音的實(shí)時(shí)解碼器,這兩個(gè)處理器采用NIOSⅡPF高速型32位內(nèi)核;NIOSⅡ-3處理器采用標(biāo)準(zhǔn)型內(nèi)核,用來完成系統(tǒng)參數(shù)的配置、人機(jī)交互界面、電臺(tái)管理和控制以及系統(tǒng)中FLASH配置內(nèi)容的在線更新工作;系統(tǒng)增加的10/100 M以太網(wǎng)接口支持設(shè)備通過網(wǎng)絡(luò)遠(yuǎn)程配置和管理,包括電臺(tái)使用偽碼的下發(fā)、電臺(tái)使用密鑰的下發(fā)、系統(tǒng)參數(shù)的遠(yuǎn)程更新、新功能的重新配置等,為實(shí)現(xiàn)一定區(qū)域中所有工作電臺(tái)的空中管理提供了可能。通過在FPGA中增加NIOSⅡ-4處理器,用來實(shí)現(xiàn)信道編碼和譯碼,提高系統(tǒng)的誤碼率性能,以很小的代價(jià)方便地為電臺(tái)引入數(shù)傳功能。我們?cè)谑褂?2,1,7)卷積碼配合維特比譯碼進(jìn)行仿真,使用了一個(gè)NIOSⅡPF等級(jí)的處理器配合少量用戶邏輯,完成了不低于10 kb/s速率的卷積編碼和維特比譯碼工作。

  

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