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電子設(shè)計(jì)自動(dòng)化

所屬頻道 工業(yè)控制

  • 探索升級(jí) Xilinx FPGA助力大型強(qiáng)子對(duì)撞機(jī)大規(guī)模升級(jí)

    據(jù)國(guó)外媒體報(bào)道，一年前，歐洲核子研究組織的大型強(qiáng)子對(duì)撞機(jī)發(fā)現(xiàn)了有著“上帝粒子”之稱(chēng)的希格斯玻色子。這是科學(xué)研究史上最偉大的發(fā)現(xiàn)之一?，F(xiàn)在，強(qiáng)子對(duì)撞機(jī)的電腦屏幕一片漆黑，控制臺(tái)前沒(méi)有任何人影，

  • 正弦信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)

    為精確地輸出正弦波、調(diào)幅波、調(diào)頻波、PSK、ASK等信號(hào)及保證信號(hào)的高可靠性，設(shè)計(jì)出一種新型的正弦信號(hào)發(fā)生器。該正弦信號(hào)發(fā)生器以可編程邏輯器件CPLD和單片機(jī)AT89S52為基礎(chǔ)，采用數(shù)字頻率合成DDS技術(shù)實(shí)現(xiàn)頻率合成功能，結(jié)合高速D／A器件AD9713使得輸出頻率維持在1 k～10 MHz范圍內(nèi)，步進(jìn)為100 Hz，且通過(guò)對(duì)CPLD采用相應(yīng)的數(shù)字控制算法實(shí)現(xiàn)調(diào)頻FM，調(diào)幅AM和鍵控PSK、ASK數(shù)字調(diào)制功能。測(cè)試結(jié)果表明，設(shè)計(jì)的正弦信號(hào)發(fā)生器輸出信號(hào)穩(wěn)定度優(yōu)于10-4，在頻率范圍內(nèi)50 Ω的負(fù)載上輸出正弦波電壓幅度穩(wěn)定在6±0．6 V，波形無(wú)明顯失真，系統(tǒng)的整體性能良好。

  • 基于FPGA的高斯白噪聲發(fā)生器設(shè)計(jì)

    0 引 言 現(xiàn)代通訊電子設(shè)備的抗干擾測(cè)試已經(jīng)成為必須的測(cè)試項(xiàng)目，主要的干擾類(lèi)型為噪聲干擾。在通信信道測(cè)試和電子對(duì)抗領(lǐng)域里，噪聲始終是最基本、最常用的干擾源之一。如何產(chǎn)生穩(wěn)定和精確的噪聲信號(hào)已經(jīng)成為一

  • 利用Cadence PCB SI分析特性阻抗變化因素

    1、概要　　在進(jìn)行PCB SI的設(shè)計(jì)時(shí)，理解特性阻抗是非常重要的。這次，我們對(duì)特性阻抗進(jìn)行基礎(chǔ)說(shuō)明之外，還說(shuō)明Allegro的阻抗計(jì)算原理以及各參數(shù)和阻抗的關(guān)系。2、什么是特性阻抗？2.1　傳送線(xiàn)路的電路特性　　在高頻

  • 用單片機(jī)和CPLD實(shí)現(xiàn)步進(jìn)電機(jī)的控制

    步進(jìn)電機(jī)是一種將脈沖信號(hào)轉(zhuǎn)換成角位移的伺服執(zhí)行器件。其特點(diǎn)是結(jié)構(gòu)簡(jiǎn)單、運(yùn)行可靠、控制方便。尤其是步距值不受電壓、溫度的變化的影響、誤差不會(huì)長(zhǎng)期積累，這給實(shí)際的應(yīng)用帶來(lái)了很大的方便。它廣泛用于消費(fèi)類(lèi)產(chǎn)品

  • 資深工程師PCB設(shè)計(jì)經(jīng)驗(yàn)介紹

    作為一個(gè)電子工程師設(shè)計(jì)電路是一項(xiàng)必備的硬功夫，但是原理設(shè)計(jì)再完美，如果電路板設(shè)計(jì)不合理性能將大打折扣，嚴(yán)重時(shí)甚至不能正常工作。根據(jù)我的經(jīng)驗(yàn)，我總結(jié)出以下一些PCB設(shè)計(jì)中應(yīng)該注意的地方，希望能對(duì)您有所啟示

  • 燃?xì)鉄崴髦悄芩疁乜刂频腅DA實(shí)現(xiàn)

    摘要：針對(duì)現(xiàn)有燃?xì)鉄崴魉疁乜刂频牟蛔阒?，介紹一種智能型水溫控制器。采用大火力快速啟動(dòng)方式縮短加熱時(shí)間，溫度反饋及超前控制方式縮小溫度穩(wěn)定時(shí)間、減小超調(diào)溫度，還設(shè)有安全保護(hù)、壽命均衡及燃燒穩(wěn)定性的控

  • Protel DXP詳細(xì)教程（一）

    Protel DXP教程導(dǎo)讀其實(shí)會(huì)Protel 99se的用戶(hù)，學(xué)習(xí)Protel dxp是很容易的，現(xiàn)在我給大家講講如何輕易的過(guò)渡到Protel dxp版本來(lái)。Protel DXP是一款Windows NT/XP的全32位電子設(shè)計(jì)系統(tǒng)。Protel DXP提供一套完全集成的設(shè)

  • LabVIEW的XY圖顯示實(shí)例

    例：繪制XY圖波形．打開(kāi)位于LabVIEW安裝文件夾＼exmples＼general＼Graphs＼gengraph.llb中的XY Graph.vi程序，程序框圖如圖1所示。 圖1 XY Graph.vi程序框圖 程序利用For循環(huán)分別產(chǎn)生100個(gè)在0-2之間均勻分布的正弦

  • 淺談PCB設(shè)計(jì)中的阻抗匹配與0歐電阻

    1、阻抗匹配阻抗匹配是指信號(hào)源或者傳輸線(xiàn)跟負(fù)載之間的一種合適的搭配方式。根據(jù)接入方式阻抗匹配有串行和并行兩種方式;根據(jù)信號(hào)源頻率阻抗匹配可分為低頻和高頻兩種。(1)高頻信號(hào)一般使用串行阻抗匹配。串行電阻的阻

  • 基于FPGA的異步LVDS過(guò)采樣的研究和實(shí)現(xiàn)

    摘要：針對(duì)LVDS接口，研究并實(shí)現(xiàn)了一種基于FPGA的LVDS過(guò)采樣技術(shù)，重點(diǎn)對(duì)LVDS過(guò)采樣技術(shù)中系統(tǒng)組成、ISERDESE2、時(shí)鐘采樣、數(shù)據(jù)恢復(fù)單元、時(shí)鐘同步狀態(tài)機(jī)等關(guān)鍵技術(shù)進(jìn)行了描述，并基于Xilinx FPGA進(jìn)行了驗(yàn)證，傳輸速

  • PCB設(shè)計(jì)關(guān)于“過(guò)孔蓋油”和“過(guò)孔開(kāi)窗”區(qū)分

    關(guān)于“過(guò)孔蓋油”和“過(guò)孔開(kāi)窗”此點(diǎn)(VIA和PAD的用法區(qū)分)，許多客戶(hù)和設(shè)計(jì)工程師在系統(tǒng)上下單時(shí)經(jīng)常會(huì)問(wèn)這是什么意思，我的文件該選哪一個(gè)選項(xiàng)?現(xiàn)就此問(wèn)題點(diǎn)說(shuō)明如下：經(jīng)常碰到這樣的問(wèn)題，設(shè)計(jì)

  • 基于FPGA的UART模塊的設(shè)計(jì)

    0 引 言 在計(jì)算機(jī)的數(shù)據(jù)通信中，外設(shè)一般不能與計(jì)算機(jī)直接相連，它們之間的信息交換主要存在以下問(wèn)題： (1)速度不匹配。外設(shè)的工作速度和計(jì)算機(jī)的工作速度不一樣，而且外設(shè)之間的工作速度差異也比較大。

  • 基于FPGA的m序列信號(hào)發(fā)生器設(shè)計(jì)

    摘要：m序列是一種偽隨機(jī)序列(PN碼)，廣泛用于數(shù)據(jù)白噪化、去白噪化、數(shù)據(jù)傳輸加密、解密等通信、控制領(lǐng)域?；贔PGA與Verilog硬件描述語(yǔ)言設(shè)計(jì)井實(shí)現(xiàn)了一種數(shù)據(jù)率按步進(jìn)可調(diào)、低數(shù)據(jù)誤碼率、反饋多項(xiàng)式為的m序列信號(hào)

  • 用ARM對(duì)FPGA進(jìn)行配置的原理與方法

    0引言基于SRAM工藝FPGA在每次上電后需要進(jìn)行配置，通常情況下FPGA的配置文件由片外專(zhuān)用的EPROM來(lái)加載。這種傳統(tǒng)配置方式是在FPGA的功能相對(duì)穩(wěn)定的情況下采用的。在系統(tǒng)設(shè)計(jì)要求配置速度高、容量大、以及遠(yuǎn)程升級(jí)時(shí)，

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