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[導(dǎo)讀]新思科技(Synopsys, Inc.)今天推出了完整的DesignWare® High Bandwidth Memory 2 (HBM2) IP解決方案,其中包括控制器、PHY和驗證IP,使設(shè)計人員能獲得高達(dá)307 GB/s的總帶寬,相當(dāng)于以3200Mb/s運行的DDR4接口傳輸速率的12倍。

亮點:

· 完整的HBM2 IP解決方案,包括PHY、控制器和驗證IP,在降低整合風(fēng)險的同時最大限度地縮短產(chǎn)品上市時間。

· DesignWare IP的實施可支持高達(dá)2400 Mb/s的傳輸速率,比JEDEC標(biāo)準(zhǔn)規(guī)格快20%。

· 偽信道模式實現(xiàn)了信道數(shù)量翻倍,從而減少抓取量并提高性能。

· HBM2 IP基于新思的硅驗證HBM和DDR4 IP,已經(jīng)被整合到數(shù)百種SoC(片上系統(tǒng))設(shè)計中。

新思科技(Synopsys, Inc.)今天推出了完整的DesignWare® High Bandwidth Memory 2 (HBM2) IP解決方案,其中包括控制器、PHY和驗證IP,使設(shè)計人員能獲得高達(dá)307 GB/s的總帶寬,相當(dāng)于以3200Mb/s運行的DDR4接口傳輸速率的12倍。此外,DesignWare HBM2 IP解決方案的能源效率比DDR4的高約10倍。高級圖形、高性能計算 (HPC) 和網(wǎng)絡(luò)應(yīng)用需要更大的內(nèi)存帶寬才能追趕上因先進處理技術(shù)而不斷提高的計算性能。設(shè)計人員可以借助DesignWare HBM2 IP解決方案,以最小的功耗和低延遲實現(xiàn)內(nèi)存的吞吐量要求。新的DesignWare HBM2 IP解決方案建立在新思的硅驗證HBM和DDR4 IP基礎(chǔ)上,已經(jīng)通過了數(shù)百次設(shè)計驗證,被應(yīng)用于數(shù)百萬個 SoC,使設(shè)計人員能降低整合風(fēng)險,加快新標(biāo)準(zhǔn)的采用。

“我們選擇了新思的DesignWare HBM2 IP解決方案是為了將16GB HBM2內(nèi)存的帶寬和能源效率充分應(yīng)用于我們的Radeon™ Vega Frontier Edition顯卡中。”AMD公司副總裁兼產(chǎn)品首席技術(shù)官Joe Macri稱,“新思在內(nèi)存接口方面深厚的專業(yè)知識,使我們能夠?qū)BM2 IP成功地整合到‘Vega’ CPU架構(gòu)中,實現(xiàn)強大的功耗和內(nèi)存帶寬目標(biāo),服務(wù)于機器學(xué)習(xí)和高級圖形應(yīng)用程序。”

完整的DesignWare HBM2 IP解決方案提供的獨特功能,能夠使設(shè)計人員實現(xiàn)內(nèi)存帶寬、延遲和功耗目標(biāo)。DesignWare HBM2控制器支持鎖定步驟或內(nèi)存交錯模式下的偽信道操作,使用戶能在各自的流量模式基礎(chǔ)上實現(xiàn)帶寬最大化。HBM2控制器和PHY都采用了DFI 4.0兼容接口,簡化了自定義DFI兼容控制器和PHY的整合。

DesignWare HBM2 PHY IP提供四種經(jīng)過試驗的電源管理狀態(tài)和快速頻率切換,使SoC能通過不同運行頻率之間的快速切換,進行功耗管理。DesignWare HBM2 PHY支持符合JEDEC HBM2 SDRAM標(biāo)準(zhǔn)的引腳陣列,以實現(xiàn)最短的2.5D封裝路由和最高的信號完整性。為了簡化HBM2 SDRAM測試,DesignWare HBM2 PHY IP還提供帶有訪問回路模式的IEEE 1500端口,用于測試和試驗SoC與HBM2 SDRAM之間的鏈接。

Synopsys的HBM的VC驗證IP完全符合HBM JEDEC規(guī)范(包括HBM2),并提供協(xié)議、方法、驗證和生產(chǎn)力功能,包括內(nèi)置協(xié)議檢查、覆蓋和驗證計劃,以及Verdi®協(xié)議感知調(diào)試和性能分析,使用戶能快速驗證基于HBM的設(shè)計。

“在增加內(nèi)存帶寬的同時避免功耗和面積負(fù)擔(dān)過重對于圖形、HPC和網(wǎng)絡(luò)應(yīng)用來說至關(guān)重要。”Synopsys IP市場副總裁John Koeter稱,“作為領(lǐng)先的內(nèi)存IP供應(yīng)商,Synopsys與多位主要客戶緊密合作開發(fā)了HBM2 IP解決方案,使設(shè)計人員能滿足不斷增長的吞吐量要求,同時改善高性能SoC設(shè)計的延遲和功耗。”

可用性和資源

目前,DesignWare HBM2 PHY和VC驗證IP可用于14納米至7納米的處理技術(shù),其他處理技術(shù)正在開發(fā)中。欲知有關(guān)DesignWare HBM2控制器IP的適用性信息,請聯(lián)系Synopsys。

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