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基于FPGA開(kāi)發(fā)靜態(tài)無(wú)功補(bǔ)償控制器
“我們?cè)贜I CompactRIO平臺(tái)上開(kāi)發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時(shí)間又保證了系統(tǒng)的穩(wěn)定性。”挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時(shí)也帶來(lái)了無(wú)功分量和高次諧波等危害，
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Altera Cyclone IV GX系列FPGA開(kāi)發(fā)方案
Altera 公司的Cyclone IV 系列FPGA包括兩個(gè)系列:Cyclone IV E和Cyclone IV GX,具有低成本、低功耗的FPGA 架構(gòu),6 K 到150 K 的邏輯單元,高達(dá)6.3 Mb 的嵌入式存儲(chǔ)器,小于1.5 W 的總功耗;Cyclone IV GX 器件提供高達(dá)八個(gè)
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Altera Cyclone IV GX系列FPGA開(kāi)發(fā)方案
Altera 公司的Cyclone IV 系列FPGA包括兩個(gè)系列:Cyclone IV E和Cyclone IV GX,具有低成本、低功耗的FPGA 架構(gòu),6 K 到150 K 的邏輯單元,高達(dá)6.3 Mb 的嵌入式存儲(chǔ)器,小于1.5 W 的總功耗;Cyclone IV GX 器件提供高達(dá)八個(gè)
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Altera Cyclone IV GX系列FPGA開(kāi)發(fā)方案
Altera 公司的Cyclone IV 系列FPGA包括兩個(gè)系列:Cyclone IV E和Cyclone IV GX,具有低成本、低功耗的FPGA 架構(gòu),6 K 到150 K 的邏輯單元,高達(dá)6.3 Mb 的嵌入式存儲(chǔ)器,小于1.5 W 的總功耗;Cyclone IV GX 器件提供高達(dá)八個(gè)
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Altera Cyclone IV GX系列FPGA開(kāi)發(fā)方案
Altera Cyclone IV GX系列FPGA開(kāi)發(fā)方案
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Xilinx FPGA開(kāi)發(fā)環(huán)境的安裝方法
Xilinx FPGA開(kāi)發(fā)環(huán)境的安裝方法
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采用FPGA開(kāi)發(fā)真正符合需求的系統(tǒng)
采用FPGA開(kāi)發(fā)真正符合需求的系統(tǒng)
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Altera發(fā)布業(yè)界第一款28-nm FPGA開(kāi)發(fā)套件
21ic訊 Altera公司日前宣布開(kāi)始提供第一款帶有28-nm FPGA的開(kāi)發(fā)套件——Stratix® V GX FPGA信號(hào)完整性套件，在推動(dòng)業(yè)界28-nm FPGA發(fā)展方面樹(shù)立了新里程碑。這一全功能套件支持設(shè)計(jì)工程師加速高性能系統(tǒng)
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Altera發(fā)布業(yè)界第一款28-nm FPGA開(kāi)發(fā)套件
Altera發(fā)布業(yè)界第一款28-nm FPGA開(kāi)發(fā)套件
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FPGA開(kāi)發(fā)套件加速全高清HDR攝像機(jī)設(shè)計(jì)
為了向攝像機(jī)生產(chǎn)商提供高質(zhì)量的HDR攝像機(jī)參考設(shè)計(jì)，幫助其快速開(kāi)始基于FPGA的高清攝像機(jī)設(shè)計(jì)開(kāi)發(fā)，萊迪思半導(dǎo)體(Lattice)日前發(fā)布了其最新的HDR-60攝像機(jī)開(kāi)發(fā)套件。這是一款基于LatticeECP3 FPGA系列可量產(chǎn)的高清攝
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FPGA開(kāi)發(fā)套件加速全高清HDR攝像機(jī)設(shè)計(jì)
FPGA開(kāi)發(fā)套件加速全高清HDR攝像機(jī)設(shè)計(jì)
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全新FPGA開(kāi)發(fā)平臺(tái)（Xilinx ）
賽靈思公司 （Xilinx, Inc.）在 IBC 2010 展會(huì)上宣布推出一款全新開(kāi)發(fā)平臺(tái)，幫助工程師充分滿足快速發(fā)展的3D電視廣播與其它高清視頻應(yīng)用需求。賽靈思Spartan®-6 FPGA 廣播連接功能套件和廣播處理引擎IP核，可幫助
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搭建Xilinx FPGA開(kāi)發(fā)環(huán)境的方法
搭建Xilinx FPGA開(kāi)發(fā)環(huán)境的方法
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以智能型混合信號(hào)FPGA開(kāi)發(fā)真正符合需求的系統(tǒng)
以智能型混合信號(hào)FPGA開(kāi)發(fā)真正符合需求的系統(tǒng)
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以智能型混合信號(hào)FPGA開(kāi)發(fā)真正符合需求的系統(tǒng)
要實(shí)現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O(shè)計(jì)理由很簡(jiǎn)單，因?yàn)檫@樣就能將材料成本、部件庫(kù)存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時(shí)也有助于提高對(duì)知識(shí)產(chǎn)權(quán)的保護(hù)。如果一項(xiàng)設(shè)計(jì)功能的精髓能夠深植于單一芯片上，將會(huì)大大增加第三方取得這項(xiàng)設(shè)計(jì)的困難度。
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FPGA開(kāi)發(fā)中按鍵消抖與單脈沖發(fā)生器電路
FPGA開(kāi)發(fā)中常用到單脈沖發(fā)生器。一些文章介紹過(guò)產(chǎn)生單脈沖的電路，產(chǎn)生的單脈沖脈寬和相位都不能與時(shí)鐘同步，只能用在要求不嚴(yán)格的場(chǎng)合。筆者目前從事的課題中需要一個(gè)與時(shí)鐘周期等寬，相位與時(shí)鐘周期相同的鍵
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Cyclone III LS FPGA開(kāi)發(fā)套件(Altera)
Altera公司 宣布，開(kāi)始提供Cyclone® III LS FPGA開(kāi)發(fā)套件。利用該套件提供的硬件和軟件解決方案，用戶可以進(jìn)行Altera Cyclone III LS FPGA原型開(kāi)發(fā)，測(cè)試設(shè)計(jì)。這是功耗最低的FPGA，200K邏輯單元(LE)的靜態(tài)功耗不
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Cyclone III LS FPGA開(kāi)發(fā)套件(Altera)
Cyclone III LS FPGA開(kāi)發(fā)套件(Altera)
