高速ADC時鐘jitter求解
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?? 高速ADC的時鐘jitter會影響高速ADC的信噪比SNR，而信噪比決定了模擬前端輸入的有效范圍。所以需要先確定模擬前端的有效輸入范圍，然后確定應(yīng)該滿足的SNR，然后推導(dǎo)出時鐘jitter。
一、模擬前端動態(tài)輸入范圍和有效位ENOB的關(guān)系??????????????????????????????????????
假設(shè)ADC的最大輸入幅度是Vpp（單位V），分辨率位數(shù)N位，有效位數(shù)ENOB位。
?? 有效位數(shù)ENOB是ADC的N位分辨率中實際有用的位數(shù)。N位ADC理論最小分辨率滿足
然而如果ADC的噪聲信號大于1LSB，則ADC采樣信號的N位表示中并不是每一位都能表示采樣信號，所以實際的分辨率位數(shù)會小于N，實際的分辨率位數(shù)我們稱為有效位數(shù)ENOB。因此對于ADC來說，更加有效的參數(shù)是ENOB，而不是N，ADC實際的最小分辨率應(yīng)該為：
ADC的模擬輸入動態(tài)范圍為（VppMin，VppMax），VppMin和VppMax使用下面公式計算
模擬輸入的幅度寬度：
VppMax-VppMin=6.02ENOB
二、有效位ENOB、信噪比SNR、信納比SINAD，總諧波失真THD之間的關(guān)系
2.1、SNR
SNR的定義是信號幅度均方根與噪聲幅度均方根的比值。假設(shè)信號幅度均方根是S，噪聲均方根是N，則
2.3、SINAD
SINAD是信號幅度均方根與所有其它頻譜成分(包括諧波但不含直流)的和方根的平均值之比。假設(shè)信號諧波幅度均方根是N，則
2.2、THD
THD指的是基波信號的均方根值與其諧波(一般僅前5次諧波比較重要)的和方根的平均值之比。假設(shè)2次、3次、4次以上的和諧波失真分別為HD2，HD3，HDn，總諧波失真是D，則THD可以用下面公式求解：
有些ADC的datasheet提供里THD的值，但是也有一些沒有直接提供THD值得，沒有提供THD值得可以使用HD2，HD3，HDn計算。
2.4ENOB、SNR、SINAD、THD之間的關(guān)系
信納比和有效位數(shù)之間滿足一個確定的關(guān)系：
因此我們可以根據(jù)所需要的ENOB來推導(dǎo)出ADC需要滿足的SINAD的值。
由SINAD、THD和SNR的定義可以推導(dǎo)出如下公式：
THD是ADC可以通過ADC的datasheet直接查找到或者間接求出來，所以對于滿足需求的SINAD，我們能夠推導(dǎo)出來SNR應(yīng)該滿足的條件。
三、SNR求解
ADC的SNR主要由三部分引起：量化噪聲，熱噪聲，抖動噪聲。
3.1、量化噪聲
?ADC對采樣信號量化的時候，一定會產(chǎn)生一定的誤差，從量化上來講實際信號和量化后的信號之間的誤差最大為0.5LSB。量化誤差如下圖所示：
量化誤差引起的信噪比計算公式：
3.2、熱噪聲
熱噪聲是芯片固有的一個噪聲，由采樣緩存器噪聲，采樣切換阻抗等引起的，是一個定值，一般ADC都會給出熱噪聲的信噪比。如果沒有給出可以使用下面公式計算：
NSD：noise spectral density or noise floordensity
3.3、抖動噪聲
抖動噪聲主要是由于時鐘抖動和孔徑抖動造成的。
上面兩個圖分別描述了時鐘抖動和孔徑抖動對采樣點的影響，這兩個抖動都會造成采樣點的偏移，然而最后對數(shù)據(jù)處理的時候，會默認這些點都在理想位置采樣的，在頻域上會造成信號頻率的彌散；另外一個理解方法是每一個采樣點的實際采樣值和理想采樣值都有一定的偏差，相當(dāng)于對每一個點都疊加了一個噪聲。
時鐘抖動引起的噪聲的信噪比使用下面公式計算
從上面兩個公式可以得出信噪比與采樣時鐘jitter成反比，與輸入信號頻率成反比，因此對于輸入信號的頻率越高，對時鐘信號的jitter要求越嚴格。
3.4、總噪聲
ADC總噪聲是量化噪聲，抖動噪聲之和。量化噪聲很多時候并不考慮，因為很多時候熱噪聲會遠遠大于量化噪聲。當(dāng)信號頻率較低的時候，主要考慮熱噪聲，當(dāng)信號頻率較高的時候，才會考慮抖動噪聲
ADC總信噪比用下面公式計算：
四、jitter求解實例
?4.1、AD9680時鐘jitter求解
????AD9680:14位分辨率位數(shù)，孔徑抖動55fs，采樣頻率1GHz，THD值80dBFS，熱噪聲67dBFS，計算出來的jitter、SNR_jitter、SNR_ADC、fin、ENOB如下圖：
第一幅圖是jitter、fin、SNR之間的關(guān)系，紅色代表SNR_jitter，綠色代表SNR_ADC，從上往下是不同fin對應(yīng)的SNR，頻率是從上依次1MHz，到501MHZ，步長50MHz。
第二幅圖是jitter、fin、ENOB之間的關(guān)系，從上往下是不同fin對應(yīng)的SNR，頻率是從上依次1MHz，到501MHZ，步長50MHz。
從圖中可以看出：fin越高，信噪比越大，ENOB越小，jitter越大，信噪比越大，ENOB越小。為了保證AD9680比較好的轉(zhuǎn)換性能，最好使時鐘jitter低于150fs，能夠保證10位以上的有效位數(shù)。
5.2、ADS54j54時鐘jitter求解
???? ADS54j54:14位分辨率位數(shù)，孔徑抖動98fs，采樣頻率500GHz，THD值80dBFS，熱噪聲66dBFS，計算出來的jitter、SNR_jitter、SNR_ADC、fin、ENOB如下圖：
第一幅圖是jitter、fin、SNR之間的關(guān)系，紅色代表SNR_jitter，綠色代表SNR_ADC，從上往下是不同fin對應(yīng)的SNR，頻率是從上依次1MHz，到251MHZ，步長50MHz。
第二幅圖是jitter、fin、ENOB之間的關(guān)系，從上往下是不同fin對應(yīng)的SNR，頻率是從上依次1MHz，到251MHZ，步長50MHz。
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4.3、ADS6445時鐘jitter與AD9680時鐘jitter比較
從兩款芯片的jitter求解結(jié)果中能夠發(fā)現(xiàn)，采樣頻率越高，信號頻率越高的ADC對時鐘jitter要求越嚴格。AD9680為了保證比較好的性能，需要小于150fs的jitter；AD54J54為了滿足較好性能，需要小于300fs的jitter。
在翻閱不同ADC的datasheet，發(fā)現(xiàn)一個參數(shù)的規(guī)律，越是采樣速度高的ADC，孔徑抖動越小。這個參數(shù)是ADC本身固有的，是與芯片設(shè)計相關(guān)的?？讖蕉秳雍蜁r鐘抖動同樣的原理影響著ADC性能。為了更高的采樣頻率，芯片開發(fā)商會設(shè)計更小的孔徑抖動，通過這個參數(shù)，我們也可以快速估算時鐘抖動的大小。當(dāng)時鐘抖動小于孔徑抖動的時候，能得到非常好的ADC性能，當(dāng)兩者相仿的時候，依然能保持很好的性能，當(dāng)時鐘抖動是孔徑抖動的兩三倍的時候，性能還比較好，當(dāng)這個比例更大的時候，就需要參考采樣信號的頻率來具體分析。因此在設(shè)計ADC時鐘的時候，可以將抖動粗略設(shè)為孔徑抖動的兩倍以內(nèi)。
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