0 引言 在大規(guī)模高性能的ASIC設(shè)計中,對時鐘偏移(Clock Skew)的要求越來越嚴(yán)格,時鐘偏移是限制系統(tǒng)時鐘頻率的主要因素。而時鐘樹綜合又是減小時鐘偏移的有效途徑,
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