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基于FPGA+DSP 的通用SSR信號(hào)處理機(jī)
本文主要針對(duì)二次雷達(dá)的通用處理要求，采用流行的FPGA和DSP結(jié)構(gòu)的處理機(jī)，并且合理設(shè)計(jì)處理流程和算法，有效地整合二次雷達(dá)接收、發(fā)射、信號(hào)處理、點(diǎn)跡處理的功能，并適于FPGA 流水處理和DSP事務(wù)處理。該處理機(jī)結(jié)構(gòu)簡單、緊湊，功能強(qiáng)大。經(jīng)測試，能有效處理AC模式和S模式應(yīng)答信號(hào)，實(shí)施S模式詢問管理及相應(yīng)功能。
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unix中的信號(hào)處理機(jī)制
unix中的信號(hào)處理機(jī)制
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基于Virtex 4的雷達(dá)導(dǎo)引頭信號(hào)處理機(jī)的設(shè)計(jì)與實(shí)現(xiàn)
0 引言導(dǎo)彈主要依靠制導(dǎo)系統(tǒng)進(jìn)行制導(dǎo)，完成從發(fā)射到命中目標(biāo)的全過程。制導(dǎo)系統(tǒng)一般利用地面制導(dǎo)雷達(dá)或彈載導(dǎo)引頭對(duì)目標(biāo)進(jìn)行探測、參數(shù)計(jì)算、控制指令形成與傳輸、程序控制和伺服控制等。雷達(dá)導(dǎo)引頭是建立在雷達(dá)、自
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基于Virtex 4的雷達(dá)導(dǎo)引頭信號(hào)處理機(jī)的設(shè)計(jì)與實(shí)現(xiàn)
0 引言導(dǎo)彈主要依靠制導(dǎo)系統(tǒng)進(jìn)行制導(dǎo)，完成從發(fā)射到命中目標(biāo)的全過程。制導(dǎo)系統(tǒng)一般利用地面制導(dǎo)雷達(dá)或彈載導(dǎo)引頭對(duì)目標(biāo)進(jìn)行探測、參數(shù)計(jì)算、控制指令形成與傳輸、程序控制和伺服控制等。雷達(dá)導(dǎo)引頭是建立在雷達(dá)、自
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一種基于FPGA的雷達(dá)數(shù)字信號(hào)處理機(jī)設(shè)計(jì)與實(shí)現(xiàn)
摘要：結(jié)合具體的雷達(dá)導(dǎo)引頭型號(hào)項(xiàng)目．從數(shù)字信號(hào)處理機(jī)的原理出發(fā)，根據(jù)項(xiàng)目的要求提出了一種基于DBF技術(shù)的某型導(dǎo)引頭信號(hào)處理機(jī)設(shè)計(jì)方案，方案以Xilinx公司Virtex4 SX55 FPGA作為數(shù)字信號(hào)處理的核心器件，實(shí)現(xiàn)對(duì)6陣
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一種基于FPGA的雷達(dá)數(shù)字信號(hào)處理機(jī)設(shè)計(jì)與實(shí)現(xiàn)
摘要：結(jié)合具體的雷達(dá)導(dǎo)引頭型號(hào)項(xiàng)目．從數(shù)字信號(hào)處理機(jī)的原理出發(fā)，根據(jù)項(xiàng)目的要求提出了一種基于DBF技術(shù)的某型導(dǎo)引頭信號(hào)處理機(jī)設(shè)計(jì)方案，方案以Xilinx公司Virtex4 SX55 FPGA作為數(shù)字信號(hào)處理的核心器件，實(shí)現(xiàn)對(duì)6陣
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基于ADSP-Ts101的數(shù)字信號(hào)處理機(jī)實(shí)現(xiàn)
本文討論的是由高速DSP芯片ADSP—TS101構(gòu)成的數(shù)字式雷達(dá)信號(hào)處理器。
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基于ADSP-Ts101的數(shù)字信號(hào)處理機(jī)實(shí)現(xiàn)
本文討論的是由高速DSP芯片ADSP—TS101構(gòu)成的數(shù)字式雷達(dá)信號(hào)處理器。
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基于PCI總線數(shù)字信號(hào)處理機(jī)的硬件設(shè)計(jì)
本文介紹了基于PCI總線的DSP數(shù)字信號(hào)處理板的硬件結(jié)構(gòu)，并具體的討論了它在設(shè)計(jì)中的應(yīng)用方法。
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基于PCI總線數(shù)字信號(hào)處理機(jī)的硬件設(shè)計(jì)
本文介紹了基于PCI總線的DSP數(shù)字信號(hào)處理板的硬件結(jié)構(gòu)，并具體的討論了它在設(shè)計(jì)中的應(yīng)用方法。
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