SerDes

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SERDES是英文SERializer(串行器)/DESerializer(解串器)的簡(jiǎn)稱。它是一種主流的時(shí)分多路復(fù)用(TDM)、點(diǎn)對(duì)點(diǎn)(P2P)的串行通信技術(shù)。即在發(fā)送端多路低速并行信號(hào)被轉(zhuǎn)換成高速串行信號(hào)，經(jīng)過(guò)傳輸媒體(光纜或銅線)，最后在接收端高速串行信號(hào)重新轉(zhuǎn)換成低速并行信號(hào)。這種點(diǎn)對(duì)點(diǎn)的串行通信技術(shù)充分利用傳輸媒體的信道容量，減少所需的傳輸信道和器件引腳數(shù)目，提升信號(hào)的傳輸速度，從而大大降低通信成本。

光纖網(wǎng)絡(luò)在光纖視頻中的應(yīng)用

帶有 TI 視頻放大器、數(shù)據(jù)轉(zhuǎn)換器、電源管理和接口器件的光纖多路復(fù)用器/光傳輸系統(tǒng)視頻的方框圖 (SBD)。設(shè)計(jì)注意事項(xiàng)光纖視頻多路復(fù)用/光傳輸系統(tǒng) (OTS)在數(shù)字化過(guò)程中，高清晰度視頻和音頻每秒鐘通常會(huì)產(chǎn)生較大的數(shù)

顯示光電
2011-12-31

光纖網(wǎng)絡(luò) 數(shù)據(jù)轉(zhuǎn)換器 SERDES 光傳輸系統(tǒng)
低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

由于現(xiàn)代數(shù)字信號(hào)處理器(dsp)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步，現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號(hào)處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中，單片dsp的性能仍可能無(wú)法滿足需

數(shù)字電源
2011-12-22

全雙工低壓數(shù)據(jù)傳輸技術(shù) SERDES
低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

嵌入式教程
2011-12-22

全雙工低壓數(shù)據(jù)傳輸技術(shù) SERDES
Altera抖動(dòng)和SERDES體系結(jié)構(gòu)專家獲選IEEE院士

Altera公司近日宣布，李鵬博士(Dr. Mike Peng Li)已被IEEE 選為IEEE院士。李博士是Altera的研究和開(kāi)發(fā)設(shè)計(jì)師兼工程師，由于在抖動(dòng)測(cè)試技術(shù)設(shè)計(jì)上的突出貢獻(xiàn)而獲此殊榮。李鵬博士在現(xiàn)代光電子器件和系統(tǒng)中，李鵬博士

消費(fèi)電子
2011-12-20

IEEE Altera IO SERDES
Altera抖動(dòng)和SERDES體系結(jié)構(gòu)專家獲選IEEE院士

21ic訊 Altera公司日前宣布，李鵬博士(Dr. Mike Peng Li)已被IEEE 選為IEEE院士。李博士是Altera的研究和開(kāi)發(fā)設(shè)計(jì)師兼工程師，由于在抖動(dòng)測(cè)試技術(shù)設(shè)計(jì)上的突出貢獻(xiàn)而獲此殊榮。在現(xiàn)代光電子器件和系統(tǒng)中，李鵬博士

廠商動(dòng)態(tài)
2011-12-16

IEEE Altera IO SERDES
萊迪斯計(jì)劃打造中端FPGA旗艦，LatticeECP4上市

一直致力于中端和低密度FPGA產(chǎn)品開(kāi)發(fā)的萊迪思半導(dǎo)體公司日前再推力作——下一代LatticeECP4 FPGA系列。其具有6Gbps的SERDES、采用低成本wire-bond封裝、功能強(qiáng)大的DSP塊和具有基于硬IP的通信引擎，適用于成

電子設(shè)計(jì)自動(dòng)化
2011-12-13

DSP FPGA LATTICE SERDES
第四代無(wú)線基礎(chǔ)架構(gòu)的離散式 SerDes 解決方案

當(dāng)網(wǎng)絡(luò)設(shè)備制造商建置4G的基礎(chǔ)架構(gòu)時(shí)，對(duì)于分布式基站架構(gòu)部署中無(wú)線電設(shè)備控制及無(wú)線電設(shè)備之間的高序列數(shù)據(jù)速率需求將大幅升高。要滿足如此需求，光纖纜線兩端的SerDeson必須發(fā)揮更高的效能。網(wǎng)絡(luò)設(shè)備制造商可將系統(tǒng)切割開(kāi)來(lái)，便能使用同一個(gè)熟悉的FPGA平臺(tái)進(jìn)行邏輯層處理。

消費(fèi)電子
2011-07-01

無(wú)線離散 BSP SERDES
高性能FPGA中的高速SERDES接口

引言　串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代。起初， SERDES是獨(dú)立的ASSP或ASIC器

電子設(shè)計(jì)自動(dòng)化
2011-04-20

FPGA LATTICE SERDES接口 SERDES
符合EMI/EMC標(biāo)準(zhǔn)的SerDes——基本測(cè)試策略和指南

摘要：電磁干擾（EMI）和電磁兼容（EMC）測(cè)試是汽車應(yīng)用領(lǐng)域中串行器/解串器（SerDes）設(shè)計(jì)必須驗(yàn)證的參數(shù)，需要在設(shè)計(jì)之初謹(jǐn)慎考慮EMI和EMC問(wèn)題，避免不必要的設(shè)計(jì)修改。以下應(yīng)用筆記詳細(xì)介紹了如何在SerDes系統(tǒng)

測(cè)試測(cè)量
2011-03-31

串行器 EMI EMC標(biāo)準(zhǔn) SERDES
汽車后視安全系統(tǒng)視頻SerDes收發(fā)器（Intersil）

Intersil公司日前宣布針對(duì)汽車后視安全系統(tǒng)，推出ISL76321串行/解串器 (SerDes) 接口芯片。這款單片式收發(fā)器解決方案通過(guò)一條屏蔽雙絞線 (STP) 電纜傳送視頻數(shù)據(jù)、雙向控制信息和電源，從而簡(jiǎn)化系統(tǒng)設(shè)計(jì)。這款產(chǎn)品有

消費(fèi)電子
2010-12-24

收發(fā)器安全系統(tǒng) INTERSIL SERDES
汽車后視安全系統(tǒng)視頻SerDes收發(fā)器（Intersil）

Intersil公司日前宣布針對(duì)汽車后視安全系統(tǒng)，推出ISL76321串行/解串器 (SerDes) 接口芯片。這款單片式收發(fā)器解決方案通過(guò)一條屏蔽雙絞線 (STP) 電纜傳送視頻數(shù)據(jù)、雙向控制信息和電源，從而簡(jiǎn)化系統(tǒng)設(shè)計(jì)。這款產(chǎn)品有

電源-LED驅(qū)動(dòng)
2010-12-21

收發(fā)器安全系統(tǒng) INTERSIL SERDES
Avago率先通過(guò)40納米工藝技術(shù)取得28Gbps的SerDes性能表現(xiàn)

Avago Technologies日前宣布已在40納米CMOS工藝技術(shù)上取得28Gbps的串化器/并化器(SerDes)性能表現(xiàn)。這一里程碑標(biāo)志著集成SerDes知識(shí)產(chǎn)權(quán)(IP)的專用集成電路(ASIC)可實(shí)現(xiàn)更高的帶寬應(yīng)用，從而提高數(shù)據(jù)在服務(wù)器、路由器

通信技術(shù)
2010-11-04

40納米 GBPS AVAGO SERDES
光纖視頻多路復(fù)用/光傳輸系統(tǒng) (OTS)的設(shè)計(jì)方案

光纖視頻多路復(fù)用/光傳輸系統(tǒng) (OTS)的設(shè)計(jì)方案

嵌入式教程
2010-10-11

光纖數(shù)據(jù)轉(zhuǎn)換器 SERDES 光傳輸系統(tǒng)
基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

　　本文討論利用帶嵌入式SERDES收發(fā)器和CPRI鏈路IP內(nèi)核的低成本FPGA，來(lái)實(shí)現(xiàn)電信系統(tǒng)低延遲變化設(shè)計(jì)的考慮因素。　　無(wú)線電信設(shè)備制造商正受到以更小體積、更低功耗、更低制造成本來(lái)布署基站架構(gòu)的壓力。當(dāng)通過(guò)WiMa

數(shù)字電源
2010-10-10

電信收發(fā)器 FIFO SERDES
基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

嵌入式教程
2010-10-10

電信收發(fā)器 FIFO SERDES
安華高在40nm CMOS工藝上實(shí)現(xiàn)25Gbps的SerDes內(nèi)核

Avago Technologies(安華高科技)宣布，已經(jīng)在40nm CMOS工藝技術(shù)上達(dá)到25Gbps的SerDes性能表現(xiàn)，這個(gè)里程碑是Avago長(zhǎng)久以來(lái)ASIC知識(shí)產(chǎn)權(quán)(IP, Intellectual Property)性能突破歷程上的另一項(xiàng)重要成就。Avago是為通信、

消費(fèi)電子
2010-02-25

內(nèi)核 CMOS工藝 GBPS SERDES
K-micro和安立合作開(kāi)發(fā)首套10G EPON芯片組測(cè)試工具

國(guó)際電子商情訊 ASIC制造領(lǐng)域的領(lǐng)導(dǎo)者 K-micro公司，和安立公司共同宣布開(kāi)發(fā)出全球第一款測(cè)量分析10Gbps EPON芯片組的測(cè)量方法和工具，運(yùn)用安立公司的MP1800A系列誤碼測(cè)試儀成功測(cè)量K-micro公司的CTXL1 10G EPON Ser

消費(fèi)電子
2009-12-10

芯片組 MICRO EPON SERDES
基于FPGA的DVI/HDMI接口實(shí)現(xiàn)

在過(guò)去幾年中，具有高清晰度視頻顯示器的一些產(chǎn)品大幅度增加。高清晰度視頻顯示器被集成在這些產(chǎn)品的內(nèi)部，或者放在產(chǎn)品的外面。原始設(shè)備制造商正在期望能夠利用標(biāo)準(zhǔn)的平板顯示器及接口技術(shù)來(lái)降低產(chǎn)品的成本，并提供

電子設(shè)計(jì)自動(dòng)化
2009-05-15

FPGA VI HDMI接口 SERDES
Serdes面臨技術(shù)轉(zhuǎn)變，ISSCC專家組就向ADC轉(zhuǎn)移的可能進(jìn)行討論

Serdes，作為過(guò)去十幾年來(lái)一直追求高速率設(shè)計(jì)的串行/解串芯片，將面臨一個(gè)徹底的轉(zhuǎn)變。根據(jù)國(guó)際固態(tài)電路會(huì)議（ISSCC）的專家組討論結(jié)果，這些設(shè)備將未來(lái)設(shè)計(jì)中從原來(lái)的模擬技術(shù)轉(zhuǎn)變?yōu)閿?shù)字技術(shù)。五個(gè)討論專題中主要

消費(fèi)電子
2009-02-17

ADC GBPS ISSCC SERDES
Achronix——打造FPGA初創(chuàng)公司的“高速”夢(mèng)

美國(guó)FPGA初創(chuàng)公司Achronix近日宣布，全球速度最快的FPGA產(chǎn)品SPEEDSTER SPD60現(xiàn)已開(kāi)始供貨。該公司希望SPD60及其后續(xù)產(chǎn)品能夠在網(wǎng)絡(luò)、電信、測(cè)試與測(cè)量、加密以及其它高性能應(yīng)用領(lǐng)域占據(jù)一席之地。盡管創(chuàng)始人、董

消費(fèi)電子
2008-12-09

FPGA NI AC SERDES

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SerDes

光纖網(wǎng)絡(luò)在光纖視頻中的應(yīng)用

低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

Altera抖動(dòng)和SERDES體系結(jié)構(gòu)專家獲選IEEE院士

Altera抖動(dòng)和SERDES體系結(jié)構(gòu)專家獲選IEEE院士

萊迪斯計(jì)劃打造中端FPGA旗艦，LatticeECP4上市

第四代無(wú)線基礎(chǔ)架構(gòu)的離散式 SerDes 解決方案

高性能FPGA中的高速SERDES接口

符合EMI/EMC標(biāo)準(zhǔn)的SerDes——基本測(cè)試策略和指南

汽車后視安全系統(tǒng)視頻SerDes收發(fā)器（Intersil）

汽車后視安全系統(tǒng)視頻SerDes收發(fā)器（Intersil）

Avago率先通過(guò)40納米工藝技術(shù)取得28Gbps的SerDes性能表現(xiàn)

光纖視頻多路復(fù)用/光傳輸系統(tǒng) (OTS)的設(shè)計(jì)方案

基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

安華高在40nm CMOS工藝上實(shí)現(xiàn)25Gbps的SerDes內(nèi)核

K-micro和安立合作開(kāi)發(fā)首套10G EPON芯片組測(cè)試工具

基于FPGA的DVI/HDMI接口實(shí)現(xiàn)

Serdes面臨技術(shù)轉(zhuǎn)變，ISSCC專家組就向ADC轉(zhuǎn)移的可能進(jìn)行討論

Achronix——打造FPGA初創(chuàng)公司的“高速”夢(mèng)

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