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高速設(shè)計中的信號完整性和電源完整性
信號完整性 (SI) 和電源完整性 (PI) 是兩個不同但相關(guān)的分析領(lǐng)域，涉及數(shù)字電路的正常運(yùn)行。在信號完整性方面，主要關(guān)注的是確保傳輸?shù)?1 在接收器處看起來像 1(0 也一樣)。在電源完整性方面，主要關(guān)注的是確保為驅(qū)動器和接收器提供足夠的電流來發(fā)送和接收 1 和 0。因此，電源完整性可以被視為信號完整性的一個子集。實際上，它們都是與數(shù)字電路的正確模擬操作有關(guān)的分析。
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高速 SerDes 應(yīng)用中的信號完整性實用指南，第 2 部分
本系列第一部分中描述的簡單情況在實際應(yīng)用中很少見。當(dāng)高頻信號通過非理想路徑(例如 PCB 通孔)時，事情會變得更加復(fù)雜，PCB 通孔充當(dāng)從 PCB 一層到另一層的導(dǎo)體，從而產(chǎn)生阻抗變化。
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高速 SerDes 應(yīng)用中的信號完整性實用指南，第 1 部分
信號完整性是許多設(shè)計人員在高速數(shù)字電路設(shè)計中處理的主要主題之一。當(dāng)信號通過封裝結(jié)構(gòu)、PCB 走線、通孔、柔性電纜和連接器等互連件在從發(fā)送器到接收器的路徑上傳播時，它會導(dǎo)致數(shù)字信號波形的質(zhì)量下降和時序錯誤。
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PCB設(shè)計指南,如何提高信號完整性
制定了PCB設(shè)計指南,作為電路設(shè)計工程師達(dá)到行業(yè)標(biāo)準(zhǔn)的基準(zhǔn)。遵循這些準(zhǔn)則將確保更好的可制造性和穩(wěn)健的產(chǎn)品性能。改進(jìn)產(chǎn)品可測試性和可制造性的設(shè)計準(zhǔn)則。他們的特色建議,以提高信號完整性和電磁兼容性(EMC)的印刷電路板,從而提高一個產(chǎn)品的整體性能。本文將概述各種PCB設(shè)計指南,以提高PCB的信號完整性。遵循這些指導(dǎo)方針將有助于工程師?PCB制造 .
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PCB走線基礎(chǔ)(一)：電源完整性與PDN設(shè)計
SI（信號完整性）研究的是信號的波形質(zhì)量，而PI（電源完整性）研究的是電源波形質(zhì)量， PI研究的對象是PDN（Power Distribution Network，電源分配網(wǎng)絡(luò)），它是從更加系統(tǒng)的角度來研究電源問題，消除或緩解電源噪聲，滿足負(fù)載對不同頻率電流的需求，為負(fù)載提供干凈、穩(wěn)定、可靠的電源，和SI一樣，PI也是PCB工程師的基本要求之一，拉線拉的好不好，PDN是重要考核方向之一。
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模擬電磁干擾有可能嗎？
如今，由高頻多相 DC/DC 轉(zhuǎn)換器驅(qū)動的千兆赫處理器以千兆赫茲的速度與內(nèi)存通信。在這些頻率下，組件和印刷電路板 (PCB) 寄生阻抗會產(chǎn)生與頻率相關(guān)的電壓降、天線結(jié)構(gòu)和 PCB 諧振，進(jìn)而產(chǎn)生電磁干擾 (EMI)、信號完整性和電源完整性 (SI/PI) 問題。在上一篇文章中，我研究了使用 LMG5200 半橋 GaN 開關(guān)等超快功率晶體管滿足電磁兼容性的挑戰(zhàn)。在這篇文章中，我們將介紹高度復(fù)雜的軟件工具，這些工具可以幫助在制造之前識別 PCB 問題區(qū)域。
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如何保證多相智能功率級應(yīng)用中的信號完整性
雖然適當(dāng)?shù)拇箅娏鞴β始壊季衷?DC/DC 應(yīng)用中始終很重要，但在印刷電路板 (PCB) 布局期間注意穩(wěn)壓器信號路由比以往任何時候都更加重要。
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振鈴型干擾信號完整性補(bǔ)償方法研究
摘 要 ：對于電子產(chǎn)品普遍存在信號完整性干擾問題的現(xiàn)狀，以較為典型的振鈴型干擾信號為對象，通過嚴(yán)格的信號完整性分析，研究了一種基于阻容特性匹配的方法。通過對振鈴型干擾信號進(jìn)行有效成分的優(yōu)化，簡單有效地改善信號波形，降低因為信號完整性問題導(dǎo)致故障代價的可能性。通過基本數(shù)學(xué)模型的建立，定位信號干擾來源， 分析信號傳輸路徑阻抗分布，計算阻性阻抗和容性阻抗匹配的理論數(shù)值，達(dá)到消減信號反射和增強(qiáng)衰減阻尼的目的。經(jīng)過對比試驗，驗證了所提研究思路及方法的正確性和可行性。
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基于65 nm工藝的SOC物理設(shè)計中的關(guān)鍵技術(shù)研究
摘 要：隨工藝的演進(jìn)，集成電路發(fā)展已經(jīng)進(jìn)入超深亞微米階段，芯片的成本、，性能、功耗、信號完整性等問題將成 為制約SOC芯片設(shè)計的關(guān)鍵問題。文章基于65GP工藝的實際項目模塊級物理設(shè)計，在現(xiàn)超深亞微米下，對芯片的低功耗、 congestion,信號完整，性等后端物理設(shè)計等關(guān)鍵問題進(jìn)行了細(xì)致研究，并提出了一些新方法和新思想，從而提高了signoff的交 付質(zhì)量，完成了tapeout要求。
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si信號完整性
信號完整性是指在高速電路設(shè)計中由互連線所引起的所有問題。信號具備信號完整性是指在不影響系統(tǒng)中其他信號質(zhì)量的前提下，接收端能夠接收到符合邏輯電平要求、時序要求和相位要求的信號。信號完整性設(shè)計的根本性目標(biāo)是保證信號波形的完整和信號時序的完整。宏觀的信號完整性問題可以分為四類：
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數(shù)字后端如何做信號完整性
數(shù)字后端，顧名思義，它處于數(shù)字IC設(shè)計流程的后端，屬于數(shù)字IC設(shè)計類崗位的一種。 在IC設(shè)計中，數(shù)字后端所占的人數(shù)比重一直是最多的，而且隨著芯片規(guī)模不斷加大，后端工程師需要的人數(shù)將會越來越多。
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常見的信號完整性問題
隨著器件工作頻率越來越高，高速PCB設(shè)計所面臨的信號完整性等問題成爲(wèi)傳統(tǒng)設(shè)計的一個瓶頸，工程師在設(shè)計出完整的解決方案上面臨越來越大的挑戰(zhàn)。盡管有關(guān)的高速仿真工具和互連工具可以幫助設(shè)計師解決部分難題，但高速PCB設(shè)計也更需要經(jīng)驗的不斷積累及業(yè)界間的深入交流。
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信號完整性與電源完整性分析
信號完整性(SI)和電源完整性(PI)是兩種不同但領(lǐng)域相關(guān)的分析，涉及數(shù)字電路正確操作。在信號完整性中，重點是確保傳輸?shù)?在接收器中看起來就像 1(對0同樣如此)。在電源完整性中，重點是確保為驅(qū)動器和接收器提供足夠的電流以發(fā)送和接收1和0。因此，電源完整性可能會被認(rèn)為是信號完整性的一個組成部分。實際上，它們都是關(guān)于數(shù)字電路正確模擬操作的分析。
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信號完整性問題有哪些
當(dāng)今的電子設(shè)計工程師可以分成兩種，一種是已經(jīng)遇到了信號完整性問題，一種是將要遇到信號完整性問題。
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信號完整性包括哪些
信號完整性(英語：Signal integrity, SI)是對于電子信號質(zhì)量的一系列度量標(biāo)準(zhǔn)。在數(shù)字電路中，一串二進(jìn)制的信號流是通過電壓(或電流)的波形來表示。
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信號完整性中，什么是TDR阻抗測量？
▼點擊名片，關(guān)注公眾號▼隨著科學(xué)技術(shù)的不斷發(fā)展，對各數(shù)字接口的速度要求越來越高，對信號完整性的要求隨之越來越嚴(yán)苛。控制阻抗，是信號完整性重要要求之一，TDR是測量特性阻抗的基本技術(shù)。今天就來介紹下TDR測量的基本原理與應(yīng)用。加微信chunhou0820，私信“TDR”獲取更多資料...
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理解信號完整性中，TDR阻抗測量的原理與應(yīng)用
▼點擊名片，關(guān)注公眾號▼隨著科學(xué)技術(shù)的不斷發(fā)展，對各數(shù)字接口的速度要求越來越高，對信號完整性的要求隨之越來越嚴(yán)苛?？刂谱杩梗切盘柾暾灾匾笾?，TDR是測量特性阻抗的基本技術(shù)。今天就來介紹下TDR測量的基本原理與應(yīng)用。加微信chunhou0820，私信“TDR”獲取更多資料...
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信號完整性系列之“減小輻射的20H原則”
本文主要介紹電源平面處理時的20H原則。
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信號完整性系列之“減小串?dāng)_的3W原則”
本文主要介紹PCB設(shè)計中常見的“3W原則”。
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信號完整性系列之“如何降低電源紋波噪聲”
本文主要介紹開關(guān)電源紋波噪聲的產(chǎn)生及如何降低。
